机械外形尺寸与焊盘 (Land Pattern) (DIP-8)
由芯片数据手册提取并按 IPC-7351B 规范化封装本体尺寸 (D × E)Nominal
9.62 × 6.35 mm
封装高度 (A) 与引脚间距 (e)IPC-7351B
A=4.20mm · e=2.54mm
焊盘尺寸 (W × L)Level B
1.60 × 1.60 mm
引脚数 / 总焊盘数Topology
8P / 8Pad (THT_DIP)
推荐外围 BOM 器件与原位替代料号 (Drop-in)
标准应用电路伴随无源器件及引脚 1:1 兼容替代型号| 位号 / 替代型号 | 参数值 / 封装 | 电路作用与 PCB 布局规则 (Layout Rule) |
|---|---|---|
| C_ctrl BOM | 10nF (0.01µF) Ceramic 0603 / Disc | 走线尽可能短粗,滤波电容紧贴电源引脚放置。 |
| C_dec BOM | 100nF Ceramic + 10µF Electrolytic Radial / 0805 | VCC(引脚 8)开关瞬态尖峰去耦(约 150mA 穿通电流)— 紧靠引脚 8-1 放置。 |
| R1, R2 + C_timing BOM | R1=4.7kΩ, R2=47kΩ, C=100nF 0603 / THT | 连接至 DISCH(引脚 7)、THRES(引脚 6)、TRIG(引脚 2)的 RC 定时网络 — 不用时将 RESET 接 VCC。 |
| SA555P / SE555P Texas Instruments | 100% Drop-in | 555 定时器 100% Pin-to-Pin DIP-8 兼容替换型号。 |
| TLC555CP / LMC555CN Texas Instruments | 100% Drop-in | 555 定时器 100% Pin-to-Pin DIP-8 兼容替换型号。 |
工程技术常见问题 (FAQ) — NE555P (DIP-8)
关于引脚定义、IPC-7351B 焊盘尺寸及 CAD 格式导出的快速解答NE555P (DIP-8) 的引脚排列 (Pinout) 与供电电压参数是什么?
TI 生产的 NE555P 采用 DIP-8 封装,共 8 脚,引脚间距 2.54 mm,工作电压范围 VCC 4.5 V to 16 V。主要引脚包括:1 (GND: 电源参考地引脚 (GND)), 2 (TRIG: NE555 精密定时器功能引脚 (TRIG)), 3 (OUT: NE555 精密定时器功能引脚 (OUT)), 4 (RESET: 系统复位 / 芯片使能引脚 (RESET)), 5 (CONT: NE555 精密定时器功能引脚 (CONT)), 6 (THRES: NE555 精密定时器功能引脚 (THRES))。
NE555P 的 IPC-7351B 标准 PCB 封装焊盘尺寸是多少?
依据数据手册机械尺寸及 IPC-7351B Level B (中等密度) 规范,NE555P (DIP-8) 本体轮廓为 6.35 × 9.62 mm,引脚间距 e = 2.54 mm,共计 8 个铜箔焊盘。
哪里可以下载 NE555P 的 KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr) 与 3D STEP 模型?
您可以在本页面免费下载基于 CERN-OHL-P-2.0 开源硬件协议且通过几何校验的 NE555P (TI, DIP-8) 完整 CAD 库,包含 KiCad 8 封装、原理图符号、Fusion 360 / Eagle (.lbr) 以及 3D STEP AP214 / WebGL GLB 模型。
静态索引附录:引脚分配表 (8 脚) 与 NE555 系列同族变体展开静态数据表
| 引脚编号 (Pin #) | 信号名称 (Signal Name) | 电气类型 (Type) | 功能说明与 PCB 设计建议 |
|---|---|---|---|
| 1 | GND | GND | 0V 接地回路引脚 (GND),用于芯片内部核心逻辑、I/O 驱动器及模拟电路参考地。 |
| 2 | TRIG | Analog | 555 定时器核心功能端子 (TRIG):Trigger comparator input (< 1/3 VCC sets flip-flop and drives OUT high) |
| 3 | OUT | Digital_IO | 555 定时器核心功能端子 (OUT):Push-pull timer output stage (capable of sinking or sourcing up to 200mA) |
| 4 | RESET | Digital_IO | 低电平有效硬件复位引脚 (RESET),拉低将复位内核与所有外设寄存器。 |
| 5 | CONT | Analog | 555 定时器核心功能端子 (CONT):Internal 2/3 VCC voltage divider access (bypass to GND via 10nF capacitor) |
| 6 | THRES | Analog | 555 定时器核心功能端子 (THRES):Threshold comparator input (> 2/3 VCC resets flip-flop and drives OUT low) |
| 7 | DISCH | Open_Drain | 555 定时器核心功能端子 (DISCH):Open-collector discharge transistor terminal for timing capacitor |
| 8 | VCC | Power_In | 主供电输入引脚 (VCC),工作电压域:4.5V ~ 16.0V VCC(最高耐压:18.0V)。 |














