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CH32V005D6U6 (QFN-12(2x2)) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH32V005D6U6

WCHID: C49006243QFN-12(2x2) · 13 ピン · Pitch 0.40mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH32V005D6U6 (QFN-12(2x2))1PA1/T1C2/OPN2PA13PA24VDD5PD06VDD7PC013PC612PC511PC410PC39PC28PC1Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.815.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
12345678910111213E=2.00mm · Pitch e=0.40mmD=2.00mm-3-2-101233210-1-2-3mm
3. 3Dモデル
パッケージ外形: 2.00mm × 2.00mm · ピッチ: 0.40mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (13/13)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1PA1/T1C2/OPN0/XI/A1I/OマルチプレクスI/O・ペリフェラル端子 PA1/T1C2/OPN0/XI/A1 (RTC/CLK)
2PA1I/OマルチプレクスI/O・ペリフェラル端子 PA1 (ADC)
3PA2I/OマルチプレクスI/O・ペリフェラル端子 PA2 (ADC)
4VDDPower電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)
5PD0I/OマルチプレクスI/O・ペリフェラル端子 PD0 (General)
6VDDPower電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)
7PC0I/OマルチプレクスI/O・ペリフェラル端子 PC0 (PWM)
8PC1I/OマルチプレクスI/O・ペリフェラル端子 PC1 (SPI, I2C)
9PC2I/OマルチプレクスI/O・ペリフェラル端子 PC2 (UART, I2C)
10PC3I/OマルチプレクスI/O・ペリフェラル端子 PC3 (PWM)
11PC4I/OマルチプレクスI/O・ペリフェラル端子 PC4 (ADC, RTC/CLK)
12PC5I/OマルチプレクスI/O・ペリフェラル端子 PC5 (SPI)
13PC6I/OマルチプレクスI/O・ペリフェラル端子 PC6 (SPI)
PIN 1 PA1/T1C2/OPN0/XI/A1
I/O
マルチプレクスI/O・ペリフェラル端子 PA1/T1C2/OPN0/XI/A1 (RTC/CLK)
設計上の注意点: Signal terminal PA1/T1C2/OPN0/XI/A1 (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: PA1/T1C2/OPN0/XI/A1. Supported peripheral buses: RTC/CLK.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 9 抽出図面)

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PDF VIEWERメーカー公式データシート: CH32V005D6U6 (WCH · QFN-12(2x2))
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1. 実装3D外観モデルREPRESENTATIVE
CH32V005D6U6 (QFN-12(2x2)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH32V005D6U6 (QFN-12(2x2)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (13ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH32V005D6U6 (QFN-12(2x2)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH32V005D6U6 (QFN-12(2x2)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-12(2x2) · 2.00×2.00mm · ピッチ 0.40mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH32V005D6U6 (QFN-12(2x2)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (13 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH32V005D6U6 (QFN-12(2x2)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (9 点 · 1/1 ページ)
CH32V005 シリーズの切り抜きなし原本図面 9 点中 1–9 点目を表示
P10 · p10_fig011401×1408px
CH32V005D6U6 (QFN-12(2x2)) — 24 CH32V006E8R 1
24 CH32V006E8R 1
P10 · p10_fig02997×652px
CH32V005D6U6 (QFN-12(2x2)) — V2.0 8
V2.0 8
P10 · p10_fig01P10
CH32V005D6U6 (QFN-12(2x2)) — Datasheet Page 10 (p10_fig01)
Datasheet Page 10 (p10_fig01)
P13 · p13_fig011008×818px
CH32V005D6U6 (QFN-12(2x2)) — 0
0
P13 · p13_fig021261×1512px
CH32V005D6U6 (QFN-12(2x2)) — PC6/T1C1_/T1C3N_/SDA_/MOSI
PC6/T1C1_/T1C3N_/SDA_/MOSI
P13 · p13_fig031232×799px
CH32V005D6U6 (QFN-12(2x2)) — V2.0 11
V2.0 11
P13 · p13_fig02P13
CH32V005D6U6 (QFN-12(2x2)) — Datasheet Page 13 (p13_fig02)
Datasheet Page 13 (p13_fig02)
P2 · p02_fig01PDF 内の全パッケージ
CH32V005D6U6 (QFN-12(2x2)) — 型号 Code Flash RAM | 通 用 I/O | 高 级 定 时 器 | 通 用 定 时 | 器 | 精 简 定 时 | 器 | 看 门 狗 | ADC | 电容 触摸 按键 | OPA 运放 | OPA 轮询 串口 I2C SPI | 最大 工作 环境 温度 | 封装 形式 | CH32V006K8U7 62K 8K 31 1 1 1 2 8+2 8 路 1 3 路 2 1 1 105℃ QFN32 | CH32V006E8R6 62K 8K 22 1 1 1 2
型号 Code Flash RAM | 通 用 I/O | 高 级 定 时 器 | 通 用 定 时 | 器 | 精 简 定 时 | 器 | 看 门 狗 | ADC | 电容 触摸 按键 | OPA 运放 | OPA 轮询 串口 I2C SPI | 最大 工作 环境 温度 | 封装 形式 | CH32V006K8U7 62K 8K 31 1 1 1 2 8+2 8 路 1 3 路 2 1 1 105℃ QFN32 | CH32V006E8R6 62K 8K 22 1 1 1 2
P40 · p40_fig01PDF 内の全パッケージ
CH32V005D6U6 (QFN-12(2x2)) — CH32V006/V005 数据手册 https://wch.cn
CH32V006/V005 数据手册 https://wch.cn

電気仕様 & 部品詳細スペック (CH32V005D6U6)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
組込みマイクロコントローラ (MCU)
詳細概要:CH32V005D6U6 (QFN-12(2x2)) は 12 ピンの組込みマイクロコントローラ (MCU)で、パッケージ外形は 2.00 × 2.00 × 0.90 mm（ピンピッチ e = 0.40 mm）です。動作電源電圧 3.0V ~ 3.6V (Typ 3.3V)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、UART, SPI, I2C, ADC, PWM, RTC/CLK インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
3.0V ~ 3.6V (Typ 3.3V)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
25MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
2.00 × 2.00 × 0.90 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-12(2x2))
ピン数・リードピッチN / e
12 Pins | Pitch e = 0.40 mm (15.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
UART, SPI, I2C, ADC, PWM, RTC/CLK
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル13 ピン自動バス分類
OK
IPC-7351B フットプリント13 パッド · ピッチ 0.40mm
OK
IPC-7525 60% はんだペースト開口EPAD 1.10×1.10mm メッシュ分割
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified
IPC-7351B

同系列ファミリー & 同一データシート部品 — CH32V005 (2)

同一データシートを共有するパッケージ違いやバリアントを選択

機械寸法 & ランドパターン (QFN-12(2x2))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
2.00 × 2.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.90mm · e=0.40mm
パッド寸法 (W × L)Level B
0.28 × 0.80 mm
ピン数 / 総パッド数Topology
13P / 13Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-12(2x2)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH32V005D6U6 (QFN-12(2x2))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH32V005D6U6 (QFN-12(2x2)) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH32V005D6U6 (QFN-12(2x2) パッケージ) は全 13 ピン構成で、ピンピッチは 0.40 mm です。主なピン：1 (PA1/T1C2/OPN0/XI/A1: マルチプレクスI/O・ペリフェラル端子 PA1/T1C2/OPN0/XI/A1 (RTC/CLK)), 2 (PA1: マルチプレクスI/O・ペリフェラル端子 PA1 (ADC)), 3 (PA2: マルチプレクスI/O・ペリフェラル端子 PA2 (ADC)), 4 (VDD: 電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)), 5 (PD0: マルチプレクスI/O・ペリフェラル端子 PD0 (General)), 6 (VDD: 電源供給入力 (VDD — 3.3V / 5.0V Standard Logic))。

CH32V005D6U6 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH32V005D6U6 (QFN-12(2x2)) の本体外形は 2.00 × 2.00 mm、ピッチ e = 0.40 mm、合計 13 パッドで構成されています（中央放熱パッド EPAD 1.10 × 1.10 mm、IPC-7525 60% 開口ペーストマスク付き）。

CH32V005D6U6 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH32V005D6U6 (WCH, QFN-12(2x2)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (13 ピン) & CH32V005 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1PA1/T1C2/OPN0/XI/A1Digital_IO信号端子 PA1/T1C2/OPN0/XI/A1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA1/T1C2/OPN0/XI/A1。対応バス/インターフェース: RTC/CLK。
2PA1Digital_IO信号端子 PA1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA1。対応バス/インターフェース: ADC。
3PA2Digital_IO信号端子 PA2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA2。対応バス/インターフェース: ADC。
4VDDPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 5.5V) です。
5PD0Digital_IO信号端子 PD0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD0。対応バス/インターフェース: General。
6VDDPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 5.5V) です。
7PC0Digital_IO信号端子 PC0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC0。対応バス/インターフェース: PWM。
8PC1Digital_IO信号端子 PC1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: I2C_SDA, SPI_NSS_。対応バス/インターフェース: SPI, I2C。
9PC2Digital_IO信号端子 PC2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: I2C_SCL。対応バス/インターフェース: UART, I2C。
10PC3Digital_IO信号端子 PC3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC3。対応バス/インターフェース: PWM。
11PC4Digital_IO信号端子 PC4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC4。対応バス/インターフェース: ADC, RTC/CLK。
12PC5Digital_IO信号端子 PC5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI_SCK。対応バス/インターフェース: SPI。
13PC6Digital_IO信号端子 PC6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI_MOSI。対応バス/インターフェース: SPI。
探索部品パッケージメーカーアップロード