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FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Symbol, Footprint IPC-7351B & 3D STEP Model

FAN5341UMPX-F106

onsemiID: C3213615UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT · 7 ピン · Pitch 0.65mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT)1VOUT2VIN3EN4FB7EP6GND5SWGrid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.810.25.10-5.1-10.2mm
2. 2Dフットプリント
1234567E=2.00mm · Pitch e=0.65mmD=2.00mm-3-2-101233210-1-2-3mm
3. 3Dモデル
パッケージ外形: 2.00mm × 2.00mm · ピッチ: 0.65mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (7/7)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1VOUTPower安定化電源出力 (VOUT — 2.7 V to 5.5 V)
2VINPower電源供給入力 (VIN — 2.7 V to 5.5 V)
3ENIシステムイネーブル・ハードウェアリセット (EN)
4FBI/OマルチプレクスI/O・ペリフェラル端子 FB (General)
5SWI/OマルチプレクスI/O・ペリフェラル端子 SW (General)
6GNDGNDグラウンド基準端子 (GND)
7EPGND露出サーマルパッド・グラウンド (EP)
PIN 1 VOUT
Power
安定化電源出力 (VOUT — 2.7 V to 5.5 V)
設計上の注意点: BoostOutputVoltage Outputoftheboostregulator ConnecttheLEDstothispin Connect Capaci. . . COUT (Output t or) to G ND .
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 11 抽出図面)

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PDF VIEWERメーカー公式データシート: FAN5341UMPX-F106 (onsemi · UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT)
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1. 実装3D外観モデルREPRESENTATIVE
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (7ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 4. パッケージ外形寸法図 (D×E×A)
UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT · 2.00×2.00mm · ピッチ 0.65mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 5. 推奨PCBフットプリント
IPC-7351B パッド (7 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (11 点 · 1/1 ページ)
FAN5341 シリーズの切り抜きなし原本図面 11 点中 1–11 点目を表示
P10 · p10_fig01パッケージ完全一致
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — UDFN6 2x2, 0.65P | CASE 517DS | ISSUE O | DATE 31 OCT 2016 | MECHANICAL CASE OUTLINE PACKAGE DIMENSIONS | 98AON13697G DOCUMENT NUMBER: | DESCRIPTION: | Electronic versions are uncontrolled except when accessed directly from the Document Rep
UDFN6 2x2, 0.65P | CASE 517DS | ISSUE O | DATE 31 OCT 2016 | MECHANICAL CASE OUTLINE PACKAGE DIMENSIONS | 98AON13697G DOCUMENT NUMBER: | DESCRIPTION: | Electronic versions are uncontrolled except when accessed directly from the Document Rep
P1 · p01_fig01424×386px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — www.onsemi.com
www.onsemi.com
P1 · p01_fig01P1
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Datasheet Page 1 (p01_fig01)
Datasheet Page 1 (p01_fig01)
P2 · p02_fig011480×870px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Figure 1. Typical Application
Figure 1. Typical Application
P2 · p02_fig021489×927px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Figure 2. Functional Block Diagram
Figure 2. Functional Block Diagram
P2 · p02_fig02P2
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Datasheet Page 2 (p02_fig02)
Datasheet Page 2 (p02_fig02)
P3 · p03_fig01547×350px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Figure 3. UMLP6 Package (Top View)
Figure 3. UMLP6 Package (Top View)
P3 · p03_fig021869×1354px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Figure 3. UMLP6 Package (Top View)
Figure 3. UMLP6 Package (Top View)
P3 · p03_fig02P3
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Datasheet Page 3 (p03_fig02)
Datasheet Page 3 (p03_fig02)
P9 · p09_fig011496×702px
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Figure 15. Recommended Component Placement
Figure 15. Recommended Component Placement
P10 · p10_fig01P10
FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) — Datasheet Page 10 (p10_fig01)
Datasheet Page 10 (p10_fig01)

電気仕様 & 部品詳細スペック (FAN5341UMPX-F106)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) は 7 ピンの標準電子部品・コネクタで、パッケージ外形は 2.00 × 2.00 × 0.85 mm（ピンピッチ e = 0.65 mm）です。動作電源電圧 2.7 V to 5.5 V、動作温度範囲 40°C to 85°C、Standard I/O / Passive インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
2.7 V to 5.5 V
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
40°C to 85°C
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
1.2 MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
2.00 × 2.00 × 0.85 mm (A1=0.03 mm)
パッケージ系列: DFN (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT)
ピン数・リードピッチN / e
7 Pins | Pitch e = 0.65 mm (25.6 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Standard I/O / Passive
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル7 ピン自動バス分類
OK
IPC-7351B フットプリント7 パッド · ピッチ 0.65mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
2.00 × 2.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.85mm · e=0.65mm
パッド寸法 (W × L)Level B
0.34 × 0.58 mm
ピン数 / 総パッド数Topology
7P / 7Pad (DUAL_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) のピン配置 (Pinout) および電源電圧仕様は？

onsemi 製 FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT パッケージ) は全 7 ピン構成で、ピンピッチは 0.65 mm、動作電源電圧範囲 VCC は 2.7 V to 5.5 V です。主なピン：1 (VOUT: 安定化電源出力 (VOUT — 2.7 V to 5.5 V)), 2 (VIN: 電源供給入力 (VIN — 2.7 V to 5.5 V)), 3 (EN: システムイネーブル・ハードウェアリセット (EN)), 4 (FB: マルチプレクスI/O・ペリフェラル端子 FB (General)), 5 (SW: マルチプレクスI/O・ペリフェラル端子 SW (General)), 6 (GND: グラウンド基準端子 (GND))。

FAN5341UMPX-F106 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、FAN5341UMPX-F106 (UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) の本体外形は 2.00 × 2.00 mm、ピッチ e = 0.65 mm、合計 7 パッドで構成されています。

FAN5341UMPX-F106 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの FAN5341UMPX-F106 (onsemi, UDFN-6_L2.0-W2.0-P0.65-BL-EP_MICROCHIP_MT) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (7 ピン) & FAN5341 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1VOUTPower_Out2.7 V to 5.5 V 電源ドメインで動作する安定化出力端子 (VOUT、最大定格: 5.5V) です。
2VINPower_In2.7 V to 5.5 V 電源ドメインで動作する正電源入力端子 (VIN、最大定格: 5.5V) です。
3ENDigital_IOチップ有効化およびリセット制御入力 (EN)：Highでチップ起動、Lowでリセット（停止）状態になります。
4FBDigital_IO信号端子 FB（方向: I/O、電圧域: 2.7 V to 5.5 V）。多重化オルタネート機能: FB。対応バス/インターフェース: General。
5SWDigital_IO信号端子 SW（方向: I/O、電圧域: 2.7 V to 5.5 V）。多重化オルタネート機能: SW。対応バス/インターフェース: General。
6GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
7EPGNDパッケージ底面の露出放熱パッド (EP)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
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