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CH9329 (SOP-16) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH9329

WCHID: C2838834SOP-16 · 16 ピン · Pitch 1.27mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH9329 (SOP-16)1ACT#2MODE03MODE14CFG05CFG16RST7TXD8RXD16V3315VCC14GND13UD-12UD+11SET10DEF9UPGrid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.215.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
12345678910111213141516E=3.90mm · Pitch e=1.27mmD=9.90mm-6-5-4-3-2-1012345676543210-1-2-3-4-5-6-7mm
3. 3Dモデル
パッケージ外形: 3.90mm × 9.90mm · ピッチ: 1.27mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (16/16)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1ACT#I/OマルチプレクスI/O・ペリフェラル端子 ACT# (General)
2MODE0I/OマルチプレクスI/O・ペリフェラル端子 MODE0 (General)
3MODE1I/OマルチプレクスI/O・ペリフェラル端子 MODE1 (General)
4CFG0I/OマルチプレクスI/O・ペリフェラル端子 CFG0 (General)
5CFG1I/OマルチプレクスI/O・ペリフェラル端子 CFG1 (General)
6RSTI/OマルチプレクスI/O・ペリフェラル端子 RST (General)
7TXDI/OマルチプレクスI/O・ペリフェラル端子 TXD (UART)
8RXDI/OマルチプレクスI/O・ペリフェラル端子 RXD (UART)
9UPI/OマルチプレクスI/O・ペリフェラル端子 UP (General)
10DEFI/OマルチプレクスI/O・ペリフェラル端子 DEF (General)
11SETI/OマルチプレクスI/O・ペリフェラル端子 SET (General)
12UD+I/OマルチプレクスI/O・ペリフェラル端子 UD+ (USB)
13UD-I/OマルチプレクスI/O・ペリフェラル端子 UD- (USB)
14GNDGNDグラウンド基準端子 (GND)
15VCCPower電源供給入力 (VCC — 3.3V / 5.0V Standard Logic)
16V33Power電源供給入力 (V33 — 3.3V / 5.0V Standard Logic)
PIN 1 ACT#
I/O
マルチプレクスI/O・ペリフェラル端子 ACT# (General)
設計上の注意点: Signal terminal ACT# (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: ACT#. Supported peripheral buses: General.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 8 抽出図面)

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PDF VIEWERメーカー公式データシート: CH9329 (WCH · SOP-16)
下の埋め込み PDF ビューア内でスクロールやキーワード検索 (Ctrl+F) が可能です
1. 実装3D外観モデルREPRESENTATIVE
CH9329 (SOP-16) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH9329 (SOP-16) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (16ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH9329 (SOP-16) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH9329 (SOP-16) - 4. パッケージ外形寸法図 (D×E×A)
SOP-16 · 3.90×9.90mm · ピッチ 1.27mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH9329 (SOP-16) - 5. 推奨PCBフットプリント
IPC-7351B パッド (16 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH9329 (SOP-16) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (8 点 · 1/1 ページ)
CH9329 シリーズの切り抜きなし原本図面 8 点中 1–8 点目を表示
P1 · p01_fig011272×392px
CH9329 (SOP-16) — 2. Features
2. Features
P2 · p02_fig01744×692px
CH9329 (SOP-16) — Package Body size Lead pitch Description Part No.
Package Body size Lead pitch Description Part No.
P2 · p02_fig01P2
CH9329 (SOP-16) — Datasheet Page 2 (p02_fig01)
Datasheet Page 2 (p02_fig01)
P4 · p04_fig011708×1219px
CH9329 (SOP-16) — Description of serial communication mode configuration:
Description of serial communication mode configuration:
P4 · p04_fig021746×1414px
CH9329 (SOP-16) — If MODE0 and MODE1 pins are suspended, the chip works in MODE0 by default.
If MODE0 and MODE1 pins are suspended, the chip works in MODE0 by default.
P7 · p07_fig011451×946px
CH9329 (SOP-16) — u ta Lo | O.1uF ~[—O.1uF — ee = sot# 1) gong vg | _ 03 «tl 7 3] hope. GND _— 1 MODE! GND [rma 4 3) CRCe UD- opt 37] 2 2 cra up+ | + p+ RST SET GND ea z TxD DEF a GND RAD UP GND CH9329 => USB P2 voc LEDI 1 ACTH Rl 1 rsp 33 2 3K3 3 SED a 44 L
u ta Lo | O.1uF ~[—O.1uF — ee = sot# 1) gong vg | _ 03 «tl 7 3] hope. GND _— 1 MODE! GND [rma 4 3) CRCe UD- opt 37] 2 2 cra up+ | + p+ RST SET GND ea z TxD DEF a GND RAD UP GND CH9329 => USB P2 voc LEDI 1 ACTH Rl 1 rsp 33 2 3K3 3 SED a 44 L
P7 · p07_fig01P7
CH9329 (SOP-16) — Datasheet Page 7 (p07_fig01)
Datasheet Page 7 (p07_fig01)
P9 · p09_fig01パッケージ完全一致
CH9329 (SOP-16) — 7.1 QFN32 封装 [QFN-32(4x4)]
7.1 QFN32 封装 [QFN-32(4x4)]

電気仕様 & 部品詳細スペック (CH9329)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:CH9329 (SOP-16) は 16 ピンの標準電子部品・コネクタで、パッケージ外形は 9.90 × 3.90 × 1.75 mm（ピンピッチ e = 1.27 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、USB, UART インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
24MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
9.90 × 3.90 × 1.75 mm (A1=0.15 mm)
パッケージ系列: SOP (SOP-16)
ピン数・リードピッチN / e
16 Pins | Pitch e = 1.27 mm (50.0 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
USB, UART
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル16 ピン自動バス分類
OK
IPC-7351B フットプリント16 パッド · ピッチ 1.27mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified
IPC-7351B

同系列ファミリー & 同一データシート部品 — CH9329 (2)

同一データシートを共有するパッケージ違いやバリアントを選択

機械寸法 & ランドパターン (SOP-16)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
9.90 × 3.90 mm
全高 (A) & ピッチ (e)IPC-7351B
A=1.75mm · e=1.27mm
パッド寸法 (W × L)Level B
0.60 × 1.55 mm
ピン数 / 総パッド数Topology
16P / 16Pad (DUAL_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
SOP-16
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH9329 (SOP-16)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH9329 (SOP-16) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH9329 (SOP-16 パッケージ) は全 16 ピン構成で、ピンピッチは 1.27 mm です。主なピン：1 (ACT#: マルチプレクスI/O・ペリフェラル端子 ACT# (General)), 2 (MODE0: マルチプレクスI/O・ペリフェラル端子 MODE0 (General)), 3 (MODE1: マルチプレクスI/O・ペリフェラル端子 MODE1 (General)), 4 (CFG0: マルチプレクスI/O・ペリフェラル端子 CFG0 (General)), 5 (CFG1: マルチプレクスI/O・ペリフェラル端子 CFG1 (General)), 6 (RST: マルチプレクスI/O・ペリフェラル端子 RST (General))。

CH9329 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH9329 (SOP-16) の本体外形は 3.90 × 9.90 mm、ピッチ e = 1.27 mm、合計 16 パッドで構成されています。

CH9329 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH9329 (WCH, SOP-16) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (16 ピン) & CH9329 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1ACT#Digital_IO信号端子 ACT#（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: ACT#。対応バス/インターフェース: General。
2MODE0Digital_IO信号端子 MODE0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: MODE0。対応バス/インターフェース: General。
3MODE1Digital_IO信号端子 MODE1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: MODE1。対応バス/インターフェース: General。
4CFG0Digital_IO信号端子 CFG0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: CFG0。対応バス/インターフェース: General。
5CFG1Digital_IO信号端子 CFG1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: CFG1。対応バス/インターフェース: General。
6RSTDigital_IO信号端子 RST（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RST。対応バス/インターフェース: General。
7TXDDigital_IO信号端子 TXD（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TXD。対応バス/インターフェース: UART。
8RXDDigital_IO信号端子 RXD（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RXD。対応バス/インターフェース: UART。
9UPDigital_IO信号端子 UP（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: UP。対応バス/インターフェース: General。
10DEFDigital_IO信号端子 DEF（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: DEF。対応バス/インターフェース: General。
11SETDigital_IO信号端子 SET（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SET。対応バス/インターフェース: General。
12UD+Digital_IO信号端子 UD+（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: UD+。対応バス/インターフェース: USB。
13UD-Digital_IO信号端子 UD-（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: UD-。対応バス/インターフェース: USB。
14GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
15VCCPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VCC、最大定格: 5.5V) です。
16V33Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (V33、最大定格: 5.5V) です。
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