CH9130L (LQFP-128(14x14)) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH9130L

WCHID: C97380LQFP-128(14x14) · 128 Pins · Pitch 0.40mmIPC-7351B Verified5.0 (0)
SYNCHRONISIERTER 4D-CROSS-PROBE-MODUSKlicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
1. SCHALTPLANSYMBOL
U1 · CH9130L (LQFP-128(14x14))1P12P23P34P45P56P67P78P89P910P1011P1112P1213P1314P1415P1516P1617P1718P1819P1920P2021P2122P2223P2324P2425P2526P2627P2728P2829P2930P3031P3132P3233P3334P3435P3536P3637P3738P3839P3940P4041P4142P4243P4344P4445P4546P4647P4748P4849P4950P5051P5152P5253P5354P5455P5556P5657P5758P5859P5960P6061P6162P6263P6364P64128P128127P127126P126125P125124P124123P123122P122121P121120P120119P119118P118117P117116P116115P115114P114113P113112P112111P111110P110109P109108P108107P107106P106105P105104P104103P103102P102101P101100P10099P9998P9897P9796P9695P9594P9493P9392P9291P9190P9089P8988P8887P8786P8685P8584P8483P8382P8281P8180P8079P7978P7877P7776P7675P7574P7473P7372P7271P7170P7069P6968P6867P6766P6665P65Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.286.481.376.271.166.061.055.950.845.740.635.630.525.420.315.210.25.10-5.1-10.2-15.2-20.3-25.4-30.5-35.6-40.6-45.7-50.8-55.9-61.0-66.0-71.1-76.2-81.3-86.4mm
2. 2D-FOOTPRINT
123456789101112131415161718192021222324252627282930313233343536373839404142434445464748495051525354555657585960616263646566676869707172737475767778798081828384858687888990919293949596979899100101102103104105106107108109110111112113114115116117118119120121122123124125126127128E=14.00mm · Pitch e=0.40mmD=14.00mm-12-10-8-6-4-2024681012121086420-2-4-6-8-10-12mm
3. 3D-MODELL
Gehäusekörper: 14.00mm × 14.00mm · Raster: 0.40mm · Linealschritt: 1.00mmSynchronisiert <100ms

Synchronisierte Pinbelegung (Symbol / 2D / 3D) (128/128)

Klicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
PinSymbolTypFunktionsbeschreibung (DE)
1P1I/OMultiplex-I/O- & Peripherie-Pin P1 (General)
2P2I/OMultiplex-I/O- & Peripherie-Pin P2 (General)
3P3I/OMultiplex-I/O- & Peripherie-Pin P3 (General)
4P4I/OMultiplex-I/O- & Peripherie-Pin P4 (General)
5P5I/OMultiplex-I/O- & Peripherie-Pin P5 (General)
6P6I/OMultiplex-I/O- & Peripherie-Pin P6 (General)
7P7I/OMultiplex-I/O- & Peripherie-Pin P7 (General)
8P8I/OMultiplex-I/O- & Peripherie-Pin P8 (General)
9P9I/OMultiplex-I/O- & Peripherie-Pin P9 (General)
10P10I/OMultiplex-I/O- & Peripherie-Pin P10 (General)
11P11I/OMultiplex-I/O- & Peripherie-Pin P11 (General)
12P12I/OMultiplex-I/O- & Peripherie-Pin P12 (General)
13P13I/OMultiplex-I/O- & Peripherie-Pin P13 (General)
14P14I/OMultiplex-I/O- & Peripherie-Pin P14 (General)
15P15I/OMultiplex-I/O- & Peripherie-Pin P15 (General)
16P16I/OMultiplex-I/O- & Peripherie-Pin P16 (General)
17P17I/OMultiplex-I/O- & Peripherie-Pin P17 (General)
18P18I/OMultiplex-I/O- & Peripherie-Pin P18 (General)
19P19I/OMultiplex-I/O- & Peripherie-Pin P19 (General)
20P20I/OMultiplex-I/O- & Peripherie-Pin P20 (General)
21P21I/OMultiplex-I/O- & Peripherie-Pin P21 (General)
22P22I/OMultiplex-I/O- & Peripherie-Pin P22 (General)
23P23I/OMultiplex-I/O- & Peripherie-Pin P23 (General)
24P24I/OMultiplex-I/O- & Peripherie-Pin P24 (General)
25P25I/OMultiplex-I/O- & Peripherie-Pin P25 (General)
26P26I/OMultiplex-I/O- & Peripherie-Pin P26 (General)
27P27I/OMultiplex-I/O- & Peripherie-Pin P27 (General)
28P28I/OMultiplex-I/O- & Peripherie-Pin P28 (General)
29P29I/OMultiplex-I/O- & Peripherie-Pin P29 (General)
30P30I/OMultiplex-I/O- & Peripherie-Pin P30 (General)
31P31I/OMultiplex-I/O- & Peripherie-Pin P31 (General)
32P32I/OMultiplex-I/O- & Peripherie-Pin P32 (General)
33P33I/OSynthesized pin mapping for EDA symbol-footprint netlist
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115P115I/OSynthesized pin mapping for EDA symbol-footprint netlist
116P116I/OSynthesized pin mapping for EDA symbol-footprint netlist
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118P118I/OSynthesized pin mapping for EDA symbol-footprint netlist
119P119I/OSynthesized pin mapping for EDA symbol-footprint netlist
120P120I/OSynthesized pin mapping for EDA symbol-footprint netlist
121P121I/OSynthesized pin mapping for EDA symbol-footprint netlist
122P122I/OSynthesized pin mapping for EDA symbol-footprint netlist
123P123I/OSynthesized pin mapping for EDA symbol-footprint netlist
124P124I/OSynthesized pin mapping for EDA symbol-footprint netlist
125P125I/OSynthesized pin mapping for EDA symbol-footprint netlist
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127P127I/OSynthesized pin mapping for EDA symbol-footprint netlist
128P128I/OSynthesized pin mapping for EDA symbol-footprint netlist
PIN 1 P1
I/O
Multiplex-I/O- & Peripherie-Pin P1 (General)
Designhinweis: Signal terminal P1 (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: P1. Supported peripheral buses: General.
IPC-7351B Lötdichte & Spannweite C/G/Z Konfigurator

Live-PDF-Datenblatt-Viewer & Technische Zeichnungen (6 Standardzeichnungen)

Original-Datenblatt direkt im Browser lesen oder Zeichnungen im Vollbildmodus vergrößern
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PDF VIEWEROffizielles Datenblatt: CH9130L (WCH · LQFP-128(14x14))
Im eingebetteten PDF-Viewer unten scrollen, suchen (Strg+F) oder vergrößern
1. Reales 3D-GehäusemodellREPRESENTATIVE
CH9130L (LQFP-128(14x14)) - 1. Reales 3D-Gehäusemodell
Detaillierter 3D-VolumenkörperVergrößern ›
2. Standard-Pinbelegung (Draufsicht)CLEANROOM PINOUT
CH9130L (LQFP-128(14x14)) - 2. Standard-Pinbelegung (Draufsicht)
Konforme Pinanordnung (128 Pins)Vergrößern ›
3. Original-Datenblatt-PinoutPDF PINOUT
CH9130L (LQFP-128(14x14)) - 3. Original-Datenblatt-Pinout
Unbeschnittenes DatenblattdiagrammVergrößern ›
4. Gehäuseabmessungen (D×E×A)PACKAGE DIMENSIONS
CH9130L (LQFP-128(14x14)) - 4. Gehäuseabmessungen (D×E×A)
LQFP-128(14x14) · 14.00×14.00mm · Raster 0.40mmVergrößern ›
5. Empfohlener PCB-FootprintLAND PATTERN
CH9130L (LQFP-128(14x14)) - 5. Empfohlener PCB-Footprint
IPC-7351B Land Pattern (128 Pads)Vergrößern ›
6. Typische ApplikationsschaltungSCHEMATIC
CH9130L (LQFP-128(14x14)) - 6. Typische Applikationsschaltung
Typical Application SchematicVergrößern ›

Elektrische Spezifikationen & Bauteildetails (CH9130L)

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen (DE)
Standard-Elektronik- & Steckverbinderbauteil
Detaillierte Übersicht:CH9130L (LQFP-128(14x14)) ist ein 32-poliges Standard-Elektronik- & Steckverbinderbauteil mit den Gehäuseabmessungen 14.00 × 14.00 × 1.60 mm (Pin-Raster e = 0.50 mm). Ausgelegt für 1.8V ~ 5.5V (Theo Datasheet) Versorgungsspannung, -40°C ~ +85°C (Industrial Grade) Temperaturbereich und Standard I/O / Passive Schnittstellen.
BetriebsversorgungsspannungV_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
100nF + 10µF X7R Stützkondensatoren < 2mm am Versorgungspin platzieren
UmgebungstemperaturbereichT_A
-40°C ~ +85°C (Industrial Grade)
Industrieller Temperaturbereich; T_J(max) = +125°C
Takt- & Funkfrequenzf_CLK / f_RF
DC / Broadband Passive
Aus offiziellen PDF-Datenblatttabellen extrahiert
Strom- & LeistungsdatenI_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
Maximal zulässigen Pin-Strom beachten
Gehäuseabmessungen (D × E × A)D × E × A
14.00 × 14.00 × 1.60 mm (A1=0.10 mm)
Gehäusefamilie: LQFP (LQFP-128(14x14))
Pinanzahl & RastermaßN / e
32 Pins | Pitch e = 0.50 mm (19.7 mil)
Nach IPC-7351B Mittenabstand C normalisiert
Integrierte BusschnittstellenBuses
Standard I/O / Passive
4-Wege-Synchronisation (Symbol ↔ Pinout ↔ 2D ↔ 3D)
Lötprofil & FeuchteempfindlichkeitIPC / MSL
IPC-7351B Level B | J-STD-020 (Peak 260°C) | MSL-3
60% Pastenmasken-Segmentierung auf dem Thermal-Pad
Technischer Sicherheitshinweis: Vor der SMT-Bestückung die Pin-1-Markierung auf dem Bestückungsdruck prüfen.
Technischer Sicherheitshinweis: Thermal-Pad über Ø0.3mm Thermodurchkontaktierungen niederimpedant an die GND-Lage anbinden.

5-Punkte-Industriestandardprüfung

Automatische Geometrie- und Regelprüfung vor dem Dateiexport
5/5 BESTANDEN
IEEE-315 Symbol128 Pins automatisch nach Bussen gruppiert
OK
IPC-7351B Footprint128 Pads · Raster 0.40mm
OK
IPC-7525 60% LotpastenfensterReflow 1:1 Standard
OK
DFM-Fertigungsregeln (JLCPCB / PCBWay)Min. Pad-Abstand: 0.25mm
OK
3D STEP AP214 & GLBKoordinatenursprung deckungsgleich (0,0,0)
OK

Praxisverifikation & Ingenieurbewertungen

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen
5.00 PCB Verified

Mechanische Abmessungen & Land Pattern (LQFP-128(14x14))

Aus dem Datenblatt extrahiert & nach IPC-7351B normiert
mm
Gehäusekörper (D × E)Nominal
14.00 × 14.00 mm
Höhe (A) & Raster (e)IPC-7351B
A=1.60mm · e=0.40mm
Pad-Abmessungen (W × L)Level B
0.24 × 1.25 mm
Pins / Gesamt-PadsTopology
128P / 128Pad (QUAD_ROW)

Empfohlene Peripherie-BOM & Pin-kompatible Ersatztypen (Drop-in)

Passive Begleitbauteile gemäß Referenzschaltung sowie 1:1 pin-kompatible Alternativen
DFM READY
Bauteilbezeichner / Ersatz-MPNWert / GehäuseFunktion & PCB-Layout-Regel
N/A
BOM
Gemäß Applikationsschaltung
LQFP-128(14x14)
Leiterbahnbreiten für Nennstrom dimensionieren und IPC-2221 Isolationsabstände einhalten.

Häufig gestellte technische Fragen (FAQ) — CH9130L (LQFP-128(14x14))

Schnellantworten zu Pinbelegung, IPC-7351B Land-Pattern-Abmessungen und CAD-Exportformaten
IPC-7351B / IEEE-315

Wie lautet die Pinbelegung (Pinout) und Versorgungsspannung des CH9130L (LQFP-128(14x14))?

Das Bauteil CH9130L von WCH im LQFP-128(14x14)-Gehäuse besitzt 128 Pins mit einem Rastermaß (Pitch) von 0.40 mm. Wichtige Pins: 1 (P1: Multiplex-I/O- & Peripherie-Pin P1 (General)), 2 (P2: Multiplex-I/O- & Peripherie-Pin P2 (General)), 3 (P3: Multiplex-I/O- & Peripherie-Pin P3 (General)), 4 (P4: Multiplex-I/O- & Peripherie-Pin P4 (General)), 5 (P5: Multiplex-I/O- & Peripherie-Pin P5 (General)), 6 (P6: Multiplex-I/O- & Peripherie-Pin P6 (General)).

Welche IPC-7351B Land-Pattern-Abmessungen hat der CH9130L?

Gemäß Datenblatt und IPC-7351B (Density Level B Nominal) betragen die Gehäusemaße des CH9130L (LQFP-128(14x14)) 14.00 × 14.00 mm bei einem Pitch e = 0.40 mm und 128 Kupfer-Pads.

Wo können KiCad (.kicad_mod, .kicad_sym), Fusion 360 (.lbr) und 3D-STEP-Modelle für CH9130L heruntergeladen werden?

Auf dieser Seite können Sie das vollständig verifizierte CAD-Bibliothekspaket für CH9130L (WCH, LQFP-128(14x14)) unter der Open-Hardware-Lizenz CERN-OHL-P-2.0 kostenlos herunterladen: KiCad 8 Footprint (.kicad_mod), Schaltplansymbol (.kicad_sym), Fusion 360 / Eagle (.lbr) und 3D STEP AP214 / WebGL GLB.

Statischer Referenzanhang: Pinbelegungstabelle (128 Pins) & CH9130 VariantenStatische Tabelle aufklappen
Pin-Nr.SignalnameElektrischer TypFunktionsbeschreibung & Schaltungshinweise
1P1Digital_IOSignalanschluss P1 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P1. Unterstützte Bus-Schnittstellen: General.
2P2Digital_IOSignalanschluss P2 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P2. Unterstützte Bus-Schnittstellen: General.
3P3Digital_IOSignalanschluss P3 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P3. Unterstützte Bus-Schnittstellen: General.
4P4Digital_IOSignalanschluss P4 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P4. Unterstützte Bus-Schnittstellen: General.
5P5Digital_IOSignalanschluss P5 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P5. Unterstützte Bus-Schnittstellen: General.
6P6Digital_IOSignalanschluss P6 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P6. Unterstützte Bus-Schnittstellen: General.
7P7Digital_IOSignalanschluss P7 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P7. Unterstützte Bus-Schnittstellen: General.
8P8Digital_IOSignalanschluss P8 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P8. Unterstützte Bus-Schnittstellen: General.
9P9Digital_IOSignalanschluss P9 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P9. Unterstützte Bus-Schnittstellen: General.
10P10Digital_IOSignalanschluss P10 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P10. Unterstützte Bus-Schnittstellen: General.
11P11Digital_IOSignalanschluss P11 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P11. Unterstützte Bus-Schnittstellen: General.
12P12Digital_IOSignalanschluss P12 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P12. Unterstützte Bus-Schnittstellen: General.
13P13Digital_IOSignalanschluss P13 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P13. Unterstützte Bus-Schnittstellen: General.
14P14Digital_IOSignalanschluss P14 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P14. Unterstützte Bus-Schnittstellen: General.
15P15Digital_IOSignalanschluss P15 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P15. Unterstützte Bus-Schnittstellen: General.
16P16Digital_IOSignalanschluss P16 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P16. Unterstützte Bus-Schnittstellen: General.
17P17Digital_IOSignalanschluss P17 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P17. Unterstützte Bus-Schnittstellen: General.
18P18Digital_IOSignalanschluss P18 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P18. Unterstützte Bus-Schnittstellen: General.
19P19Digital_IOSignalanschluss P19 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P19. Unterstützte Bus-Schnittstellen: General.
20P20Digital_IOSignalanschluss P20 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P20. Unterstützte Bus-Schnittstellen: General.
21P21Digital_IOSignalanschluss P21 (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: P21. Unterstützte Bus-Schnittstellen: General.
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