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CH32V303VCT6 (LQFP-100(14x14)) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH32V303VCT6

WCHID: C5357073LQFP-100(14x14) · 100 ピン · Pitch 0.50mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH32V303VCT6 (LQFP-100(14x14))1PE22PE33PE44PE55PE66VBAT7PC13/TAMPER-8PC14/OSC32IN9PC15/OSC320U10VSS_511VDD_512OSC_IN13OSC_OUT14NRST15PC0/ADC1016PC1/ADC1117PC2/ADC1218PC3/ADC1319VSSA20VREF-21VREF+22VDDA23PA0/WKUP/ADC24PA1/ADC125PA2/ADC226PA3/ADC327VSS_428VDD_429PA4/ADC4/DAC30PA5/ADC5/DAC31PA6/ADC632PA7/ADC733PC4/ADC1434PC5/ADC1535PB0/ADC836PB1/ADC937PB2/BOOT138PE739PE840PE941PE1042PE1143PE1244PE1345PE1446PE1547PB1048PB1149VSS_150VIO_1100VIO_399VSS_398PE197PE096PB995PB894BOOT093PB792PB691PB590PB489PB388PD787PD686PD585PD484PD383PD282PD181PD080PC1279PC1178PC1077PA1576PA14/SWCLK75VDD_274VSS_273NC72PA13/SWDIO71PA12/USB1DP70PA11/USB1DM69PA1068PA967PA866PC965PC864PC763PC662PD1561PD1460PD1359PD1258PD1157PD1056PD955PD854PB1553PB1452PB1351PB12Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.868.663.558.453.348.343.238.133.027.922.917.812.77.62.5-2.5-7.6-12.7-17.8-22.9-27.9-33.0-38.1-43.2-48.3-53.3-58.4-63.5-68.6mm
2. 2Dフットプリント
123456789101112131415161718192021222324252627282930313233343536373839404142434445464748495051525354555657585960616263646566676869707172737475767778798081828384858687888990919293949596979899100E=14.00mm · Pitch e=0.50mmD=14.00mm-12-10-8-6-4-2024681012121086420-2-4-6-8-10-12mm
3. 3Dモデル
パッケージ外形: 14.00mm × 14.00mm · ピッチ: 0.50mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (100/100)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1PE2I/OマルチプレクスI/O・ペリフェラル端子 PE2 (General)
2PE3I/OマルチプレクスI/O・ペリフェラル端子 PE3 (General)
3PE4I/OマルチプレクスI/O・ペリフェラル端子 PE4 (General)
4PE5I/OマルチプレクスI/O・ペリフェラル端子 PE5 (General)
5PE6I/OマルチプレクスI/O・ペリフェラル端子 PE6 (General)
6VBATPower電源供給入力 (VBAT — 3.3V / 5.0V Standard Logic)
7PC13/TAMPER-RTCI/OマルチプレクスI/O・ペリフェラル端子 PC13/TAMPER-RTC (RTC/CLK)
8PC14/OSC32INI/OマルチプレクスI/O・ペリフェラル端子 PC14/OSC32IN (RTC/CLK)
9PC15/OSC320UTI/OマルチプレクスI/O・ペリフェラル端子 PC15/OSC320UT (RTC/CLK)
10VSS_5GNDグラウンド基準端子 (VSS_5)
11VDD_5Power電源供給入力 (VDD_5 — 3.3V / 5.0V Standard Logic)
12OSC_INI/OマルチプレクスI/O・ペリフェラル端子 OSC_IN (RTC/CLK)
13OSC_OUTI/OマルチプレクスI/O・ペリフェラル端子 OSC_OUT (RTC/CLK)
14NRSTIシステムイネーブル・ハードウェアリセット (NRST)
15PC0/ADC10I/OマルチプレクスI/O・ペリフェラル端子 PC0/ADC10 (ADC)
16PC1/ADC11I/OマルチプレクスI/O・ペリフェラル端子 PC1/ADC11 (ADC)
17PC2/ADC12I/OマルチプレクスI/O・ペリフェラル端子 PC2/ADC12 (ADC)
18PC3/ADC13I/OマルチプレクスI/O・ペリフェラル端子 PC3/ADC13 (ADC)
19VSSAGNDグラウンド基準端子 (VSSA)
20VREF-AnalogマルチプレクスI/O・ペリフェラル端子 VREF- (General)
21VREF+AnalogマルチプレクスI/O・ペリフェラル端子 VREF+ (General)
22VDDAPower電源供給入力 (VDDA — 3.3V / 5.0V Standard Logic)
23PA0/WKUP/ADC0I/OマルチプレクスI/O・ペリフェラル端子 PA0/WKUP/ADC0 (ADC)
24PA1/ADC1I/OマルチプレクスI/O・ペリフェラル端子 PA1/ADC1 (ADC)
25PA2/ADC2I/OマルチプレクスI/O・ペリフェラル端子 PA2/ADC2 (ADC)
26PA3/ADC3I/OマルチプレクスI/O・ペリフェラル端子 PA3/ADC3 (ADC)
27VSS_4GNDグラウンド基準端子 (VSS_4)
28VDD_4Power電源供給入力 (VDD_4 — 3.3V / 5.0V Standard Logic)
29PA4/ADC4/DAC0I/OマルチプレクスI/O・ペリフェラル端子 PA4/ADC4/DAC0 (ADC, DAC)
30PA5/ADC5/DAC1I/OマルチプレクスI/O・ペリフェラル端子 PA5/ADC5/DAC1 (ADC, DAC)
31PA6/ADC6I/OマルチプレクスI/O・ペリフェラル端子 PA6/ADC6 (ADC)
32PA7/ADC7I/OマルチプレクスI/O・ペリフェラル端子 PA7/ADC7 (ADC)
33PC4/ADC14I/OマルチプレクスI/O・ペリフェラル端子 PC4/ADC14 (ADC)
34PC5/ADC15I/OマルチプレクスI/O・ペリフェラル端子 PC5/ADC15 (ADC)
35PB0/ADC8I/OマルチプレクスI/O・ペリフェラル端子 PB0/ADC8 (ADC)
36PB1/ADC9I/OマルチプレクスI/O・ペリフェラル端子 PB1/ADC9 (ADC)
37PB2/BOOT1I/OマルチプレクスI/O・ペリフェラル端子 PB2/BOOT1 (General)
38PE7I/OマルチプレクスI/O・ペリフェラル端子 PE7 (General)
39PE8I/OマルチプレクスI/O・ペリフェラル端子 PE8 (General)
40PE9I/OマルチプレクスI/O・ペリフェラル端子 PE9 (General)
41PE10I/OマルチプレクスI/O・ペリフェラル端子 PE10 (General)
42PE11I/OマルチプレクスI/O・ペリフェラル端子 PE11 (General)
43PE12I/OマルチプレクスI/O・ペリフェラル端子 PE12 (General)
44PE13I/OマルチプレクスI/O・ペリフェラル端子 PE13 (General)
45PE14I/OマルチプレクスI/O・ペリフェラル端子 PE14 (General)
46PE15I/OマルチプレクスI/O・ペリフェラル端子 PE15 (General)
47PB10I/OマルチプレクスI/O・ペリフェラル端子 PB10 (General)
48PB11I/OマルチプレクスI/O・ペリフェラル端子 PB11 (General)
49VSS_1GND露出サーマルパッド・グラウンド (VSS_1)
50VIO_1I/OマルチプレクスI/O・ペリフェラル端子 VIO_1 (General)
51PB12I/OマルチプレクスI/O・ペリフェラル端子 PB12 (General)
52PB13I/OマルチプレクスI/O・ペリフェラル端子 PB13 (General)
53PB14I/OマルチプレクスI/O・ペリフェラル端子 PB14 (General)
54PB15I/OマルチプレクスI/O・ペリフェラル端子 PB15 (General)
55PD8I/OマルチプレクスI/O・ペリフェラル端子 PD8 (General)
56PD9I/OマルチプレクスI/O・ペリフェラル端子 PD9 (General)
57PD10I/OマルチプレクスI/O・ペリフェラル端子 PD10 (General)
58PD11I/OマルチプレクスI/O・ペリフェラル端子 PD11 (General)
59PD12I/OマルチプレクスI/O・ペリフェラル端子 PD12 (General)
60PD13I/OマルチプレクスI/O・ペリフェラル端子 PD13 (General)
61PD14I/OマルチプレクスI/O・ペリフェラル端子 PD14 (General)
62PD15I/OマルチプレクスI/O・ペリフェラル端子 PD15 (General)
63PC6I/OマルチプレクスI/O・ペリフェラル端子 PC6 (General)
64PC7I/OマルチプレクスI/O・ペリフェラル端子 PC7 (General)
65PC8I/OマルチプレクスI/O・ペリフェラル端子 PC8 (General)
66PC9I/OマルチプレクスI/O・ペリフェラル端子 PC9 (General)
67PA8I/OマルチプレクスI/O・ペリフェラル端子 PA8 (General)
68PA9I/OマルチプレクスI/O・ペリフェラル端子 PA9 (General)
69PA10I/OマルチプレクスI/O・ペリフェラル端子 PA10 (General)
70PA11/USB1DMI/OマルチプレクスI/O・ペリフェラル端子 PA11/USB1DM (USB)
71PA12/USB1DPI/OマルチプレクスI/O・ペリフェラル端子 PA12/USB1DP (USB)
72PA13/SWDIOI/OマルチプレクスI/O・ペリフェラル端子 PA13/SWDIO (SWD/JTAG)
73NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
74VSS_2GNDグラウンド基準端子 (VSS_2)
75VDD_2Power電源供給入力 (VDD_2 — 3.3V / 5.0V Standard Logic)
76PA14/SWCLKI/OマルチプレクスI/O・ペリフェラル端子 PA14/SWCLK (SWD/JTAG)
77PA15I/OマルチプレクスI/O・ペリフェラル端子 PA15 (General)
78PC10I/OマルチプレクスI/O・ペリフェラル端子 PC10 (General)
79PC11I/OマルチプレクスI/O・ペリフェラル端子 PC11 (General)
80PC12I/OマルチプレクスI/O・ペリフェラル端子 PC12 (General)
81PD0I/OマルチプレクスI/O・ペリフェラル端子 PD0 (General)
82PD1I/OマルチプレクスI/O・ペリフェラル端子 PD1 (General)
83PD2I/OマルチプレクスI/O・ペリフェラル端子 PD2 (General)
84PD3I/OマルチプレクスI/O・ペリフェラル端子 PD3 (General)
85PD4I/OマルチプレクスI/O・ペリフェラル端子 PD4 (General)
86PD5I/OマルチプレクスI/O・ペリフェラル端子 PD5 (General)
87PD6I/OマルチプレクスI/O・ペリフェラル端子 PD6 (General)
88PD7I/OマルチプレクスI/O・ペリフェラル端子 PD7 (General)
89PB3I/OマルチプレクスI/O・ペリフェラル端子 PB3 (General)
90PB4I/OマルチプレクスI/O・ペリフェラル端子 PB4 (General)
91PB5I/OマルチプレクスI/O・ペリフェラル端子 PB5 (General)
92PB6I/OマルチプレクスI/O・ペリフェラル端子 PB6 (General)
93PB7I/OマルチプレクスI/O・ペリフェラル端子 PB7 (General)
94BOOT0I入力専用端子 BOOT0 (General)
95PB8I/OマルチプレクスI/O・ペリフェラル端子 PB8 (General)
96PB9I/OマルチプレクスI/O・ペリフェラル端子 PB9 (General)
97PE0I/OマルチプレクスI/O・ペリフェラル端子 PE0 (General)
98PE1I/OマルチプレクスI/O・ペリフェラル端子 PE1 (General)
99VSS_3GNDグラウンド基準端子 (VSS_3)
100VIO_3I/OマルチプレクスI/O・ペリフェラル端子 VIO_3 (General)
PIN 1 PE2
I/O
マルチプレクスI/O・ペリフェラル端子 PE2 (General)
設計上の注意点: Signal terminal PE2 (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: PE2. Supported peripheral buses: General.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 4 抽出図面)

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PDF VIEWERメーカー公式データシート: CH32V303VCT6 (WCH · LQFP-100(14x14))
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1. 実装3D外観モデルREPRESENTATIVE
CH32V303VCT6 (LQFP-100(14x14)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH32V303VCT6 (LQFP-100(14x14)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (100ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH32V303VCT6 (LQFP-100(14x14)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH32V303VCT6 (LQFP-100(14x14)) - 4. パッケージ外形寸法図 (D×E×A)
LQFP-100(14x14) · 14.00×14.00mm · ピッチ 0.50mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH32V303VCT6 (LQFP-100(14x14)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (100 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH32V303VCT6 (LQFP-100(14x14)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (4 点 · 1/1 ページ)
CH32V208 / CH32V305 / CH32V307 シリーズの切り抜きなし原本図面 4 点中 1–4 点目を表示
P1 · p01_fig01245×133px
CH32V303VCT6 (LQFP-100(14x14)) — Overview
Overview
P40 · p40_fig011708×672px
CH32V303VCT6 (LQFP-100(14x14)) — Table 8-13 Rounding Mode | Rounding code Rounding mode Description | 000 RNE Rounding to the nearest value, even values are preferred | 001 RTZ Rounding to zero | 010 RDN Rounding down (to -∞) | 011 RUP Rounding up (to ∞) | 100 RMM Round to
Table 8-13 Rounding Mode | Rounding code Rounding mode Description | 000 RNE Rounding to the nearest value, even values are preferred | 001 RTZ Rounding to zero | 010 RDN Rounding down (to -∞) | 011 RUP Rounding up (to ∞) | 100 RMM Round to
P42 · p42_fig011708×323px
CH32V303VCT6 (LQFP-100(14x14)) — The cache operation control register is mainly used to clear or invalidate instructions or data in the cache.
The cache operation control register is mainly used to clear or invalidate instructions or data in the cache.
P42 · p42_fig021727×2107px
CH32V303VCT6 (LQFP-100(14x14)) — V1.3 41
V1.3 41

電気仕様 & 部品詳細スペック (CH32V303VCT6)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
組込みマイクロコントローラ (MCU)
詳細概要:CH32V303VCT6 (LQFP-100(14x14)) は 100 ピンの組込みマイクロコントローラ (MCU)で、パッケージ外形は 14.00 × 14.00 × 1.60 mm（ピンピッチ e = 0.50 mm）です。動作電源電圧 3.0V ~ 3.6V (Typ 3.3V)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、ADC, DAC, RTC/CLK, SWD/JTAG, USB インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
3.0V ~ 3.6V (Typ 3.3V)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
DC / Broadband Passive
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
14.00 × 14.00 × 1.60 mm (A1=0.10 mm)
パッケージ系列: LQFP (LQFP-100(14x14))
ピン数・リードピッチN / e
100 Pins | Pitch e = 0.50 mm (19.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
ADC, DAC, RTC/CLK, SWD/JTAG, USB
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: ブートストラップピン注意 (PB2/BOOT1, BOOT0)：リセット解除時の論理レベルを乱す外部プルアップ/ダウンを避けてください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル100 ピン自動バス分類
OK
IPC-7351B フットプリント100 パッド · ピッチ 0.50mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (LQFP-100(14x14))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
14.00 × 14.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=1.60mm · e=0.50mm
パッド寸法 (W × L)Level B
0.30 × 1.25 mm
ピン数 / 総パッド数Topology
100P / 100Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
LQFP-100(14x14)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH32V303VCT6 (LQFP-100(14x14))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH32V303VCT6 (LQFP-100(14x14)) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH32V303VCT6 (LQFP-100(14x14) パッケージ) は全 100 ピン構成で、ピンピッチは 0.50 mm です。主なピン：1 (PE2: マルチプレクスI/O・ペリフェラル端子 PE2 (General)), 2 (PE3: マルチプレクスI/O・ペリフェラル端子 PE3 (General)), 3 (PE4: マルチプレクスI/O・ペリフェラル端子 PE4 (General)), 4 (PE5: マルチプレクスI/O・ペリフェラル端子 PE5 (General)), 5 (PE6: マルチプレクスI/O・ペリフェラル端子 PE6 (General)), 6 (VBAT: 電源供給入力 (VBAT — 3.3V / 5.0V Standard Logic))。

CH32V303VCT6 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH32V303VCT6 (LQFP-100(14x14)) の本体外形は 14.00 × 14.00 mm、ピッチ e = 0.50 mm、合計 100 パッドで構成されています。

CH32V303VCT6 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH32V303VCT6 (WCH, LQFP-100(14x14)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (100 ピン) & CH32V208 / CH32V305 / CH32V307 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1PE2Digital_IO信号端子 PE2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE2。対応バス/インターフェース: General。
2PE3Digital_IO信号端子 PE3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE3。対応バス/インターフェース: General。
3PE4Digital_IO信号端子 PE4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE4。対応バス/インターフェース: General。
4PE5Digital_IO信号端子 PE5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE5。対応バス/インターフェース: General。
5PE6Digital_IO信号端子 PE6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE6。対応バス/インターフェース: General。
6VBATPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VBAT、最大定格: 5.5V) です。
7PC13/TAMPER-RTCDigital_IO信号端子 PC13/TAMPER-RTC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC13/TAMPER-RTC。対応バス/インターフェース: RTC/CLK。
8PC14/OSC32INDigital_IO信号端子 PC14/OSC32IN（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC14/OSC32IN。対応バス/インターフェース: RTC/CLK。
9PC15/OSC320UTDigital_IO信号端子 PC15/OSC320UT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC15/OSC320UT。対応バス/インターフェース: RTC/CLK。
10VSS_5GND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSS_5) です。
11VDD_5Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD_5、最大定格: 5.5V) です。
12OSC_INDigital_IO信号端子 OSC_IN（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: OSC_IN。対応バス/インターフェース: RTC/CLK。
13OSC_OUTDigital_IO信号端子 OSC_OUT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: OSC_OUT。対応バス/インターフェース: RTC/CLK。
14NRSTDigital_IOローアクティブ・ハードウェアリセット端子 (NRST)：Lowに引くことでコアと全ペリフェラルを初期化します。
15PC0/ADC10Analog信号端子 PC0/ADC10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC0/ADC10。対応バス/インターフェース: ADC。
16PC1/ADC11Analog信号端子 PC1/ADC11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC1/ADC11。対応バス/インターフェース: ADC。
17PC2/ADC12Analog信号端子 PC2/ADC12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC2/ADC12。対応バス/インターフェース: ADC。
18PC3/ADC13Analog信号端子 PC3/ADC13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC3/ADC13。対応バス/インターフェース: ADC。
19VSSAGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSSA) です。
20VREF-Analog信号端子 VREF-（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VREF-。対応バス/インターフェース: General。
21VREF+Analog信号端子 VREF+（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VREF+。対応バス/インターフェース: General。
22VDDAPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDA、最大定格: 5.5V) です。
23PA0/WKUP/ADC0Analog信号端子 PA0/WKUP/ADC0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA0/WKUP/ADC0。対応バス/インターフェース: ADC。
24PA1/ADC1Analog信号端子 PA1/ADC1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA1/ADC1。対応バス/インターフェース: ADC。
25PA2/ADC2Analog信号端子 PA2/ADC2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA2/ADC2。対応バス/インターフェース: ADC。
26PA3/ADC3Analog信号端子 PA3/ADC3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA3/ADC3。対応バス/インターフェース: ADC。
27VSS_4GND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSS_4) です。
28VDD_4Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD_4、最大定格: 5.5V) です。
29PA4/ADC4/DAC0Analog信号端子 PA4/ADC4/DAC0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA4/ADC4/DAC0。対応バス/インターフェース: ADC, DAC。
30PA5/ADC5/DAC1Analog信号端子 PA5/ADC5/DAC1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA5/ADC5/DAC1。対応バス/インターフェース: ADC, DAC。
31PA6/ADC6Analog信号端子 PA6/ADC6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA6/ADC6。対応バス/インターフェース: ADC。
32PA7/ADC7Analog信号端子 PA7/ADC7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA7/ADC7。対応バス/インターフェース: ADC。
33PC4/ADC14Analog信号端子 PC4/ADC14（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC4/ADC14。対応バス/インターフェース: ADC。
34PC5/ADC15Analog信号端子 PC5/ADC15（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC5/ADC15。対応バス/インターフェース: ADC。
35PB0/ADC8Analog信号端子 PB0/ADC8（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB0/ADC8。対応バス/インターフェース: ADC。
36PB1/ADC9Analog信号端子 PB1/ADC9（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB1/ADC9。対応バス/インターフェース: ADC。
37PB2/BOOT1Digital_IO信号端子 PB2/BOOT1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB2/BOOT1。対応バス/インターフェース: General。
38PE7Digital_IO信号端子 PE7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE7。対応バス/インターフェース: General。
39PE8Digital_IO信号端子 PE8（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE8。対応バス/インターフェース: General。
40PE9Digital_IO信号端子 PE9（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE9。対応バス/インターフェース: General。
41PE10Digital_IO信号端子 PE10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE10。対応バス/インターフェース: General。
42PE11Digital_IO信号端子 PE11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE11。対応バス/インターフェース: General。
43PE12Digital_IO信号端子 PE12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE12。対応バス/インターフェース: General。
44PE13Digital_IO信号端子 PE13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE13。対応バス/インターフェース: General。
45PE14Digital_IO信号端子 PE14（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE14。対応バス/インターフェース: General。
46PE15Digital_IO信号端子 PE15（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PE15。対応バス/インターフェース: General。
47PB10Digital_IO信号端子 PB10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB10。対応バス/インターフェース: General。
48PB11Digital_IO信号端子 PB11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB11。対応バス/インターフェース: General。
49VSS_1GNDパッケージ底面の露出放熱パッド (VSS_1)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
50VIO_1Digital_IO信号端子 VIO_1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VIO_1。対応バス/インターフェース: General。
51PB12Digital_IO信号端子 PB12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB12。対応バス/インターフェース: General。
52PB13Digital_IO信号端子 PB13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB13。対応バス/インターフェース: General。
53PB14Digital_IO信号端子 PB14（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB14。対応バス/インターフェース: General。
54PB15Digital_IO信号端子 PB15（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB15。対応バス/インターフェース: General。
55PD8Digital_IO信号端子 PD8（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD8。対応バス/インターフェース: General。
56PD9Digital_IO信号端子 PD9（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD9。対応バス/インターフェース: General。
57PD10Digital_IO信号端子 PD10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD10。対応バス/インターフェース: General。
58PD11Digital_IO信号端子 PD11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD11。対応バス/インターフェース: General。
59PD12Digital_IO信号端子 PD12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD12。対応バス/インターフェース: General。
60PD13Digital_IO信号端子 PD13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD13。対応バス/インターフェース: General。
61PD14Digital_IO信号端子 PD14（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD14。対応バス/インターフェース: General。
62PD15Digital_IO信号端子 PD15（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PD15。対応バス/インターフェース: General。
63PC6Digital_IO信号端子 PC6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC6。対応バス/インターフェース: General。
64PC7Digital_IO信号端子 PC7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PC7。対応バス/インターフェース: General。
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