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MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — Symbol, Footprint IPC-7351B & 3D STEP Model

MIC28513-2YFL-T5

MICROCHIPID: C512204FQFN-24-EP(3x4) · 27 Pins · Pitch 0.50mmIPC-7351B Verified5.0 (0)
SYNCHRONISIERTER 4D-CROSS-PROBE-MODUSKlicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
1. SCHALTPLANSYMBOL
U1 · MIC28513-2YFL-T5 (FQFN-24-EP(3x4))1DL2PGND3DH4PVIN5LX6BST7PVIN8PVIN9PVIN10PGND11PGND12SW13AGND14FB27SW26PGND25PV IN24FREQ23PGND22PGND21SW20P VDD19VDD18I LIM17V IN16EN15PGOODGrid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.822.917.812.77.62.5-2.5-7.6-12.7-17.8-22.9mm
2. 2D-FOOTPRINT
123456789101112131415161718192021222324252627E=4.00mm · Pitch e=0.50mmD=3.00mm-4-3-2-1012343210-1-2-3mm
3. 3D-MODELL
Gehäusekörper: 4.00mm × 3.00mm · Raster: 0.50mm · Linealschritt: 1.00mmSynchronisiert <100ms

Synchronisierte Pinbelegung (Symbol / 2D / 3D) (27/27)

Klicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
PinSymbolTypFunktionsbeschreibung (DE)
1DLI/OMultiplex-I/O- & Peripherie-Pin DL (General)
2PGNDGNDMasseanschluss (PGND)
3DHI/OMultiplex-I/O- & Peripherie-Pin DH (General)
4PVINPowerVersorgungsspannungseingang (PVIN — 4.6V to 45V)
5LXI/OMultiplex-I/O- & Peripherie-Pin LX (General)
6BSTI/OMultiplex-I/O- & Peripherie-Pin BST (General)
7PVINPowerVersorgungsspannungseingang (PVIN — 4.6V to 45V)
8PVINPowerVersorgungsspannungseingang (PVIN — 4.6V to 45V)
9PVINPowerVersorgungsspannungseingang (PVIN — 4.6V to 45V)
10PGNDGNDMasseanschluss (PGND)
11PGNDGNDMasseanschluss (PGND)
12SWI/OMultiplex-I/O- & Peripherie-Pin SW (General)
13AGNDGNDMasseanschluss (AGND)
14FBI/OMultiplex-I/O- & Peripherie-Pin FB (General)
15PGOODI/OMultiplex-I/O- & Peripherie-Pin PGOOD (General)
16ENISystemfreigabe & Hardware-Reset (EN)
17V INI/OMultiplex-I/O- & Peripherie-Pin V IN (General)
18I LIMI/OMultiplex-I/O- & Peripherie-Pin I LIM (General)
19VDDPowerGeregelter Spannungsausgang (VDD — 4.6V to 45V)
20P VDDPowerVersorgungsspannungseingang (P VDD — 4.6V to 45V)
21SWI/OMultiplex-I/O- & Peripherie-Pin SW (General)
22PGNDGNDMasseanschluss (PGND)
23PGNDGNDMasseanschluss (PGND)
24FREQI/OMultiplex-I/O- & Peripherie-Pin FREQ (General)
25PV INI/OMultiplex-I/O- & Peripherie-Pin PV IN (General)
26PGNDGNDMasseanschluss (PGND)
27SWI/OMultiplex-I/O- & Peripherie-Pin SW (General)
PIN 1 DL
I/O
Multiplex-I/O- & Peripherie-Pin DL (General)
Designhinweis: Low-Side Gate Drive Internal low-side power MOSFET gate connection This pin must . . beleftunconnectedorfloating .
IPC-7351B Lötdichte & Spannweite C/G/Z Konfigurator

Live-PDF-Datenblatt-Viewer & Technische Zeichnungen (6 Standardzeichnungen + 18 Extrahierte Abbildungen)

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PDF VIEWEROffizielles Datenblatt: MIC28513-2YFL-T5 (MICROCHIP · FQFN-24-EP(3x4))
Im eingebetteten PDF-Viewer unten scrollen, suchen (Strg+F) oder vergrößern
1. Reales 3D-GehäusemodellREPRESENTATIVE
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 1. Reales 3D-Gehäusemodell
Detaillierter 3D-VolumenkörperVergrößern ›
2. Standard-Pinbelegung (Draufsicht)CLEANROOM PINOUT
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 2. Standard-Pinbelegung (Draufsicht)
Konforme Pinanordnung (27 Pins)Vergrößern ›
3. Original-Datenblatt-PinoutPDF PINOUT
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 3. Original-Datenblatt-Pinout
Unbeschnittenes DatenblattdiagrammVergrößern ›
4. Gehäuseabmessungen (D×E×A)PACKAGE DIMENSIONS
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 4. Gehäuseabmessungen (D×E×A)
FQFN-24-EP(3x4) · 4.00×3.00mm · Raster 0.50mmVergrößern ›
5. Empfohlener PCB-FootprintLAND PATTERN
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 5. Empfohlener PCB-Footprint
IPC-7351B Land Pattern (27 Pads)Vergrößern ›
6. Typische ApplikationsschaltungSCHEMATIC
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) - 6. Typische Applikationsschaltung
Typical Application SchematicVergrößern ›
Originale Datenblatt-Pinouts & Technische Zeichnungen (18 Abb. · Seite 1/2)
Zeige 1–12 von 18 unbeschnittenen Originalzeichnungen für MIC28513
P1 · p01_fig01377×200px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — 45VIN, 4A Synchronous Buck Regulator
45VIN, 4A Synchronous Buck Regulator
P1 · p01_fig02867×1054px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) —  2016-2018 Microchip Technology Inc. DS20005522B-page 1
 2016-2018 Microchip Technology Inc. DS20005522B-page 1
P2 · p02_fig011487×1019px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — Functional Block Diagram
Functional Block Diagram
P2 · p02_fig021777×1457px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — DS20005522B-page 2  2016-2018 Microchip Technology Inc. | Functional Block Diagram | SW | EN | PGND | PVIN | gm | PGOOD | VDD | BST | VREF 0.8V | POWER GOOD COMPARATOR | PVDD | FREQ | M1 | M2 | R1 | R2 | RINJ | CINJ | COUT | CIN | 3.3V | C
DS20005522B-page 2  2016-2018 Microchip Technology Inc. | Functional Block Diagram | SW | EN | PGND | PVIN | gm | PGOOD | VDD | BST | VREF 0.8V | POWER GOOD COMPARATOR | PVDD | FREQ | M1 | M2 | R1 | R2 | RINJ | CINJ | COUT | CIN | 3.3V | C
P2 · p02_fig01P2
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — Datasheet Page 2 (p02_fig01)
Datasheet Page 2 (p02_fig01)
P21 · p21_fig011777×1016px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — FIGURE 5-1: Voltage Divider Configuration. The output voltage is determined by Equation 5-1. EQUATION 5-1:
FIGURE 5-1: Voltage Divider Configuration. The output voltage is determined by Equation 5-1. EQUATION 5-1:
P21 · p21_fig02486×483px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — FIGURE 5-2: Switching Frequency Adjustment. Equation 5-3 gives the estimated switching frequency. EQUATION 5-3:
FIGURE 5-2: Switching Frequency Adjustment. Equation 5-3 gives the estimated switching frequency. EQUATION 5-3:
P21 · p21_fig031776×471px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — FIGURE 5-1: Voltage Divider Configuration. The output voltage is determined by Equation 5-1. EQUATION 5-1:
FIGURE 5-1: Voltage Divider Configuration. The output voltage is determined by Equation 5-1. EQUATION 5-1:
P21 · p21_fig041777×626px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — Figure 5-3 shows the switching frequency versus the resistor R17 when R19 = 100 kΩ.
Figure 5-3 shows the switching frequency versus the resistor R17 when R19 = 100 kΩ.
P21 · p21_fig05663×544px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — FIGURE 5-3: Switching Frequency vs. R17. 5.3 Inductor Selection
FIGURE 5-3: Switching Frequency vs. R17. 5.3 Inductor Selection
P25 · p25_fig011777×566px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — The inductor power dissipation due to DCR in Equation 5-24 can be approximated by Equation 5-25.
The inductor power dissipation due to DCR in Equation 5-24 can be approximated by Equation 5-25.
P27 · p27_fig01715×494px
MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) — FIGURE 6-1: Top and Bottom Layers of a Four-Layer Board. The following guidelines should be followed to ensure proper operation of the MIC28513 converter.
FIGURE 6-1: Top and Bottom Layers of a Four-Layer Board. The following guidelines should be followed to ensure proper operation of the MIC28513 converter.
Seite 1 / 2 (18 extrahierte Abbildungen)

Elektrische Spezifikationen & Bauteildetails (MIC28513-2YFL-T5)

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen (DE)
Standard-Elektronik- & Steckverbinderbauteil
Detaillierte Übersicht:MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) ist ein 24-poliges Standard-Elektronik- & Steckverbinderbauteil mit den Gehäuseabmessungen 3.00 × 4.00 × 0.85 mm (Pin-Raster e = 0.50 mm). Ausgelegt für 4.6V to 45V Versorgungsspannung, 40°C to +125°C Temperaturbereich und CAN Schnittstellen.
BetriebsversorgungsspannungV_CC / V_DD
4.6V to 45V
100nF + 10µF X7R Stützkondensatoren < 2mm am Versorgungspin platzieren
UmgebungstemperaturbereichT_A
40°C to +125°C
Industrieller Temperaturbereich; T_J(max) = +125°C
Takt- & Funkfrequenzf_CLK / f_RF
200 kHz
Aus offiziellen PDF-Datenblatttabellen extrahiert
Strom- & LeistungsdatenI_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
Maximal zulässigen Pin-Strom beachten
Gehäuseabmessungen (D × E × A)D × E × A
3.00 × 4.00 × 0.85 mm (A1=0.03 mm)
Gehäusefamilie: QFN (FQFN-24-EP(3x4))
Pinanzahl & RastermaßN / e
24 Pins | Pitch e = 0.50 mm (19.7 mil)
Nach IPC-7351B Mittenabstand C normalisiert
Integrierte BusschnittstellenBuses
CAN
4-Wege-Synchronisation (Symbol ↔ Pinout ↔ 2D ↔ 3D)
Lötprofil & FeuchteempfindlichkeitIPC / MSL
IPC-7351B Level B | J-STD-020 (Peak 260°C) | MSL-3
60% Pastenmasken-Segmentierung auf dem Thermal-Pad
Technischer Sicherheitshinweis: Vor der SMT-Bestückung die Pin-1-Markierung auf dem Bestückungsdruck prüfen.
Technischer Sicherheitshinweis: Thermal-Pad über Ø0.3mm Thermodurchkontaktierungen niederimpedant an die GND-Lage anbinden.

5-Punkte-Industriestandardprüfung

Automatische Geometrie- und Regelprüfung vor dem Dateiexport
5/5 BESTANDEN
IEEE-315 Symbol27 Pins automatisch nach Bussen gruppiert
OK
IPC-7351B Footprint27 Pads · Raster 0.50mm
OK
IPC-7525 60% LotpastenfensterReflow 1:1 Standard
OK
DFM-Fertigungsregeln (JLCPCB / PCBWay)Min. Pad-Abstand: 0.25mm
OK
3D STEP AP214 & GLBKoordinatenursprung deckungsgleich (0,0,0)
OK

Praxisverifikation & Ingenieurbewertungen

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen
5.00 PCB Verified

Mechanische Abmessungen & Land Pattern (FQFN-24-EP(3x4))

Aus dem Datenblatt extrahiert & nach IPC-7351B normiert
mm
Gehäusekörper (D × E)Nominal
3.00 × 4.00 mm
Höhe (A) & Raster (e)IPC-7351B
A=0.85mm · e=0.50mm
Pad-Abmessungen (W × L)Level B
0.25 × 0.50 mm
Pins / Gesamt-PadsTopology
27P / 27Pad (QUAD_ROW)

Empfohlene Peripherie-BOM & Pin-kompatible Ersatztypen (Drop-in)

Passive Begleitbauteile gemäß Referenzschaltung sowie 1:1 pin-kompatible Alternativen
DFM READY
Bauteilbezeichner / Ersatz-MPNWert / GehäuseFunktion & PCB-Layout-Regel
N/A
BOM
Per application circuit
FQFN-24-EP(3x4)
Leiterbahnbreiten für Nennstrom dimensionieren und IPC-2221 Isolationsabstände einhalten.

Häufig gestellte technische Fragen (FAQ) — MIC28513-2YFL-T5 (FQFN-24-EP(3x4))

Schnellantworten zu Pinbelegung, IPC-7351B Land-Pattern-Abmessungen und CAD-Exportformaten
IPC-7351B / IEEE-315

Wie lautet die Pinbelegung (Pinout) und Versorgungsspannung des MIC28513-2YFL-T5 (FQFN-24-EP(3x4))?

Das Bauteil MIC28513-2YFL-T5 von MICROCHIP im FQFN-24-EP(3x4)-Gehäuse besitzt 27 Pins mit einem Rastermaß (Pitch) von 0.50 mm und einem Betriebsspannungsbereich VCC von 4.6V to 45V. Wichtige Pins: 1 (DL: Multiplex-I/O- & Peripherie-Pin DL (General)), 2 (PGND: Masseanschluss (PGND)), 3 (DH: Multiplex-I/O- & Peripherie-Pin DH (General)), 4 (PVIN: Versorgungsspannungseingang (PVIN — 4.6V to 45V)), 5 (LX: Multiplex-I/O- & Peripherie-Pin LX (General)), 6 (BST: Multiplex-I/O- & Peripherie-Pin BST (General)).

Welche IPC-7351B Land-Pattern-Abmessungen hat der MIC28513-2YFL-T5?

Gemäß Datenblatt und IPC-7351B (Density Level B Nominal) betragen die Gehäusemaße des MIC28513-2YFL-T5 (FQFN-24-EP(3x4)) 4.00 × 3.00 mm bei einem Pitch e = 0.50 mm und 27 Kupfer-Pads.

Wo können KiCad (.kicad_mod, .kicad_sym), Fusion 360 (.lbr) und 3D-STEP-Modelle für MIC28513-2YFL-T5 heruntergeladen werden?

Auf dieser Seite können Sie das vollständig verifizierte CAD-Bibliothekspaket für MIC28513-2YFL-T5 (MICROCHIP, FQFN-24-EP(3x4)) unter der Open-Hardware-Lizenz CERN-OHL-P-2.0 kostenlos herunterladen: KiCad 8 Footprint (.kicad_mod), Schaltplansymbol (.kicad_sym), Fusion 360 / Eagle (.lbr) und 3D STEP AP214 / WebGL GLB.

Statischer Referenzanhang: Pinbelegungstabelle (27 Pins) & MIC28513 VariantenStatische Tabelle aufklappen
Pin-Nr.SignalnameElektrischer TypFunktionsbeschreibung & Schaltungshinweise
1DLDigital_IOSignalanschluss DL (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: DL. Unterstützte Bus-Schnittstellen: General.
2PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
3DHDigital_IOSignalanschluss DH (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: DH. Unterstützte Bus-Schnittstellen: General.
4PVINPower_InPositiver Versorgungseingang (PVIN) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
5LXDigital_IOSignalanschluss LX (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: LX. Unterstützte Bus-Schnittstellen: General.
6BSTDigital_IOSignalanschluss BST (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: BST. Unterstützte Bus-Schnittstellen: General.
7PVINPower_InPositiver Versorgungseingang (PVIN) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
8PVINPower_InPositiver Versorgungseingang (PVIN) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
9PVINPower_InPositiver Versorgungseingang (PVIN) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
10PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
11PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
12SWDigital_IOSignalanschluss SW (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: SW. Unterstützte Bus-Schnittstellen: General.
13AGNDGNDElektrischer 0V-Masserückführungsanschluss (AGND) für Kernlogik, I/O-Treiber und Analogblöcke.
14FBDigital_IOSignalanschluss FB (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: FB. Unterstützte Bus-Schnittstellen: General.
15PGOODOpen_DrainSignalanschluss PGOOD (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: PGOOD. Unterstützte Bus-Schnittstellen: General.
16ENDigital_IOChip-Freigabe- und Reset-Steuereingang (EN): High aktiviert den Chip; Low versetzt ihn in den Reset-/Abschaltzustand.
17V INDigital_IOSignalanschluss V IN (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: V IN. Unterstützte Bus-Schnittstellen: General.
18I LIMDigital_IOSignalanschluss I LIM (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: I LIM. Unterstützte Bus-Schnittstellen: General.
19VDDPower_OutGeregelter Leistungsausgang (VDD) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
20P VDDPower_InPositiver Versorgungseingang (P VDD) im Spannungsbereich 4.6V to 45V (Max. 45.0V).
21SWDigital_IOSignalanschluss SW (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: SW. Unterstützte Bus-Schnittstellen: General.
22PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
23PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
24FREQDigital_IOSignalanschluss FREQ (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: FREQ. Unterstützte Bus-Schnittstellen: General.
25PV INDigital_IOSignalanschluss PV IN (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: PV IN. Unterstützte Bus-Schnittstellen: General.
26PGNDGNDElektrischer 0V-Masserückführungsanschluss (PGND) für Kernlogik, I/O-Treiber und Analogblöcke.
27SWDigital_IOSignalanschluss SW (Richtung: I/O, Spannungsbereich: 4.6V to 45V). Alternative Multiplex-Funktionen: SW. Unterstützte Bus-Schnittstellen: General.
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