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CH547G (SOP-16) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH547G

WCHID: C1222433SOP-16 · 16 ピン · Pitch 1.27mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH547G (SOP-16)102P1.4/SCS/AIN3P1.5/MOSI/PW4P1.6/MISO/RX5P1.7/SCK/TXD6P5.7/RST7P3.0/RXD8P3.1/TXD16V3315VDD14GND/VSS13P5.0/DM12P5.1/DP11P2.4/PWM1/T210P2.2/PWM3/IN9P3.4/T0Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.215.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
12345678910111213141516E=3.90mm · Pitch e=1.27mmD=9.90mm-6-5-4-3-2-1012345676543210-1-2-3-4-5-6-7mm
3. 3Dモデル
パッケージ外形: 3.90mm × 9.90mm · ピッチ: 1.27mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (16/16)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
10I/OマルチプレクスI/O・ペリフェラル端子 0 (General)
2P1.4/SCS/AIN4I/OマルチプレクスI/O・ペリフェラル端子 P1.4/SCS/AIN4 (ADC)
3P1.5/MOSI/PWM0_/AIN5I/OマルチプレクスI/O・ペリフェラル端子 P1.5/MOSI/PWM0_/AIN5 (SPI, ADC, PWM)
4P1.6/MISO/RXD1_/AIN6I/OマルチプレクスI/O・ペリフェラル端子 P1.6/MISO/RXD1_/AIN6 (UART, SPI, ADC)
5P1.7/SCK/TXD1_/AIN7I/OマルチプレクスI/O・ペリフェラル端子 P1.7/SCK/TXD1_/AIN7 (UART, SPI, ADC)
6P5.7/RSTI/OマルチプレクスI/O・ペリフェラル端子 P5.7/RST (General)
7P3.0/RXDI/OマルチプレクスI/O・ペリフェラル端子 P3.0/RXD (UART)
8P3.1/TXDI/OマルチプレクスI/O・ペリフェラル端子 P3.1/TXD (UART)
9P3.4/T0I/OマルチプレクスI/O・ペリフェラル端子 P3.4/T0 (General)
10P2.2/PWM3/INT0_I/OマルチプレクスI/O・ペリフェラル端子 P2.2/PWM3/INT0_ (PWM)
11P2.4/PWM1/T2_I/OマルチプレクスI/O・ペリフェラル端子 P2.4/PWM1/T2_ (PWM)
12P5.1/DPI/OマルチプレクスI/O・ペリフェラル端子 P5.1/DP (General)
13P5.0/DMI/OマルチプレクスI/O・ペリフェラル端子 P5.0/DM (General)
14GND/VSSGNDグラウンド基準端子 (GND/VSS)
15VDDPower電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)
16V33Power電源供給入力 (V33 — 3.3V / 5.0V Standard Logic)
PIN 1 0
I/O
マルチプレクスI/O・ペリフェラル端子 0 (General)
設計上の注意点: 输出系统主频的4 分频时钟信号 ，即Fsys/4
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 8 抽出図面)

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PDF VIEWERメーカー公式データシート: CH547G (WCH · SOP-16)
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1. 実装3D外観モデルREPRESENTATIVE
CH547G (SOP-16) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH547G (SOP-16) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (16ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH547G (SOP-16) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH547G (SOP-16) - 4. パッケージ外形寸法図 (D×E×A)
SOP-16 · 3.90×9.90mm · ピッチ 1.27mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH547G (SOP-16) - 5. 推奨PCBフットプリント
IPC-7351B パッド (16 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH547G (SOP-16) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (8 点 · 1/1 ページ)
CH546 / CH547 シリーズの切り抜きなし原本図面 8 点中 1–8 点目を表示
P1 · p01_fig011717×914px
CH547G (SOP-16) — CH546 32KB+3KB 2 路 1 组 8 路 8 通道
CH546 32KB+3KB 2 路 1 组 8 路 8 通道
P27 · p27_fig011757×489px
CH547G (SOP-16) — 由Pn_MOD_OC[x]和Pn_DIR_PU[x]组合实现Pn 端口的相关配置，具体如下。
由Pn_MOD_OC[x]和Pn_DIR_PU[x]组合实现Pn 端口的相关配置，具体如下。
P28 · p28_fig011757×1897px
CH547G (SOP-16) — CH547 手册 28 | 0 | 1 | GND | Pn_DIR_PU[x] | Pn[x] | Delay 2 Clock | Pn[x] | OUT | bPn_MOD_OC[x] | 10K | 70K | VCC | VCC | // | AIN[x] | ADC_CHAN[x] VCC Pn[x] | IN | VCC | bPn_MOD_OC[x] | ADC_PIN[x/2] | P5 端口输入输出寄存器(P5)： | 位 名称 访问 描述 复位值 | 7
CH547 手册 28 | 0 | 1 | GND | Pn_DIR_PU[x] | Pn[x] | Delay 2 Clock | Pn[x] | OUT | bPn_MOD_OC[x] | 10K | 70K | VCC | VCC | // | AIN[x] | ADC_CHAN[x] VCC Pn[x] | IN | VCC | bPn_MOD_OC[x] | ADC_PIN[x/2] | P5 端口输入输出寄存器(P5)： | 位 名称 访问 描述 复位值 | 7
P28 · p28_fig01P28
CH547G (SOP-16) — Datasheet Page 28 (p28_fig01)
Datasheet Page 28 (p28_fig01)
P42 · p42_fig011757×798px
CH547G (SOP-16) — UART3 波特率由SBAUD3 设置产生，根据bU3SMOD 的选择分为两种情况： 当bU3SMOD=0 时，SBAUD3 = 256 - Fsys / 32 / 波特率； 当bU3SMOD=1 时，SBAUD3 = 256 - Fsys / 16 / 波特率。 UART3 中断状态寄存器(SIF3)： | 位 名称 访问 描述 复位值 | [7:2] 保留 RO 保留 000000b | 1 bU3TI RW 发送中断标志位，一个数据字节发送完后由硬件置位，需 要软件写1
UART3 波特率由SBAUD3 设置产生，根据bU3SMOD 的选择分为两种情况： 当bU3SMOD=0 时，SBAUD3 = 256 - Fsys / 32 / 波特率； 当bU3SMOD=1 时，SBAUD3 = 256 - Fsys / 16 / 波特率。 UART3 中断状态寄存器(SIF3)： | 位 名称 访问 描述 复位值 | [7:2] 保留 RO 保留 000000b | 1 bU3TI RW 发送中断标志位，一个数据字节发送完后由硬件置位，需 要软件写1
P45 · p45_fig011496×347px
CH547G (SOP-16) — 图14.3.1 SPI 模式0 时序图 模式3：bSn_MST_CLK = 1
图14.3.1 SPI 模式0 时序图 模式3：bSn_MST_CLK = 1
P45 · p45_fig021529×357px
CH547G (SOP-16) — 图14.3.1 SPI 模式0 时序图 模式3：bSn_MST_CLK = 1
图14.3.1 SPI 模式0 时序图 模式3：bSn_MST_CLK = 1
P60 · p60_fig01PDF 内の全パッケージ
CH547G (SOP-16) — 18.1 LQFP48-7*7 18.2 QFN28-4*4 70.15 #25 DOAQOHagegga ia COUN OT i. a — i= =a —_ im — —_ [ = pS 18 |8 | = a nls i — — |_| = = He ws =o aia Co #13 - = TInt aE ae Eee a spoon nag abs a oO. a.2 04 nh ne sos LQFP 1.5 TQFP |_|. 1.05
18.1 LQFP48-7*7 18.2 QFN28-4*4 70.15 #25 DOAQOHagegga ia COUN OT i. a — i= =a —_ im — —_ [ = pS 18 |8 | = a nls i — — |_| = = He ws =o aia Co #13 - = TInt aE ae Eee a spoon nag abs a oO. a.2 04 nh ne sos LQFP 1.5 TQFP |_|. 1.05

電気仕様 & 部品詳細スペック (CH547G)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:CH547G (SOP-16) は 16 ピンの標準電子部品・コネクタで、パッケージ外形は 9.90 × 3.90 × 1.75 mm（ピンピッチ e = 1.27 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、USB, UART, SPI, ADC, PWM インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
40MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
9.90 × 3.90 × 1.75 mm (A1=0.15 mm)
パッケージ系列: SOP (SOP-16)
ピン数・リードピッチN / e
16 Pins | Pitch e = 1.27 mm (50.0 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
USB, UART, SPI, ADC, PWM
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル16 ピン自動バス分類
OK
IPC-7351B フットプリント16 パッド · ピッチ 1.27mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (SOP-16)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
9.90 × 3.90 mm
全高 (A) & ピッチ (e)IPC-7351B
A=1.75mm · e=1.27mm
パッド寸法 (W × L)Level B
0.60 × 1.55 mm
ピン数 / 総パッド数Topology
16P / 16Pad (DUAL_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
SOP-16
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH547G (SOP-16)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH547G (SOP-16) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH547G (SOP-16 パッケージ) は全 16 ピン構成で、ピンピッチは 1.27 mm です。主なピン：1 (0: マルチプレクスI/O・ペリフェラル端子 0 (General)), 2 (P1.4/SCS/AIN4: マルチプレクスI/O・ペリフェラル端子 P1.4/SCS/AIN4 (ADC)), 3 (P1.5/MOSI/PWM0_/AIN5: マルチプレクスI/O・ペリフェラル端子 P1.5/MOSI/PWM0_/AIN5 (SPI, ADC, PWM)), 4 (P1.6/MISO/RXD1_/AIN6: マルチプレクスI/O・ペリフェラル端子 P1.6/MISO/RXD1_/AIN6 (UART, SPI, ADC)), 5 (P1.7/SCK/TXD1_/AIN7: マルチプレクスI/O・ペリフェラル端子 P1.7/SCK/TXD1_/AIN7 (UART, SPI, ADC)), 6 (P5.7/RST: マルチプレクスI/O・ペリフェラル端子 P5.7/RST (General))。

CH547G の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH547G (SOP-16) の本体外形は 3.90 × 9.90 mm、ピッチ e = 1.27 mm、合計 16 パッドで構成されています。

CH547G の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH547G (WCH, SOP-16) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (16 ピン) & CH546 / CH547 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
10Digital_IO信号端子 0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: 0。対応バス/インターフェース: General。
2P1.4/SCS/AIN4Analog信号端子 P1.4/SCS/AIN4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P1.4/SCS/AIN4。対応バス/インターフェース: ADC。
3P1.5/MOSI/PWM0_/AIN5Digital_IO信号端子 P1.5/MOSI/PWM0_/AIN5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: SPI, ADC, PWM。
4P1.6/MISO/RXD1_/AIN6Digital_IO信号端子 P1.6/MISO/RXD1_/AIN6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: UART, SPI, ADC。
5P1.7/SCK/TXD1_/AIN7Digital_IO信号端子 P1.7/SCK/TXD1_/AIN7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: UART, SPI, ADC。
6P5.7/RSTDigital_IO信号端子 P5.7/RST（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P5.7/RST。対応バス/インターフェース: General。
7P3.0/RXDDigital_IO信号端子 P3.0/RXD（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P3.0/RXD。対応バス/インターフェース: UART。
8P3.1/TXDDigital_IO信号端子 P3.1/TXD（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P3.1/TXD。対応バス/インターフェース: UART。
9P3.4/T0Digital_IO信号端子 P3.4/T0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P3.4/T0。対応バス/インターフェース: General。
10P2.2/PWM3/INT0_Digital_IO信号端子 P2.2/PWM3/INT0_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P2.2/PWM3/INT0_。対応バス/インターフェース: PWM。
11P2.4/PWM1/T2_Digital_IO信号端子 P2.4/PWM1/T2_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P2.4/PWM1/T2_。対応バス/インターフェース: PWM。
12P5.1/DPDigital_IO信号端子 P5.1/DP（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P5.1/DP。対応バス/インターフェース: General。
13P5.0/DMDigital_IO信号端子 P5.0/DM（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P5.0/DM。対応バス/インターフェース: General。
14GND/VSSGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND/VSS) です。
15VDDPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 5.5V) です。
16V33Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (V33、最大定格: 5.5V) です。
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