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VSC8530XMW-05 (QFN-48-EP(6x6)) — Symbol, Footprint IPC-7351B & 3D STEP Model

VSC8530XMW-05

MICROCHIPID: C1522142QFN-48-EP(6x6) · 49 ピン · Pitch 0.40mmIPC TOLERANCE VARIATION5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · VSC8530XMW-05 (QFN-48-EP(6x6))1VDD25A2VDD1A3RESERVED_54RESERVED_45VDD25A6RESERVED_37RESERVED_28VDD25A9P0_D1N10P0_D1P11P0_D0N12P0_D0P13VDD1A14VDD115VDDMAC16RXD317RXD218RXD119VDDMAC20RXD021RX_CTL22RX_CLK23TX_CTL24VDD125TX_CLK49EP48REF_REXT47VDD1A46REF_FILT45RESERVED_044RESERVED_143XTAL242XTAL141REFCLK_SEL0_40REFCLK_SEL1_39LED038LED137VDDIO36CLKOUT35NRESET34MDINT33MDIO32VDDMDIO31MDC30TXD329TXD228TXD127VDDMAC26TXD0Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.838.133.027.922.917.812.77.62.5-2.5-7.6-12.7-17.8-22.9-27.9-33.0-38.1mm
2. 2Dフットプリント
12345678910111213141516171819202122232425262728293031323334353637383940414243444546474849E=6.00mm · Pitch e=0.40mmD=6.00mm-5-4-3-2-1012345543210-1-2-3-4-5mm
3. 3Dモデル
パッケージ外形: 6.00mm × 6.00mm · ピッチ: 0.40mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (49/49)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1VDD25APower電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)
2VDD1APower電源供給入力 (VDD1A — 3.3V / 5.0V Standard Logic)
3RESERVED_5I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_5 (General)
4RESERVED_4I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_4 (General)
5VDD25APower電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)
6RESERVED_3I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_3 (General)
7RESERVED_2I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_2 (General)
8VDD25APower電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)
9P0_D1NI/OマルチプレクスI/O・ペリフェラル端子 P0_D1N (General)
10P0_D1PI/OマルチプレクスI/O・ペリフェラル端子 P0_D1P (General)
11P0_D0NI/OマルチプレクスI/O・ペリフェラル端子 P0_D0N (General)
12P0_D0PI/OマルチプレクスI/O・ペリフェラル端子 P0_D0P (General)
13VDD1APower電源供給入力 (VDD1A — 3.3V / 5.0V Standard Logic)
14VDD1Power電源供給入力 (VDD1 — 3.3V / 5.0V Standard Logic)
15VDDMACPower電源供給入力 (VDDMAC — 3.3V / 5.0V Standard Logic)
16RXD3I/OマルチプレクスI/O・ペリフェラル端子 RXD3 (UART)
17RXD2I/OマルチプレクスI/O・ペリフェラル端子 RXD2 (UART)
18RXD1I/OマルチプレクスI/O・ペリフェラル端子 RXD1 (UART)
19VDDMACPower電源供給入力 (VDDMAC — 3.3V / 5.0V Standard Logic)
20RXD0I/OマルチプレクスI/O・ペリフェラル端子 RXD0 (UART)
21RX_CTLI/OマルチプレクスI/O・ペリフェラル端子 RX_CTL (General)
22RX_CLKI/OマルチプレクスI/O・ペリフェラル端子 RX_CLK (General)
23TX_CTLI/OマルチプレクスI/O・ペリフェラル端子 TX_CTL (General)
24VDD1Power電源供給入力 (VDD1 — 3.3V / 5.0V Standard Logic)
25TX_CLKI/OマルチプレクスI/O・ペリフェラル端子 TX_CLK (General)
26TXD0I/OマルチプレクスI/O・ペリフェラル端子 TXD0 (UART)
27VDDMACPower電源供給入力 (VDDMAC — 3.3V / 5.0V Standard Logic)
28TXD1I/OマルチプレクスI/O・ペリフェラル端子 TXD1 (UART)
29TXD2I/OマルチプレクスI/O・ペリフェラル端子 TXD2 (UART)
30TXD3I/OマルチプレクスI/O・ペリフェラル端子 TXD3 (UART)
31MDCI/OマルチプレクスI/O・ペリフェラル端子 MDC (General)
32VDDMDIOPower電源供給入力 (VDDMDIO — 3.3V / 5.0V Standard Logic)
33MDIOI/OマルチプレクスI/O・ペリフェラル端子 MDIO (General)
34MDINTI/OマルチプレクスI/O・ペリフェラル端子 MDINT (General)
35NRESETIシステムイネーブル・ハードウェアリセット (NRESET)
36CLKOUTI/OマルチプレクスI/O・ペリフェラル端子 CLKOUT (General)
37VDDIOPower電源供給入力 (VDDIO — 3.3V / 5.0V Standard Logic)
38LED1I/OマルチプレクスI/O・ペリフェラル端子 LED1 (General)
39LED0I/OマルチプレクスI/O・ペリフェラル端子 LED0 (General)
40REFCLK_SEL1_I/OマルチプレクスI/O・ペリフェラル端子 REFCLK_SEL1_ (General)
41REFCLK_SEL0_I/OマルチプレクスI/O・ペリフェラル端子 REFCLK_SEL0_ (General)
42XTAL1I/OマルチプレクスI/O・ペリフェラル端子 XTAL1 (RTC/CLK)
43XTAL2I/OマルチプレクスI/O・ペリフェラル端子 XTAL2 (RTC/CLK)
44RESERVED_1I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_1 (General)
45RESERVED_0I/OマルチプレクスI/O・ペリフェラル端子 RESERVED_0 (General)
46REF_FILTI/OマルチプレクスI/O・ペリフェラル端子 REF_FILT (General)
47VDD1APower電源供給入力 (VDD1A — 3.3V / 5.0V Standard Logic)
48REF_REXTI/OマルチプレクスI/O・ペリフェラル端子 REF_REXT (General)
49EPGND露出サーマルパッド・グラウンド (EP)
PIN 1 VDD25A
Power
電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)
設計上の注意点: PWR
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 5 抽出図面)

原本PDFを直接閲覧、または図面をクリックして全画面拡大
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PDF VIEWERメーカー公式データシート: VSC8530XMW-05 (MICROCHIP · QFN-48-EP(6x6))
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1. 実装3D外観モデルREPRESENTATIVE
VSC8530XMW-05 (QFN-48-EP(6x6)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
VSC8530XMW-05 (QFN-48-EP(6x6)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (49ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
VSC8530XMW-05 (QFN-48-EP(6x6)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
VSC8530XMW-05 (QFN-48-EP(6x6)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-48-EP(6x6) · 6.00×6.00mm · ピッチ 0.40mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
VSC8530XMW-05 (QFN-48-EP(6x6)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (49 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
VSC8530XMW-05 (QFN-48-EP(6x6)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (5 点 · 1/1 ページ)
VSC8530 シリーズの切り抜きなし原本図面 5 点中 1–5 点目を表示
P1 · p01_fig01661×219px
VSC8530XMW-05 (QFN-48-EP(6x6)) — PDF 抽出図面 p01_fig01 (1 ページ — OTHER_DIAGRAM)
PDF 抽出図面 p01_fig01 (1 ページ — OTHER_DIAGRAM)
P71 · p71_fig011590×1655px
VSC8530XMW-05 (QFN-48-EP(6x6)) — Figure 27 • Pin Diagram
Figure 27 • Pin Diagram
P71 · p71_fig01P71
VSC8530XMW-05 (QFN-48-EP(6x6)) — Datasheet Page 71 (p71_fig01)
Datasheet Page 71 (p71_fig01)
P76 · p76_fig011772×2086px
VSC8530XMW-05 (QFN-48-EP(6x6)) — Figure 28 • Package Drawing
Figure 28 • Package Drawing
P76 · p76_fig01P76
VSC8530XMW-05 (QFN-48-EP(6x6)) — Datasheet Page 76 (p76_fig01)
Datasheet Page 76 (p76_fig01)

電気仕様 & 部品詳細スペック (VSC8530XMW-05)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:VSC8530XMW-05 (QFN-48-EP(6x6)) は 48 ピンの標準電子部品・コネクタで、パッケージ外形は 6.00 × 6.00 × 0.85 mm（ピンピッチ e = 0.40 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、RTC/CLK, UART インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
1 MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
6.00 × 6.00 × 0.85 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-48-EP(6x6))
ピン数・リードピッチN / e
48 Pins | Pitch e = 0.40 mm (15.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
RTC/CLK, UART
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル49 ピン自動バス分類
OK
IPC-7351B フットプリント49 パッド · ピッチ 0.40mm
OK
IPC-7525 60% はんだペースト開口EPAD 3.30×3.30mm メッシュ分割
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (QFN-48-EP(6x6))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
6.00 × 6.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.85mm · e=0.40mm
パッド寸法 (W × L)Level B
0.22 × 0.80 mm
ピン数 / 総パッド数Topology
49P / 49Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-48-EP(6x6)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — VSC8530XMW-05 (QFN-48-EP(6x6))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

VSC8530XMW-05 (QFN-48-EP(6x6)) のピン配置 (Pinout) および電源電圧仕様は？

MICROCHIP 製 VSC8530XMW-05 (QFN-48-EP(6x6) パッケージ) は全 49 ピン構成で、ピンピッチは 0.40 mm です。主なピン：1 (VDD25A: 電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)), 2 (VDD1A: 電源供給入力 (VDD1A — 3.3V / 5.0V Standard Logic)), 3 (RESERVED_5: マルチプレクスI/O・ペリフェラル端子 RESERVED_5 (General)), 4 (RESERVED_4: マルチプレクスI/O・ペリフェラル端子 RESERVED_4 (General)), 5 (VDD25A: 電源供給入力 (VDD25A — 3.3V / 5.0V Standard Logic)), 6 (RESERVED_3: マルチプレクスI/O・ペリフェラル端子 RESERVED_3 (General))。

VSC8530XMW-05 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、VSC8530XMW-05 (QFN-48-EP(6x6)) の本体外形は 6.00 × 6.00 mm、ピッチ e = 0.40 mm、合計 49 パッドで構成されています（中央放熱パッド EPAD 3.30 × 3.30 mm、IPC-7525 60% 開口ペーストマスク付き）。

VSC8530XMW-05 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの VSC8530XMW-05 (MICROCHIP, QFN-48-EP(6x6)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (49 ピン) & VSC8530 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1VDD25APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD25A、最大定格: 5.5V) です。
2VDD1APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD1A、最大定格: 5.5V) です。
3RESERVED_5Digital_IO信号端子 RESERVED_5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_5。対応バス/インターフェース: General。
4RESERVED_4Digital_IO信号端子 RESERVED_4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_4。対応バス/インターフェース: General。
5VDD25APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD25A、最大定格: 5.5V) です。
6RESERVED_3Digital_IO信号端子 RESERVED_3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_3。対応バス/インターフェース: General。
7RESERVED_2Digital_IO信号端子 RESERVED_2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_2。対応バス/インターフェース: General。
8VDD25APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD25A、最大定格: 5.5V) です。
9P0_D1NDigital_IO信号端子 P0_D1N（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P0_D1N。対応バス/インターフェース: General。
10P0_D1PDigital_IO信号端子 P0_D1P（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P0_D1P。対応バス/インターフェース: General。
11P0_D0NDigital_IO信号端子 P0_D0N（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P0_D0N。対応バス/インターフェース: General。
12P0_D0PDigital_IO信号端子 P0_D0P（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: P0_D0P。対応バス/インターフェース: General。
13VDD1APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD1A、最大定格: 5.5V) です。
14VDD1Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD1、最大定格: 5.5V) です。
15VDDMACPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDMAC、最大定格: 5.5V) です。
16RXD3Digital_IO信号端子 RXD3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RXD3。対応バス/インターフェース: UART。
17RXD2Digital_IO信号端子 RXD2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RXD2。対応バス/インターフェース: UART。
18RXD1Digital_IO信号端子 RXD1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RXD1。対応バス/インターフェース: UART。
19VDDMACPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDMAC、最大定格: 5.5V) です。
20RXD0Digital_IO信号端子 RXD0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RXD0。対応バス/インターフェース: UART。
21RX_CTLDigital_IO信号端子 RX_CTL（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RX_CTL。対応バス/インターフェース: General。
22RX_CLKDigital_IO信号端子 RX_CLK（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RX_CLK。対応バス/インターフェース: General。
23TX_CTLDigital_IO信号端子 TX_CTL（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TX_CTL。対応バス/インターフェース: General。
24VDD1Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD1、最大定格: 5.5V) です。
25TX_CLKDigital_IO信号端子 TX_CLK（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TX_CLK。対応バス/インターフェース: General。
26TXD0Digital_IO信号端子 TXD0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TXD0。対応バス/インターフェース: UART。
27VDDMACPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDMAC、最大定格: 5.5V) です。
28TXD1Digital_IO信号端子 TXD1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TXD1。対応バス/インターフェース: UART。
29TXD2Digital_IO信号端子 TXD2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TXD2。対応バス/インターフェース: UART。
30TXD3Digital_IO信号端子 TXD3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: TXD3。対応バス/インターフェース: UART。
31MDCDigital_IO信号端子 MDC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: MDC。対応バス/インターフェース: General。
32VDDMDIOPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDMDIO、最大定格: 5.5V) です。
33MDIODigital_IO信号端子 MDIO（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: MDIO。対応バス/インターフェース: General。
34MDINTDigital_IO信号端子 MDINT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: MDINT。対応バス/インターフェース: General。
35NRESETDigital_IOローアクティブ・ハードウェアリセット端子 (NRESET)：Lowに引くことでコアと全ペリフェラルを初期化します。
36CLKOUTDigital_IO信号端子 CLKOUT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: CLKOUT。対応バス/インターフェース: General。
37VDDIOPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDDIO、最大定格: 5.5V) です。
38LED1Digital_IO信号端子 LED1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: LED1。対応バス/インターフェース: General。
39LED0Digital_IO信号端子 LED0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: LED0。対応バス/インターフェース: General。
40REFCLK_SEL1_Digital_IO信号端子 REFCLK_SEL1_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: REFCLK_SEL1_。対応バス/インターフェース: General。
41REFCLK_SEL0_Digital_IO信号端子 REFCLK_SEL0_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: REFCLK_SEL0_。対応バス/インターフェース: General。
42XTAL1Digital_IO信号端子 XTAL1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: XTAL1。対応バス/インターフェース: RTC/CLK。
43XTAL2Digital_IO信号端子 XTAL2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: XTAL2。対応バス/インターフェース: RTC/CLK。
44RESERVED_1Digital_IO信号端子 RESERVED_1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_1。対応バス/インターフェース: General。
45RESERVED_0Digital_IO信号端子 RESERVED_0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RESERVED_0。対応バス/インターフェース: General。
46REF_FILTDigital_IO信号端子 REF_FILT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: REF_FILT。対応バス/インターフェース: General。
47VDD1APower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD1A、最大定格: 5.5V) です。
48REF_REXTDigital_IO信号端子 REF_REXT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: REF_REXT。対応バス/インターフェース: General。
49EPGNDパッケージ底面の露出放熱パッド (EP)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
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