PIC18LF4620-I/P (PDIP-40) — Symbol, Footprint IPC-7351B & 3D STEP Model

PIC18LF4620-I/P

MICROCHIPID: C556918PDIP-40 · 40 Pins · Pitch 2.54mmIPC-7351B Verified5.0 (0)
SYNCHRONISIERTER 4D-CROSS-PROBE-MODUSKlicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
1. SCHALTPLANSYMBOL
U1 · PIC18LF4620-I/P (PDIP-40)1MCLR#/VPP/RE2RA0/AN03RA1/AN14RA2/AN2/VREF5RA3/AN3/VREF6RA4/T0CKI/C17NC8RE0/RD#/AN59RE1/WR#/AN610RE2/CS#/AN711VDD12VSS13OSC1/CLKI/RA14OSC2/CLKO/RA15RC0/T1OSO/T116RC1/T1OSI/CC17RC2/CCP1/P1A18RC3/SCK/SCL19RD0/PSP020RD1/PSP140RB7/KBI3/PGD39RB6/KBI2/PGC38RB5/KBI1/PGM37RB4/KBI0/AN136RB3/AN9/CCP235RB2/INT2/AN834RB1/INT1/AN133RB0/INT0/FLT32VDD31VSS30RD7/PSP7/P1D29RD6/PSP6/P1C28RD5/PSP5/P1B27RD4/PSP426RC7/RX/DT25RC6/TX/CK24RC5/SDO23RC4/SDI/SDA22RD3/PSP321RD2/PSP2Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.830.525.420.315.210.25.10-5.1-10.2-15.2-20.3-25.4-30.5mm
2. 2D-FOOTPRINT
12345678910111213141516171819202122232425262728293031323334353637383940E=13.74mm · Pitch e=2.54mmD=50.26mm-22-20-18-16-14-12-10-8-6-4-2024681012141618202239373533312927252321191715131197531-1-3-5-7-9-11-13-15-17-19-21-23-25-27-29-31-33-35-37-39mm
3. 3D-MODELL
Gehäusekörper: 13.74mm × 50.26mm · Raster: 2.54mm · Linealschritt: 1.00mmSynchronisiert <100ms

Synchronisierte Pinbelegung (Symbol / 2D / 3D) (40/40)

Klicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
PinSymbolTypFunktionsbeschreibung (DE)
1MCLR#/VPP/RE3I/OMultiplex-I/O- & Peripherie-Pin MCLR#/VPP/RE3 (General)
2RA0/AN0I/OMultiplex-I/O- & Peripherie-Pin RA0/AN0 (General)
3RA1/AN1I/OMultiplex-I/O- & Peripherie-Pin RA1/AN1 (General)
4RA2/AN2/VREF-/CVREFAnalogMultiplex-I/O- & Peripherie-Pin RA2/AN2/VREF-/CVREF (General)
5RA3/AN3/VREF+AnalogMultiplex-I/O- & Peripherie-Pin RA3/AN3/VREF+ (General)
6RA4/T0CKI/C1OUTI/OMultiplex-I/O- & Peripherie-Pin RA4/T0CKI/C1OUT (General)
7NCNCNo Connect (Leave Floating)
8RE0/RD#/AN5I/OMultiplex-I/O- & Peripherie-Pin RE0/RD#/AN5 (General)
9RE1/WR#/AN6I/OMultiplex-I/O- & Peripherie-Pin RE1/WR#/AN6 (General)
10RE2/CS#/AN7I/OMultiplex-I/O- & Peripherie-Pin RE2/CS#/AN7 (General)
11VDDPowerVersorgungsspannungseingang (VDD — 2.0V to 5.5V)
12VSSGNDMasseanschluss (VSS)
13OSC1/CLKI/RA7I/OMultiplex-I/O- & Peripherie-Pin OSC1/CLKI/RA7 (RTC/CLK)
14OSC2/CLKO/RA6I/OMultiplex-I/O- & Peripherie-Pin OSC2/CLKO/RA6 (RTC/CLK)
15RC0/T1OSO/T13CKII/OMultiplex-I/O- & Peripherie-Pin RC0/T1OSO/T13CKI (General)
16RC1/T1OSI/CCP2I/OMultiplex-I/O- & Peripherie-Pin RC1/T1OSI/CCP2 (General)
17RC2/CCP1/P1AI/OMultiplex-I/O- & Peripherie-Pin RC2/CCP1/P1A (General)
18RC3/SCK/SCLI/OMultiplex-I/O- & Peripherie-Pin RC3/SCK/SCL (SPI, I2C)
19RD0/PSP0I/OMultiplex-I/O- & Peripherie-Pin RD0/PSP0 (General)
20RD1/PSP1I/OMultiplex-I/O- & Peripherie-Pin RD1/PSP1 (General)
21RD2/PSP2I/OMultiplex-I/O- & Peripherie-Pin RD2/PSP2 (General)
22RD3/PSP3I/OMultiplex-I/O- & Peripherie-Pin RD3/PSP3 (General)
23RC4/SDI/SDAI/OMultiplex-I/O- & Peripherie-Pin RC4/SDI/SDA (I2C)
24RC5/SDOI/OMultiplex-I/O- & Peripherie-Pin RC5/SDO (General)
25RC6/TX/CKI/OMultiplex-I/O- & Peripherie-Pin RC6/TX/CK (General)
26RC7/RX/DTI/OMultiplex-I/O- & Peripherie-Pin RC7/RX/DT (General)
27RD4/PSP4I/OMultiplex-I/O- & Peripherie-Pin RD4/PSP4 (General)
28RD5/PSP5/P1BI/OMultiplex-I/O- & Peripherie-Pin RD5/PSP5/P1B (General)
29RD6/PSP6/P1CI/OMultiplex-I/O- & Peripherie-Pin RD6/PSP6/P1C (General)
30RD7/PSP7/P1DI/OMultiplex-I/O- & Peripherie-Pin RD7/PSP7/P1D (General)
31VSSGNDMasseanschluss (VSS)
32VDDPowerVersorgungsspannungseingang (VDD — 2.0V to 5.5V)
33RB0/INT0/FLT0/AN12I/OMultiplex-I/O- & Peripherie-Pin RB0/INT0/FLT0/AN12 (General)
34RB1/INT1/AN10I/OMultiplex-I/O- & Peripherie-Pin RB1/INT1/AN10 (General)
35RB2/INT2/AN8I/OMultiplex-I/O- & Peripherie-Pin RB2/INT2/AN8 (General)
36RB3/AN9/CCP2I/OMultiplex-I/O- & Peripherie-Pin RB3/AN9/CCP2 (General)
37RB4/KBI0/AN11I/OMultiplex-I/O- & Peripherie-Pin RB4/KBI0/AN11 (General)
38RB5/KBI1/PGMI/OMultiplex-I/O- & Peripherie-Pin RB5/KBI1/PGM (General)
39RB6/KBI2/PGCI/OMultiplex-I/O- & Peripherie-Pin RB6/KBI2/PGC (General)
40RB7/KBI3/PGDI/OMultiplex-I/O- & Peripherie-Pin RB7/KBI3/PGD (General)
PIN 1 MCLR#/VPP/RE3
I/O
Multiplex-I/O- & Peripherie-Pin MCLR#/VPP/RE3 (General)
Designhinweis: Signal terminal MCLR#/VPP/RE3 (I/O, 2.0V to 5.5V domain). Multiplexed alternate functions: MCLR#/VPP/RE3. Supported peripheral buses: General.
IPC-7351B Lötdichte & Spannweite C/G/Z Konfigurator

Live-PDF-Datenblatt-Viewer & Technische Zeichnungen (6 Standardzeichnungen + 14 Extrahierte Abbildungen)

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PDF VIEWEROffizielles Datenblatt: PIC18LF4620-I/P (MICROCHIP · PDIP-40)
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1. Reales 3D-GehäusemodellREPRESENTATIVE
PIC18LF4620-I/P (PDIP-40) - 1. Reales 3D-Gehäusemodell
Detaillierter 3D-VolumenkörperVergrößern ›
2. Standard-Pinbelegung (Draufsicht)CLEANROOM PINOUT
PIC18LF4620-I/P (PDIP-40) - 2. Standard-Pinbelegung (Draufsicht)
Konforme Pinanordnung (40 Pins)Vergrößern ›
3. Original-Datenblatt-PinoutPDF PINOUT
PIC18LF4620-I/P (PDIP-40) - 3. Original-Datenblatt-Pinout
Unbeschnittenes DatenblattdiagrammVergrößern ›
4. Gehäuseabmessungen (D×E×A)PACKAGE DIMENSIONS
PIC18LF4620-I/P (PDIP-40) - 4. Gehäuseabmessungen (D×E×A)
PDIP-40 · 13.74×50.26mm · Raster 2.54mmVergrößern ›
5. Empfohlener PCB-FootprintLAND PATTERN
PIC18LF4620-I/P (PDIP-40) - 5. Empfohlener PCB-Footprint
IPC-7351B Land Pattern (40 Pads)Vergrößern ›
6. Typische ApplikationsschaltungSCHEMATIC
PIC18LF4620-I/P (PDIP-40) - 6. Typische Applikationsschaltung
Typical Application SchematicVergrößern ›
Originale Datenblatt-Pinouts & Technische Zeichnungen (14 Abb. · Seite 1/2)
Zeige 1–12 von 14 unbeschnittenen Originalzeichnungen für PIC18LF4620
P2 · p02_fig011777×1640px
PIC18LF4620-I/P (PDIP-40) — DS39626E-page ii © 2008 Microchip Technology Inc. | Trademarks | FilterLab, Linear Active Thermistor, MXDEV, MXLAB, SEEVAL, SmartSensor and The Embedded Control Solutions Company are registered trademarks of Microchip Technology Incorporate
DS39626E-page ii © 2008 Microchip Technology Inc. | Trademarks | FilterLab, Linear Active Thermistor, MXDEV, MXLAB, SEEVAL, SmartSensor and The Embedded Control Solutions Company are registered trademarks of Microchip Technology Incorporate
P2 · p02_fig02788×285px
PIC18LF4620-I/P (PDIP-40) — DS39626E-page ii © 2008 Microchip Technology Inc.
DS39626E-page ii © 2008 Microchip Technology Inc.
P143 · p143_fig011777×345px
PIC18LF4620-I/P (PDIP-40) — FIGURE 15-1: CAPTURE MODE OPERATION BLOCK DIAGRAM
FIGURE 15-1: CAPTURE MODE OPERATION BLOCK DIAGRAM
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PIC18LF4620-I/P (PDIP-40) — FIGURE 15-1: CAPTURE MODE OPERATION BLOCK DIAGRAM
FIGURE 15-1: CAPTURE MODE OPERATION BLOCK DIAGRAM
P144 · p144_fig011537×941px
PIC18LF4620-I/P (PDIP-40) — FIGURE 15-2: COMPARE MODE OPERATION BLOCK DIAGRAM
FIGURE 15-2: COMPARE MODE OPERATION BLOCK DIAGRAM
P167 · p167_fig011777×937px
PIC18LF4620-I/P (PDIP-40) — FIGURE 17-2: SPI MASTER/SLAVE CONNECTION
FIGURE 17-2: SPI MASTER/SLAVE CONNECTION
P168 · p168_fig011777×1598px
PIC18LF4620-I/P (PDIP-40) — FIGURE 17-3: SPI MODE WAVEFORM (MASTER MODE) Write to SSPBUF SCK (CKP = 0 CKE = 0) SCK (CKP = 1 SCK (CKP = 0
FIGURE 17-3: SPI MODE WAVEFORM (MASTER MODE) Write to SSPBUF SCK (CKP = 0 CKE = 0) SCK (CKP = 1 SCK (CKP = 0
P170 · p170_fig011756×1059px
PIC18LF4620-I/P (PDIP-40) — FIGURE 17-5: SPI MODE WAVEFORM (SLAVE MODE WITH CKE = 0) SS SCK (CKP = 0 SCK (CKP = 1 CKE = 0) Write to SSPBUF
FIGURE 17-5: SPI MODE WAVEFORM (SLAVE MODE WITH CKE = 0) SS SCK (CKP = 0 SCK (CKP = 1 CKE = 0) Write to SSPBUF
P170 · p170_fig021777×1097px
PIC18LF4620-I/P (PDIP-40) — FIGURE 17-6: SPI MODE WAVEFORM (SLAVE MODE WITH CKE = 1) SS SCK (CKP = 0 SCK (CKP = 1 CKE = 1) Write to SSPBUF
FIGURE 17-6: SPI MODE WAVEFORM (SLAVE MODE WITH CKE = 1) SS SCK (CKP = 0 SCK (CKP = 1 CKE = 1) Write to SSPBUF
P170 · p170_fig01P170
PIC18LF4620-I/P (PDIP-40) — Datasheet Page 170 (p170_fig01)
Datasheet Page 170 (p170_fig01)
P385 · p385_fig021371×652px
PIC18LF4620-I/P (PDIP-40) — Note: In the event the full Microchip part number cannot be marked on one line, it will be carried over to the next line, thus limiting the number of available characters for customer-specific information. | 3 e | 3 e
Note: In the event the full Microchip part number cannot be marked on one line, it will be carried over to the next line, thus limiting the number of available characters for customer-specific information. | 3 e | 3 e
P385 · p385_fig02P385
PIC18LF4620-I/P (PDIP-40) — Datasheet Page 385 (p385_fig02)
Datasheet Page 385 (p385_fig02)
Seite 1 / 2 (14 extrahierte Abbildungen)

Elektrische Spezifikationen & Bauteildetails (PIC18LF4620-I/P)

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen (DE)
Standard-Elektronik- & Steckverbinderbauteil
Detaillierte Übersicht:PIC18LF4620-I/P (PDIP-40) ist ein 40-poliges Standard-Elektronik- & Steckverbinderbauteil mit den Gehäuseabmessungen 50.26 × 13.74 × 4.20 mm (Pin-Raster e = 2.54 mm). Ausgelegt für 2.0V to 5.5V Versorgungsspannung, -40°C ~ +85°C (Industrial Grade) Temperaturbereich und UART, SPI, I2C, ADC, PWM, RTC/CLK Schnittstellen.
BetriebsversorgungsspannungV_CC / V_DD
2.0V to 5.5V
100nF + 10µF X7R Stützkondensatoren < 2mm am Versorgungspin platzieren
UmgebungstemperaturbereichT_A
-40°C ~ +85°C (Industrial Grade)
Industrieller Temperaturbereich; T_J(max) = +125°C
Takt- & Funkfrequenzf_CLK / f_RF
32 kHz
Aus offiziellen PDF-Datenblatttabellen extrahiert
Strom- & LeistungsdatenI_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
Maximal zulässigen Pin-Strom beachten
Gehäuseabmessungen (D × E × A)D × E × A
50.26 × 13.74 × 4.20 mm (A1=0.51 mm)
Gehäusefamilie: DIP (PDIP-40)
Pinanzahl & RastermaßN / e
40 Pins | Pitch e = 2.54 mm (100.0 mil)
Nach IPC-7351B Mittenabstand C normalisiert
Integrierte BusschnittstellenBuses
UART, SPI, I2C, ADC, PWM, RTC/CLK
4-Wege-Synchronisation (Symbol ↔ Pinout ↔ 2D ↔ 3D)
Lötprofil & FeuchteempfindlichkeitIPC / MSL
IPC-7351B Level B | J-STD-020 (Peak 260°C) | MSL-3
60% Pastenmasken-Segmentierung auf dem Thermal-Pad
Technischer Sicherheitshinweis: Vor der SMT-Bestückung die Pin-1-Markierung auf dem Bestückungsdruck prüfen.
Technischer Sicherheitshinweis: Thermal-Pad über Ø0.3mm Thermodurchkontaktierungen niederimpedant an die GND-Lage anbinden.

5-Punkte-Industriestandardprüfung

Automatische Geometrie- und Regelprüfung vor dem Dateiexport
5/5 BESTANDEN
IEEE-315 Symbol40 Pins automatisch nach Bussen gruppiert
OK
IPC-7351B Footprint40 Pads · Raster 2.54mm
OK
IPC-7525 60% LotpastenfensterReflow 1:1 Standard
OK
DFM-Fertigungsregeln (JLCPCB / PCBWay)Min. Pad-Abstand: 0.25mm
OK
3D STEP AP214 & GLBKoordinatenursprung deckungsgleich (0,0,0)
OK

Praxisverifikation & Ingenieurbewertungen

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen
5.00 PCB Verified

Mechanische Abmessungen & Land Pattern (PDIP-40)

Aus dem Datenblatt extrahiert & nach IPC-7351B normiert
mm
Gehäusekörper (D × E)Nominal
50.26 × 13.74 mm
Höhe (A) & Raster (e)IPC-7351B
A=4.20mm · e=2.54mm
Pad-Abmessungen (W × L)Level B
1.60 × 1.60 mm
Pins / Gesamt-PadsTopology
40P / 40Pad (THT_DIP)

Empfohlene Peripherie-BOM & Pin-kompatible Ersatztypen (Drop-in)

Passive Begleitbauteile gemäß Referenzschaltung sowie 1:1 pin-kompatible Alternativen
DFM READY
Bauteilbezeichner / Ersatz-MPNWert / GehäuseFunktion & PCB-Layout-Regel
N/A
BOM
Gemäß Applikationsschaltung
PDIP-40
Leiterbahnbreiten für Nennstrom dimensionieren und IPC-2221 Isolationsabstände einhalten.

Häufig gestellte technische Fragen (FAQ) — PIC18LF4620-I/P (PDIP-40)

Schnellantworten zu Pinbelegung, IPC-7351B Land-Pattern-Abmessungen und CAD-Exportformaten
IPC-7351B / IEEE-315

Wie lautet die Pinbelegung (Pinout) und Versorgungsspannung des PIC18LF4620-I/P (PDIP-40)?

Das Bauteil PIC18LF4620-I/P von MICROCHIP im PDIP-40-Gehäuse besitzt 40 Pins mit einem Rastermaß (Pitch) von 2.54 mm und einem Betriebsspannungsbereich VCC von 2.0V to 5.5V. Wichtige Pins: 1 (MCLR#/VPP/RE3: Multiplex-I/O- & Peripherie-Pin MCLR#/VPP/RE3 (General)), 2 (RA0/AN0: Multiplex-I/O- & Peripherie-Pin RA0/AN0 (General)), 3 (RA1/AN1: Multiplex-I/O- & Peripherie-Pin RA1/AN1 (General)), 4 (RA2/AN2/VREF-/CVREF: Multiplex-I/O- & Peripherie-Pin RA2/AN2/VREF-/CVREF (General)), 5 (RA3/AN3/VREF+: Multiplex-I/O- & Peripherie-Pin RA3/AN3/VREF+ (General)), 6 (RA4/T0CKI/C1OUT: Multiplex-I/O- & Peripherie-Pin RA4/T0CKI/C1OUT (General)).

Welche IPC-7351B Land-Pattern-Abmessungen hat der PIC18LF4620-I/P?

Gemäß Datenblatt und IPC-7351B (Density Level B Nominal) betragen die Gehäusemaße des PIC18LF4620-I/P (PDIP-40) 13.74 × 50.26 mm bei einem Pitch e = 2.54 mm und 40 Kupfer-Pads.

Wo können KiCad (.kicad_mod, .kicad_sym), Fusion 360 (.lbr) und 3D-STEP-Modelle für PIC18LF4620-I/P heruntergeladen werden?

Auf dieser Seite können Sie das vollständig verifizierte CAD-Bibliothekspaket für PIC18LF4620-I/P (MICROCHIP, PDIP-40) unter der Open-Hardware-Lizenz CERN-OHL-P-2.0 kostenlos herunterladen: KiCad 8 Footprint (.kicad_mod), Schaltplansymbol (.kicad_sym), Fusion 360 / Eagle (.lbr) und 3D STEP AP214 / WebGL GLB.

Statischer Referenzanhang: Pinbelegungstabelle (40 Pins) & PIC18LF4620 VariantenStatische Tabelle aufklappen
Pin-Nr.SignalnameElektrischer TypFunktionsbeschreibung & Schaltungshinweise
1MCLR#/VPP/RE3Digital_IOSignalanschluss MCLR#/VPP/RE3 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: MCLR#/VPP/RE3. Unterstützte Bus-Schnittstellen: General.
2RA0/AN0Digital_IOSignalanschluss RA0/AN0 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RA0/AN0. Unterstützte Bus-Schnittstellen: General.
3RA1/AN1Digital_IOSignalanschluss RA1/AN1 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RA1/AN1. Unterstützte Bus-Schnittstellen: General.
4RA2/AN2/VREF-/CVREFAnalogSignalanschluss RA2/AN2/VREF-/CVREF (Richtung: Analog, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RA2/AN2/VREF-/CVREF. Unterstützte Bus-Schnittstellen: General.
5RA3/AN3/VREF+AnalogSignalanschluss RA3/AN3/VREF+ (Richtung: Analog, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RA3/AN3/VREF+. Unterstützte Bus-Schnittstellen: General.
6RA4/T0CKI/C1OUTDigital_IOSignalanschluss RA4/T0CKI/C1OUT (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RA4/T0CKI/C1OUT. Unterstützte Bus-Schnittstellen: General.
7NCNo_ConnectNo Connect (Leave Floating)
8RE0/RD#/AN5Digital_IOSignalanschluss RE0/RD#/AN5 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RE0/RD#/AN5. Unterstützte Bus-Schnittstellen: General.
9RE1/WR#/AN6Digital_IOSignalanschluss RE1/WR#/AN6 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RE1/WR#/AN6. Unterstützte Bus-Schnittstellen: General.
10RE2/CS#/AN7Digital_IOSignalanschluss RE2/CS#/AN7 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RE2/CS#/AN7. Unterstützte Bus-Schnittstellen: General.
11VDDPower_InPositiver Versorgungseingang (VDD) im Spannungsbereich 2.0V to 5.5V (Max. 5.5V).
12VSSGNDElektrischer 0V-Masserückführungsanschluss (VSS) für Kernlogik, I/O-Treiber und Analogblöcke.
13OSC1/CLKI/RA7Digital_IOSignalanschluss OSC1/CLKI/RA7 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: OSC1/CLKI/RA7. Unterstützte Bus-Schnittstellen: RTC/CLK.
14OSC2/CLKO/RA6Digital_IOSignalanschluss OSC2/CLKO/RA6 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: OSC2/CLKO/RA6. Unterstützte Bus-Schnittstellen: RTC/CLK.
15RC0/T1OSO/T13CKIDigital_IOSignalanschluss RC0/T1OSO/T13CKI (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC0/T1OSO/T13CKI. Unterstützte Bus-Schnittstellen: General.
16RC1/T1OSI/CCP2Digital_IOSignalanschluss RC1/T1OSI/CCP2 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC1/T1OSI/CCP2. Unterstützte Bus-Schnittstellen: General.
17RC2/CCP1/P1ADigital_IOSignalanschluss RC2/CCP1/P1A (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC2/CCP1/P1A. Unterstützte Bus-Schnittstellen: General.
18RC3/SCK/SCLDigital_IOSignalanschluss RC3/SCK/SCL (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC3/SCK/SCL. Unterstützte Bus-Schnittstellen: SPI, I2C.
19RD0/PSP0Digital_IOSignalanschluss RD0/PSP0 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD0/PSP0. Unterstützte Bus-Schnittstellen: General.
20RD1/PSP1Digital_IOSignalanschluss RD1/PSP1 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD1/PSP1. Unterstützte Bus-Schnittstellen: General.
21RD2/PSP2Digital_IOSignalanschluss RD2/PSP2 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD2/PSP2. Unterstützte Bus-Schnittstellen: General.
22RD3/PSP3Digital_IOSignalanschluss RD3/PSP3 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD3/PSP3. Unterstützte Bus-Schnittstellen: General.
23RC4/SDI/SDADigital_IOSignalanschluss RC4/SDI/SDA (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC4/SDI/SDA. Unterstützte Bus-Schnittstellen: I2C.
24RC5/SDODigital_IOSignalanschluss RC5/SDO (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC5/SDO. Unterstützte Bus-Schnittstellen: General.
25RC6/TX/CKDigital_IOSignalanschluss RC6/TX/CK (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC6/TX/CK. Unterstützte Bus-Schnittstellen: General.
26RC7/RX/DTDigital_IOSignalanschluss RC7/RX/DT (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RC7/RX/DT. Unterstützte Bus-Schnittstellen: General.
27RD4/PSP4Digital_IOSignalanschluss RD4/PSP4 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD4/PSP4. Unterstützte Bus-Schnittstellen: General.
28RD5/PSP5/P1BDigital_IOSignalanschluss RD5/PSP5/P1B (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD5/PSP5/P1B. Unterstützte Bus-Schnittstellen: General.
29RD6/PSP6/P1CDigital_IOSignalanschluss RD6/PSP6/P1C (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD6/PSP6/P1C. Unterstützte Bus-Schnittstellen: General.
30RD7/PSP7/P1DDigital_IOSignalanschluss RD7/PSP7/P1D (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RD7/PSP7/P1D. Unterstützte Bus-Schnittstellen: General.
31VSSGNDElektrischer 0V-Masserückführungsanschluss (VSS) für Kernlogik, I/O-Treiber und Analogblöcke.
32VDDPower_InPositiver Versorgungseingang (VDD) im Spannungsbereich 2.0V to 5.5V (Max. 5.5V).
33RB0/INT0/FLT0/AN12Digital_IOSignalanschluss RB0/INT0/FLT0/AN12 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB0/INT0/FLT0/AN12. Unterstützte Bus-Schnittstellen: General.
34RB1/INT1/AN10Digital_IOSignalanschluss RB1/INT1/AN10 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB1/INT1/AN10. Unterstützte Bus-Schnittstellen: General.
35RB2/INT2/AN8Digital_IOSignalanschluss RB2/INT2/AN8 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB2/INT2/AN8. Unterstützte Bus-Schnittstellen: General.
36RB3/AN9/CCP2Digital_IOSignalanschluss RB3/AN9/CCP2 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB3/AN9/CCP2. Unterstützte Bus-Schnittstellen: General.
37RB4/KBI0/AN11Digital_IOSignalanschluss RB4/KBI0/AN11 (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB4/KBI0/AN11. Unterstützte Bus-Schnittstellen: General.
38RB5/KBI1/PGMDigital_IOSignalanschluss RB5/KBI1/PGM (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB5/KBI1/PGM. Unterstützte Bus-Schnittstellen: General.
39RB6/KBI2/PGCDigital_IOSignalanschluss RB6/KBI2/PGC (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB6/KBI2/PGC. Unterstützte Bus-Schnittstellen: General.
40RB7/KBI3/PGDDigital_IOSignalanschluss RB7/KBI3/PGD (Richtung: I/O, Spannungsbereich: 2.0V to 5.5V). Alternative Multiplex-Funktionen: RB7/KBI3/PGD. Unterstützte Bus-Schnittstellen: General.