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EQCO62X20C1-I/8EX (QFN-16(4x4)) — Symbol, Footprint IPC-7351B & 3D STEP Model

EQCO62X20C1-I/8EX

MICROCHIPID: C5339185QFN-16(4x4) · 17 ピン · Pitch 0.50mmIPC TOLERANCE VARIATION5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · EQCO62X20C1-I/8EX (QFN-16(4x4))1GND2SDIp3SDIn4GND5LFI6AmpR7RiseR8NC9GND17EP16VCC15NC14NC13VCC12GND11SDOp10SDOnGrid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.817.812.77.62.5-2.5-7.6-12.7-17.8mm
2. 2Dフットプリント
1234567891011121314151617E=4.00mm · Pitch e=0.50mmD=4.00mm-4-3-2-10123443210-1-2-3-4mm
3. 3Dモデル
パッケージ外形: 4.00mm × 4.00mm · ピッチ: 0.50mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (17/17)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1GNDGNDグラウンド基準端子 (GND)
2SDIpI/OマルチプレクスI/O・ペリフェラル端子 SDIp (General)
3SDInI/OマルチプレクスI/O・ペリフェラル端子 SDIn (General)
4GNDGNDグラウンド基準端子 (GND)
5LFII/OマルチプレクスI/O・ペリフェラル端子 LFI (General)
6AmpRI/OマルチプレクスI/O・ペリフェラル端子 AmpR (General)
7RiseRI/OマルチプレクスI/O・ペリフェラル端子 RiseR (General)
8NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
9GNDGNDグラウンド基準端子 (GND)
10SDOnI/OマルチプレクスI/O・ペリフェラル端子 SDOn (General)
11SDOpI/OマルチプレクスI/O・ペリフェラル端子 SDOp (General)
12GNDGNDグラウンド基準端子 (GND)
13VCCPower電源供給入力 (VCC — 3.3V / 5.0V Standard Logic)
14NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
15NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
16VCCPower電源供給入力 (VCC — 3.3V / 5.0V Standard Logic)
17EPGND露出サーマルパッド・グラウンド (EP)
PIN 1 GND
GND
グラウンド基準端子 (GND)
設計上の注意点: 0V electrical ground return terminal (GND) for internal core logic, I/O drivers, and analog sub-blocks.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 14 抽出図面)

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PDF VIEWERメーカー公式データシート: EQCO62X20C1-I/8EX (MICROCHIP · QFN-16(4x4))
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1. 実装3D外観モデルREPRESENTATIVE
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (17ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-16(4x4) · 4.00×4.00mm · ピッチ 0.50mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (17 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
EQCO62X20C1-I/8EX (QFN-16(4x4)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (14 点 · 1/2 ページ)
EQCO62X20C1 シリーズの切り抜きなし原本図面 14 点中 1–12 点目を表示
P1 · p01_fig01377×200px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — EQCO62R20.3 6.25 Gbps Asymmetric Coax Equalizer/ EQCO31R20.3 3.125 Gbps Asymmetric Coax Equalizer
EQCO62R20.3 6.25 Gbps Asymmetric Coax Equalizer/ EQCO31R20.3 3.125 Gbps Asymmetric Coax Equalizer
P5 · p05_fig011390×1007px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — FIGURE 1-2: EQCO62R20.3 PIN DIAGRAM(VIEWED FROM TOP)
FIGURE 1-2: EQCO62R20.3 PIN DIAGRAM(VIEWED FROM TOP)
P5 · p05_fig02256×154px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — FIGURE 1-2: EQCO62R20.3 PIN DIAGRAM(VIEWED FROM TOP)
FIGURE 1-2: EQCO62R20.3 PIN DIAGRAM(VIEWED FROM TOP)
P5 · p05_fig01P5
EQCO62X20C1-I/8EX (QFN-16(4x4)) — Datasheet Page 5 (p05_fig01)
Datasheet Page 5 (p05_fig01)
P9 · p09_fig011669×1074px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — FIGURE 2-1: EQCO62R20.3 TYPICAL APPLICATION CIRCUIT
FIGURE 2-1: EQCO62R20.3 TYPICAL APPLICATION CIRCUIT
P9 · p09_fig01P9
EQCO62X20C1-I/8EX (QFN-16(4x4)) — Datasheet Page 9 (p09_fig01)
Datasheet Page 9 (p09_fig01)
P10 · p10_fig011657×1178px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — FIGURE 2-2: RECOMMENDED PCB LAYOUT FOR EQCO62R20.3
FIGURE 2-2: RECOMMENDED PCB LAYOUT FOR EQCO62R20.3
P18 · p18_fig011664×768px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — 4.1 Package Marking Information
4.1 Package Marking Information
P18 · p18_fig021361×615px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — Note: In the event the full Microchip part number cannot be marked on one line, it will be carried over to the next line, thus limiting the number of available characters for customer-specific information. | 3 e | 3 e
Note: In the event the full Microchip part number cannot be marked on one line, it will be carried over to the next line, thus limiting the number of available characters for customer-specific information. | 3 e | 3 e
P18 · p18_fig01P18
EQCO62X20C1-I/8EX (QFN-16(4x4)) — Datasheet Page 18 (p18_fig01)
Datasheet Page 18 (p18_fig01)
P20 · p20_fig011777×2439px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — DS60001302C-page 20  2012-2018 Microchip Technology Inc. | Microchip Technology Drawing C04-259B Sheet 2 of 2 | For the most current package drawings, please see the Microchip Packaging Specification located at http://www.microchip.com/pac
DS60001302C-page 20  2012-2018 Microchip Technology Inc. | Microchip Technology Drawing C04-259B Sheet 2 of 2 | For the most current package drawings, please see the Microchip Packaging Specification located at http://www.microchip.com/pac
P21 · p21_fig011777×2520px
EQCO62X20C1-I/8EX (QFN-16(4x4)) — EQCO62R20.3/EQCO31R20.3
EQCO62R20.3/EQCO31R20.3
1 / 2 ページ (14 点の抽出図面)

電気仕様 & 部品詳細スペック (EQCO62X20C1-I/8EX)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:EQCO62X20C1-I/8EX (QFN-16(4x4)) は 16 ピンの標準電子部品・コネクタで、パッケージ外形は 4.00 × 4.00 × 0.90 mm（ピンピッチ e = 0.50 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C to +85°C、Standard I/O / Passive インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C to +85°C
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
2 GHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
4.00 × 4.00 × 0.90 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-16(4x4))
ピン数・リードピッチN / e
16 Pins | Pitch e = 0.50 mm (19.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Standard I/O / Passive
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル17 ピン自動バス分類
OK
IPC-7351B フットプリント17 パッド · ピッチ 0.50mm
OK
IPC-7525 60% はんだペースト開口EPAD 2.20×2.20mm メッシュ分割
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (QFN-16(4x4))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
4.00 × 4.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.90mm · e=0.50mm
パッド寸法 (W × L)Level B
0.28 × 0.90 mm
ピン数 / 総パッド数Topology
17P / 17Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-16(4x4)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — EQCO62X20C1-I/8EX (QFN-16(4x4))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

EQCO62X20C1-I/8EX (QFN-16(4x4)) のピン配置 (Pinout) および電源電圧仕様は？

MICROCHIP 製 EQCO62X20C1-I/8EX (QFN-16(4x4) パッケージ) は全 17 ピン構成で、ピンピッチは 0.50 mm です。主なピン：1 (GND: グラウンド基準端子 (GND)), 2 (SDIp: マルチプレクスI/O・ペリフェラル端子 SDIp (General)), 3 (SDIn: マルチプレクスI/O・ペリフェラル端子 SDIn (General)), 4 (GND: グラウンド基準端子 (GND)), 5 (LFI: マルチプレクスI/O・ペリフェラル端子 LFI (General)), 6 (AmpR: マルチプレクスI/O・ペリフェラル端子 AmpR (General))。

EQCO62X20C1-I/8EX の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、EQCO62X20C1-I/8EX (QFN-16(4x4)) の本体外形は 4.00 × 4.00 mm、ピッチ e = 0.50 mm、合計 17 パッドで構成されています（中央放熱パッド EPAD 2.20 × 2.20 mm、IPC-7525 60% 開口ペーストマスク付き）。

EQCO62X20C1-I/8EX の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの EQCO62X20C1-I/8EX (MICROCHIP, QFN-16(4x4)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (17 ピン) & EQCO62X20C1 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
2SDIpDigital_IO信号端子 SDIp（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SDIp。対応バス/インターフェース: General。
3SDInDigital_IO信号端子 SDIn（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SDIn。対応バス/インターフェース: General。
4GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
5LFIDigital_IO信号端子 LFI（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: LFI。対応バス/インターフェース: General。
6AmpRDigital_IO信号端子 AmpR（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: AmpR。対応バス/インターフェース: General。
7RiseRDigital_IO信号端子 RiseR（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: RiseR。対応バス/インターフェース: General。
8NCNC信号端子 NC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
9GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
10SDOnDigital_IO信号端子 SDOn（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SDOn。対応バス/インターフェース: General。
11SDOpDigital_IO信号端子 SDOp（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SDOp。対応バス/インターフェース: General。
12GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
13VCCPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VCC、最大定格: 5.5V) です。
14NCNC信号端子 NC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
15NCNC信号端子 NC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
16VCCPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VCC、最大定格: 5.5V) です。
17EPGNDパッケージ底面の露出放熱パッド (EP)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
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