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TLV62585RWTT (QFN-12(2x2)) — Symbol, Footprint IPC-7351B & 3D STEP Model

TLV62585RWTT

TIID: C2070949QFN-12(2x2) · 12 ピン · Pitch 0.50mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · TLV62585RWTT (QFN-12(2x2))1GND2SW3VIN4EN5FB6NC12PGND11SW10VIN9PG8EN7FBGrid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.812.77.62.5-2.5-7.6-12.7mm
2. 2Dフットプリント
121110987654321E=2.00mm · Pitch e=0.50mmD=2.00mm-3-2-101233210-1-2-3mm
3. 3Dモデル
パッケージ外形: 2.00mm × 2.00mm · ピッチ: 0.50mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (12/12)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1GNDGNDグラウンド基準端子 (GND)
2SWI/OマルチプレクスI/O・ペリフェラル端子 SW (General)
3VINPower電源供給入力 (VIN — 2.5 V to 5.5 V)
4ENIシステムイネーブル・ハードウェアリセット (EN)
5FBI/OマルチプレクスI/O・ペリフェラル端子 FB (General)
6NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
7FBI/OマルチプレクスI/O・ペリフェラル端子 FB (General)
8ENIシステムイネーブル・ハードウェアリセット (EN)
9PGI/OマルチプレクスI/O・ペリフェラル端子 PG (CAN)
10VINPower電源供給入力 (VIN — 2.5 V to 5.5 V)
11SWI/OマルチプレクスI/O・ペリフェラル端子 SW (General)
12PGNDGNDグラウンド基準端子 (PGND)
PIN 1 GND
GND
グラウンド基準端子 (GND)
設計上の注意点: Groundpin .
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 14 抽出図面)

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PDF VIEWERメーカー公式データシート: TLV62585RWTT (TI · QFN-12(2x2))
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1. 実装3D外観モデルREPRESENTATIVE
TLV62585RWTT (QFN-12(2x2)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
TLV62585RWTT (QFN-12(2x2)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (12ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
TLV62585RWTT (QFN-12(2x2)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
TLV62585RWTT (QFN-12(2x2)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-12(2x2) · 2.00×2.00mm · ピッチ 0.50mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
TLV62585RWTT (QFN-12(2x2)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (12 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
TLV62585RWTT (QFN-12(2x2)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (14 点 · 1/2 ページ)
TLV62585 シリーズの切り抜きなし原本図面 14 点中 1–12 点目を表示
P3 · p03_fig03パッケージ完全一致
TLV62585RWTT (QFN-12(2x2)) — Pin Functions
Pin Functions
P1 · p01_fig011892×872px
TLV62585RWTT (QFN-12(2x2)) — 空白
空白
P1 · p01_fig01P1
TLV62585RWTT (QFN-12(2x2)) — Datasheet Page 1 (p01_fig01)
Datasheet Page 1 (p01_fig01)
P3 · p03_fig03P3
TLV62585RWTT (QFN-12(2x2)) — Datasheet Page 3 (p03_fig03)
Datasheet Page 3 (p03_fig03)
P8 · p08_fig011292×576px
TLV62585RWTT (QFN-12(2x2)) — 图4. 1.8-V Output Voltage Application
图4. 1.8-V Output Voltage Application
P22 · p22_fig011910×2128px
TLV62585RWTT (QFN-12(2x2)) — PACKAGE OUTLINE
PACKAGE OUTLINE
P23 · p23_fig011910×2145px
TLV62585RWTT (QFN-12(2x2)) — EXAMPLE BOARD LAYOUT
EXAMPLE BOARD LAYOUT
P23 · p23_fig01P23
TLV62585RWTT (QFN-12(2x2)) — Datasheet Page 23 (p23_fig01)
Datasheet Page 23 (p23_fig01)
P24 · p24_fig011910×2146px
TLV62585RWTT (QFN-12(2x2)) — NOTES: (continued) 5. Laser cutting apertures with trapezoidal walls and rounded corners may offer better paste release. IPC-7525 may have alternate design recommendations.
NOTES: (continued) 5. Laser cutting apertures with trapezoidal walls and rounded corners may offer better paste release. IPC-7525 may have alternate design recommendations.
P24 · p24_fig01P24
TLV62585RWTT (QFN-12(2x2)) — Datasheet Page 24 (p24_fig01)
Datasheet Page 24 (p24_fig01)
P25 · p25_fig011910×2138px
TLV62585RWTT (QFN-12(2x2)) — PACKAGE OUTLINE
PACKAGE OUTLINE
P26 · p26_fig011910×2046px
TLV62585RWTT (QFN-12(2x2)) — EXAMPLE BOARD LAYOUT
EXAMPLE BOARD LAYOUT
1 / 2 ページ (14 点の抽出図面)

電気仕様 & 部品詳細スペック (TLV62585RWTT)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:TLV62585RWTT (QFN-12(2x2)) は 12 ピンの標準電子部品・コネクタで、パッケージ外形は 2.00 × 2.00 × 0.90 mm（ピンピッチ e = 0.50 mm）です。動作電源電圧 2.5 V to 5.5 V、動作温度範囲 25°C to 0°C、PWM, CAN インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
2.5 V to 5.5 V
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
25°C to 0°C
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
1.5MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
2.00 × 2.00 × 0.90 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-12(2x2))
ピン数・リードピッチN / e
12 Pins | Pitch e = 0.50 mm (19.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
PWM, CAN
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル12 ピン自動バス分類
OK
IPC-7351B フットプリント12 パッド · ピッチ 0.50mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (QFN-12(2x2))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
2.00 × 2.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.90mm · e=0.50mm
パッド寸法 (W × L)Level B
0.30 × 0.55 mm
ピン数 / 総パッド数Topology
12P / 12Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-12(2x2)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — TLV62585RWTT (QFN-12(2x2))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

TLV62585RWTT (QFN-12(2x2)) のピン配置 (Pinout) および電源電圧仕様は？

TI 製 TLV62585RWTT (QFN-12(2x2) パッケージ) は全 12 ピン構成で、ピンピッチは 0.50 mm、動作電源電圧範囲 VCC は 2.5 V to 5.5 V です。主なピン：1 (GND: グラウンド基準端子 (GND)), 2 (SW: マルチプレクスI/O・ペリフェラル端子 SW (General)), 3 (VIN: 電源供給入力 (VIN — 2.5 V to 5.5 V)), 4 (EN: システムイネーブル・ハードウェアリセット (EN)), 5 (FB: マルチプレクスI/O・ペリフェラル端子 FB (General)), 6 (NC: マルチプレクスI/O・ペリフェラル端子 NC (General))。

TLV62585RWTT の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、TLV62585RWTT (QFN-12(2x2)) の本体外形は 2.00 × 2.00 mm、ピッチ e = 0.50 mm、合計 12 パッドで構成されています。

TLV62585RWTT の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの TLV62585RWTT (TI, QFN-12(2x2)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (12 ピン) & TLV62585 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
2SWDigital_IO信号端子 SW（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: SW。対応バス/インターフェース: General。
3VINPower_In2.5 V to 5.5 V 電源ドメインで動作する正電源入力端子 (VIN、最大定格: 5.5V) です。
4ENDigital_IOチップ有効化およびリセット制御入力 (EN)：Highでチップ起動、Lowでリセット（停止）状態になります。
5FBDigital_IO信号端子 FB（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: FB。対応バス/インターフェース: General。
6NCNC信号端子 NC（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
7FBDigital_IO信号端子 FB（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: FB。対応バス/インターフェース: General。
8ENDigital_IOチップ有効化およびリセット制御入力 (EN)：Highでチップ起動、Lowでリセット（停止）状態になります。
9PGOpen_Drain信号端子 PG（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: PG。対応バス/インターフェース: CAN。
10VINPower_In2.5 V to 5.5 V 電源ドメインで動作する正電源入力端子 (VIN、最大定格: 5.5V) です。
11SWDigital_IO信号端子 SW（方向: I/O、電圧域: 2.5 V to 5.5 V）。多重化オルタネート機能: SW。対応バス/インターフェース: General。
12PGNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (PGND) です。
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