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KP41140SGA (SOP-8) — Symbol, Footprint IPC-7351B & 3D STEP Model

KP41140SGA

Kiwi InstrumentsID: C2692168SOP-8 · 8 ピン · Pitch 1.27mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · KP41140SGA (SOP-8)1GND2GND3GND4VDD8Drain7Drain6Drain5DrainGrid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.810.25.10-5.1-10.2mm
2. 2Dフットプリント
12345678E=3.90mm · Pitch e=1.27mmD=4.90mm-5-4-3-2-101234543210-1-2-3-4mm
3. 3Dモデル
パッケージ外形: 3.90mm × 4.90mm · ピッチ: 1.27mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (8/8)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1GNDGNDグラウンド基準端子 (GND)
2GNDGNDグラウンド基準端子 (GND)
3GNDGNDグラウンド基準端子 (GND)
4VDDPower電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)
5DrainAnalogマルチプレクスI/O・ペリフェラル端子 Drain (General)
6DrainAnalogマルチプレクスI/O・ペリフェラル端子 Drain (General)
7DrainAnalogマルチプレクスI/O・ペリフェラル端子 Drain (General)
8DrainAnalogマルチプレクスI/O・ペリフェラル端子 Drain (General)
PIN 1 GND
GND
グラウンド基準端子 (GND)
設計上の注意点: 0V electrical ground return terminal (GND) for internal core logic, I/O drivers, and analog sub-blocks.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 8 抽出図面)

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PDF VIEWERメーカー公式データシート: KP41140SGA (Kiwi Instruments · SOP-8)
下の埋め込み PDF ビューア内でスクロールやキーワード検索 (Ctrl+F) が可能です
1. 実装3D外観モデルREPRESENTATIVE
KP41140SGA (SOP-8) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
KP41140SGA (SOP-8) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (8ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
KP41140SGA (SOP-8) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
KP41140SGA (SOP-8) - 4. パッケージ外形寸法図 (D×E×A)
SOP-8 · 3.90×4.90mm · ピッチ 1.27mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
KP41140SGA (SOP-8) - 5. 推奨PCBフットプリント
IPC-7351B パッド (8 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
KP41140SGA (SOP-8) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (8 点 · 1/1 ページ)
KP41140 / KP41141 / KP41142 シリーズの切り抜きなし原本図面 8 点中 1–8 点目を表示
P2 · p02_fig01パッケージ完全一致
KP41140SGA (SOP-8) — KP4114X 高性能、副边同步整流功率开关 | 管脚封装 | SOP-8 | 产品标记 | KP41140SG | XXXXXX | YWWZZ | 1 2 3 4 | 8 6 5 | XXXXXX: 晶圆代码 Y: 年份代码 WW: 周代码, 01-52 ZZ: 流水码, 01-99或A0-ZZ | 7 | KP41141SG | XXXXXX | YWWZZ | 1 2 3 4 | 8 6 5 | XXXXXX: 晶圆代码 Y: 年份代码 WW: 周代码, 01-52
KP4114X 高性能、副边同步整流功率开关 | 管脚封装 | SOP-8 | 产品标记 | KP41140SG | XXXXXX | YWWZZ | 1 2 3 4 | 8 6 5 | XXXXXX: 晶圆代码 Y: 年份代码 WW: 周代码, 01-52 ZZ: 流水码, 01-99或A0-ZZ | 7 | KP41141SG | XXXXXX | YWWZZ | 1 2 3 4 | 8 6 5 | XXXXXX: 晶圆代码 Y: 年份代码 WW: 周代码, 01-52
P2 · p02_fig02パッケージ完全一致
KP41140SGA (SOP-8) — SOP-8
SOP-8
P3 · p03_fig01パッケージ完全一致
KP41140SGA (SOP-8) — www.kiwiinst.com 3 DS_KP4114X_REV1.1_CN ©Kiwi Instruments Corp. Confidential
www.kiwiinst.com 3 DS_KP4114X_REV1.1_CN ©Kiwi Instruments Corp. Confidential
P6 · p06_fig01パッケージ完全一致
KP41140SGA (SOP-8) — 必易确保以上信息准确可靠，同时保留在不发布任何通知的情况下对以上信息进行修改的权利。使用者在将 必易的产品整合到任何应用的过程中，应确保不侵犯第三方知识产权；未按以上信息所规定的应用条件和参 数进行使用所造成的损失，必易不负任何法律责任。
必易确保以上信息准确可靠，同时保留在不发布任何通知的情况下对以上信息进行修改的权利。使用者在将 必易的产品整合到任何应用的过程中，应确保不侵犯第三方知识产权；未按以上信息所规定的应用条件和参 数进行使用所造成的损失，必易不负任何法律责任。
P1 · p01_fig011843×2087px
KP41140SGA (SOP-8) — 高性能、副边同步整流功率开关
高性能、副边同步整流功率开关
P1 · p01_fig01P1
KP41140SGA (SOP-8) — Datasheet Page 1 (p01_fig01)
Datasheet Page 1 (p01_fig01)
P2 · p02_fig02P2
KP41140SGA (SOP-8) — Datasheet Page 2 (p02_fig02)
Datasheet Page 2 (p02_fig02)
P6 · p06_fig01P6
KP41140SGA (SOP-8) — Datasheet Page 6 (p06_fig01)
Datasheet Page 6 (p06_fig01)

電気仕様 & 部品詳細スペック (KP41140SGA)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:KP41140SGA (SOP-8) は 8 ピンの標準電子部品・コネクタで、パッケージ外形は 4.90 × 3.90 × 1.75 mm（ピンピッチ e = 1.27 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、Standard I/O / Passive インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
DC / Broadband Passive
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
4.90 × 3.90 × 1.75 mm (A1=0.15 mm)
パッケージ系列: SOP (SOP-8)
ピン数・リードピッチN / e
8 Pins | Pitch e = 1.27 mm (50.0 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Standard I/O / Passive
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル8 ピン自動バス分類
OK
IPC-7351B フットプリント8 パッド · ピッチ 1.27mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified
IPC-7351B

同系列ファミリー & 同一データシート部品 — KP41140 / KP41141 / KP41142 (3)

同一データシートを共有するパッケージ違いやバリアントを選択

機械寸法 & ランドパターン (SOP-8)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
4.90 × 3.90 mm
全高 (A) & ピッチ (e)IPC-7351B
A=1.75mm · e=1.27mm
パッド寸法 (W × L)Level B
0.60 × 1.55 mm
ピン数 / 総パッド数Topology
8P / 8Pad (DUAL_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
SOP-8
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — KP41140SGA (SOP-8)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

KP41140SGA (SOP-8) のピン配置 (Pinout) および電源電圧仕様は？

Kiwi Instruments 製 KP41140SGA (SOP-8 パッケージ) は全 8 ピン構成で、ピンピッチは 1.27 mm です。主なピン：1 (GND: グラウンド基準端子 (GND)), 2 (GND: グラウンド基準端子 (GND)), 3 (GND: グラウンド基準端子 (GND)), 4 (VDD: 電源供給入力 (VDD — 3.3V / 5.0V Standard Logic)), 5 (Drain: マルチプレクスI/O・ペリフェラル端子 Drain (General)), 6 (Drain: マルチプレクスI/O・ペリフェラル端子 Drain (General))。

KP41140SGA の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、KP41140SGA (SOP-8) の本体外形は 3.90 × 4.90 mm、ピッチ e = 1.27 mm、合計 8 パッドで構成されています。

KP41140SGA の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの KP41140SGA (Kiwi Instruments, SOP-8) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (8 ピン) & KP41140 / KP41141 / KP41142 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
2GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
3GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
4VDDPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 5.5V) です。
5DrainAnalog信号端子 Drain（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: Drain。対応バス/インターフェース: General。
6DrainAnalog信号端子 Drain（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: Drain。対応バス/インターフェース: General。
7DrainAnalog信号端子 Drain（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: Drain。対応バス/インターフェース: General。
8DrainAnalog信号端子 Drain（方向: Analog、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: Drain。対応バス/インターフェース: General。
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