KP1072LDP (DIP-7) — Symbol, Footprint IPC-7351B & 3D STEP Model

KP1072LDP

Kiwi InstrumentsID: C2692475DIP-7 · 7 Pins · Pitch 2.54mmIPC-7351B Verified5.0 (0)
SYNCHRONISIERTER 4D-CROSS-PROBE-MODUSKlicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
1. SCHALTPLANSYMBOL
U1 · KP1072LDP (DIP-7)1GND2ROVP3NC4HVDD8CS6DRAIN5DRAINGrid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.210.25.10-5.1-10.2mm
2. 2D-FOOTPRINT
8654321E=9.70mm · Pitch e=2.54mmD=6.40mm-7-5-3-113577531-1-3-5-7mm
3. 3D-MODELL
Gehäusekörper: 9.70mm × 6.40mm · Raster: 2.54mm · Linealschritt: 1.00mmSynchronisiert <100ms

Synchronisierte Pinbelegung (Symbol / 2D / 3D) (7/7)

Klicken oder berühren Sie einen Pin, um ihn zeitgleich in Symbol, Footprint und 3D hervorzuheben
PinSymbolTypFunktionsbeschreibung (DE)
1GNDGNDMasseanschluss (GND)
2ROVPI/OMultiplex-I/O- & Peripherie-Pin ROVP (General)
3NCI/OMultiplex-I/O- & Peripherie-Pin NC (General)
4HVDDPowerVersorgungsspannungseingang (HVDD — 3.3V / 5.0V Standard Logic)
5DRAINAnalogMultiplex-I/O- & Peripherie-Pin DRAIN (General)
6DRAINAnalogMultiplex-I/O- & Peripherie-Pin DRAIN (General)
8CSI/OMultiplex-I/O- & Peripherie-Pin CS (General)
PIN 1 GND
GND
Masseanschluss (GND)
Designhinweis: 0V electrical ground return terminal (GND) for internal core logic, I/O drivers, and analog sub-blocks.
IPC-7351B Lötdichte & Spannweite C/G/Z Konfigurator

Live-PDF-Datenblatt-Viewer & Technische Zeichnungen (6 Standardzeichnungen + 17 Extrahierte Abbildungen)

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PDF VIEWEROffizielles Datenblatt: KP1072LDP (Kiwi Instruments · DIP-7)
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1. Reales 3D-GehäusemodellREPRESENTATIVE
KP1072LDP (DIP-7) - 1. Reales 3D-Gehäusemodell
Detaillierter 3D-VolumenkörperVergrößern ›
2. Standard-Pinbelegung (Draufsicht)CLEANROOM PINOUT
KP1072LDP (DIP-7) - 2. Standard-Pinbelegung (Draufsicht)
Konforme Pinanordnung (7 Pins)Vergrößern ›
3. Original-Datenblatt-PinoutPDF PINOUT
KP1072LDP (DIP-7) - 3. Original-Datenblatt-Pinout
Unbeschnittenes DatenblattdiagrammVergrößern ›
4. Gehäuseabmessungen (D×E×A)PACKAGE DIMENSIONS
KP1072LDP (DIP-7) - 4. Gehäuseabmessungen (D×E×A)
DIP-7 · 9.70×6.40mm · Raster 2.54mmVergrößern ›
5. Empfohlener PCB-FootprintLAND PATTERN
KP1072LDP (DIP-7) - 5. Empfohlener PCB-Footprint
IPC-7351B Land Pattern (7 Pads)Vergrößern ›
6. Typische ApplikationsschaltungSCHEMATIC
KP1072LDP (DIP-7) - 6. Typische Applikationsschaltung
Typical Application SchematicVergrößern ›
Originale Datenblatt-Pinouts & Technische Zeichnungen (17 Abb. · Seite 1/2)
Zeige 1–12 von 17 unbeschnittenen Originalzeichnungen für KP1070 / KP1071 / KP1072
P1 · p01_fig01EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — 非隔离、降压型准谐振 LED 功率开关
非隔离、降压型准谐振 LED 功率开关
P2 · p02_fig01EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — KP107XL 非隔离、降压型准谐振 LED 功率开关
KP107XL 非隔离、降压型准谐振 LED 功率开关
P2 · p02_fig07EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — DIP-7 DIP-7 DIP-7 DIP-7
DIP-7 DIP-7 DIP-7 DIP-7
P2 · p02_fig08EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — DIP-7 DIP-7 DIP-7 DIP-7
DIP-7 DIP-7 DIP-7 DIP-7
P2 · p02_fig09EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — DIP-7 DIP-7 DIP-7 DIP-7
DIP-7 DIP-7 DIP-7 DIP-7
P2 · p02_fig10EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — DIP-7 DIP-7 DIP-7 DIP-7
DIP-7 DIP-7 DIP-7 DIP-7
P8 · p08_fig01EXAKTES GEHÄUSE
KP1072LDP (DIP-7) — 必易确保以上信息准确可靠,同时保留在不发布任何通知的情况下对以上信息进行修改的权利。使用者在将 必易的产品整合到任何应用的过程中,应确保不侵犯第三方知识产权;未按以上信息所规定的应用条件和参 数进行使用所造成的损失,必易不负任何法律责任。
必易确保以上信息准确可靠,同时保留在不发布任何通知的情况下对以上信息进行修改的权利。使用者在将 必易的产品整合到任何应用的过程中,应确保不侵犯第三方知识产权;未按以上信息所规定的应用条件和参 数进行使用所造成的损失,必易不负任何法律责任。
P1 · p01_fig01P1
KP1072LDP (DIP-7) — Datasheet Page 1 (p01_fig01)
Datasheet Page 1 (p01_fig01)
P2 · p02_fig07P2
KP1072LDP (DIP-7) — Datasheet Page 2 (p02_fig07)
Datasheet Page 2 (p02_fig07)
P5 · p05_fig011841×2389px
KP1072LDP (DIP-7) — KP107XL 非隔离、降压型准谐振 LED 功率开关 | TLEB 电流采样前沿消隐时间 (备注 3) 300 500 700 ns | Vcs(max) 峰值电流基准 590 600 610 mV | TD_OC 关断延时 (备注 3) 100 ns | 输出过压保护部分 (ROVP 管脚) | IROVP ROVP 输出电流 49 μA | 使能部分 (ROVP 管脚) | VROVP ROVP 电压 当VROVP<150mV 时,芯 片停止工作 150 mV | 过热
KP107XL 非隔离、降压型准谐振 LED 功率开关 | TLEB 电流采样前沿消隐时间 (备注 3) 300 500 700 ns | Vcs(max) 峰值电流基准 590 600 610 mV | TD_OC 关断延时 (备注 3) 100 ns | 输出过压保护部分 (ROVP 管脚) | IROVP ROVP 输出电流 49 μA | 使能部分 (ROVP 管脚) | VROVP ROVP 电压 当VROVP<150mV 时,芯 片停止工作 150 mV | 过热
P8 · p08_fig01P8
KP1072LDP (DIP-7) — Datasheet Page 8 (p08_fig01)
Datasheet Page 8 (p08_fig01)
P2 · p02_fig02Alle Gehäuse im PDF
KP1072LDP (DIP-7) — SOP-7 SOP-7 SOP-7 SOP-7 SOP-7
SOP-7 SOP-7 SOP-7 SOP-7 SOP-7
Seite 1 / 2 (17 extrahierte Abbildungen)

Elektrische Spezifikationen & Bauteildetails (KP1072LDP)

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen (DE)
Standard-Elektronik- & Steckverbinderbauteil
Detaillierte Übersicht:KP1072LDP (DIP-7) ist ein 7-poliges Standard-Elektronik- & Steckverbinderbauteil mit den Gehäuseabmessungen 9.42 × 10.41 × 3.50 mm (Pin-Raster e = 2.54 mm). Ausgelegt für 1.8V ~ 5.5V (Theo Datasheet) Versorgungsspannung, -40°C ~ +85°C (Industrial Grade) Temperaturbereich und Standard I/O / Passive Schnittstellen.
BetriebsversorgungsspannungV_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
100nF + 10µF X7R Stützkondensatoren < 2mm am Versorgungspin platzieren
UmgebungstemperaturbereichT_A
-40°C ~ +85°C (Industrial Grade)
Industrieller Temperaturbereich; T_J(max) = +125°C
Takt- & Funkfrequenzf_CLK / f_RF
7kHz
Aus offiziellen PDF-Datenblatttabellen extrahiert
Strom- & LeistungsdatenI_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
Maximal zulässigen Pin-Strom beachten
Gehäuseabmessungen (D × E × A)D × E × A
9.42 × 10.41 × 3.50 mm (A1=0.51 mm)
Gehäusefamilie: DIP (DIP-7)
Pinanzahl & RastermaßN / e
7 Pins | Pitch e = 2.54 mm (100.0 mil)
Nach IPC-7351B Mittenabstand C normalisiert
Integrierte BusschnittstellenBuses
Standard I/O / Passive
4-Wege-Synchronisation (Symbol ↔ Pinout ↔ 2D ↔ 3D)
Lötprofil & FeuchteempfindlichkeitIPC / MSL
IPC-7351B Level B | J-STD-020 (Peak 260°C) | MSL-3
60% Pastenmasken-Segmentierung auf dem Thermal-Pad
Technischer Sicherheitshinweis: Vor der SMT-Bestückung die Pin-1-Markierung auf dem Bestückungsdruck prüfen.
Technischer Sicherheitshinweis: Thermal-Pad über Ø0.3mm Thermodurchkontaktierungen niederimpedant an die GND-Lage anbinden.

5-Punkte-Industriestandardprüfung

Automatische Geometrie- und Regelprüfung vor dem Dateiexport
5/5 BESTANDEN
IEEE-315 Symbol7 Pins automatisch nach Bussen gruppiert
OK
IPC-7351B Footprint7 Pads · Raster 2.54mm
OK
IPC-7525 60% LotpastenfensterReflow 1:1 Standard
OK
DFM-Fertigungsregeln (JLCPCB / PCBWay)Min. Pad-Abstand: 0.25mm
OK
3D STEP AP214 & GLBKoordinatenursprung deckungsgleich (0,0,0)
OK

Praxisverifikation & Ingenieurbewertungen

Automatisch aus dem Datenblatt extrahierte Funktionsbeschreibung, Abmessungen, Betriebsspannungsbereich und Schnittstellen
5.00 PCB Verified

Mechanische Abmessungen & Land Pattern (DIP-7)

Aus dem Datenblatt extrahiert & nach IPC-7351B normiert
mm
Gehäusekörper (D × E)Nominal
9.70 × 6.40 mm
Höhe (A) & Raster (e)IPC-7351B
A=3.50mm · e=2.54mm
Pad-Abmessungen (W × L)Level B
1.60 × 1.60 mm
Pins / Gesamt-PadsTopology
7P / 7Pad (THT_DIP)

Empfohlene Peripherie-BOM & Pin-kompatible Ersatztypen (Drop-in)

Passive Begleitbauteile gemäß Referenzschaltung sowie 1:1 pin-kompatible Alternativen
DFM READY
Bauteilbezeichner / Ersatz-MPNWert / GehäuseFunktion & PCB-Layout-Regel
N/A
BOM
Gemäß Applikationsschaltung
DIP-7
Leiterbahnbreiten für Nennstrom dimensionieren und IPC-2221 Isolationsabstände einhalten.

Häufig gestellte technische Fragen (FAQ) — KP1072LDP (DIP-7)

Schnellantworten zu Pinbelegung, IPC-7351B Land-Pattern-Abmessungen und CAD-Exportformaten
IPC-7351B / IEEE-315

Wie lautet die Pinbelegung (Pinout) und Versorgungsspannung des KP1072LDP (DIP-7)?

Das Bauteil KP1072LDP von Kiwi Instruments im DIP-7-Gehäuse besitzt 7 Pins mit einem Rastermaß (Pitch) von 2.54 mm. Wichtige Pins: 1 (GND: Masseanschluss (GND)), 2 (ROVP: Multiplex-I/O- & Peripherie-Pin ROVP (General)), 3 (NC: Multiplex-I/O- & Peripherie-Pin NC (General)), 4 (HVDD: Versorgungsspannungseingang (HVDD — 3.3V / 5.0V Standard Logic)), 5 (DRAIN: Multiplex-I/O- & Peripherie-Pin DRAIN (General)), 6 (DRAIN: Multiplex-I/O- & Peripherie-Pin DRAIN (General)).

Welche IPC-7351B Land-Pattern-Abmessungen hat der KP1072LDP?

Gemäß Datenblatt und IPC-7351B (Density Level B Nominal) betragen die Gehäusemaße des KP1072LDP (DIP-7) 6.40 × 9.70 mm bei einem Pitch e = 2.54 mm und 7 Kupfer-Pads.

Wo können KiCad (.kicad_mod, .kicad_sym), Fusion 360 (.lbr) und 3D-STEP-Modelle für KP1072LDP heruntergeladen werden?

Auf dieser Seite können Sie das vollständig verifizierte CAD-Bibliothekspaket für KP1072LDP (Kiwi Instruments, DIP-7) unter der Open-Hardware-Lizenz CERN-OHL-P-2.0 kostenlos herunterladen: KiCad 8 Footprint (.kicad_mod), Schaltplansymbol (.kicad_sym), Fusion 360 / Eagle (.lbr) und 3D STEP AP214 / WebGL GLB.

Statischer Referenzanhang: Pinbelegungstabelle (7 Pins) & KP1070 / KP1071 / KP1072 VariantenStatische Tabelle aufklappen
Pin-Nr.SignalnameElektrischer TypFunktionsbeschreibung & Schaltungshinweise
1GNDGNDElektrischer 0V-Masserückführungsanschluss (GND) für Kernlogik, I/O-Treiber und Analogblöcke.
2ROVPDigital_IOSignalanschluss ROVP (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: ROVP. Unterstützte Bus-Schnittstellen: General.
3NCNCSignalanschluss NC (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: NC. Unterstützte Bus-Schnittstellen: General.
4HVDDPower_InPositiver Versorgungseingang (HVDD) im Spannungsbereich 3.3V / 5.0V Standard Logic (Max. 5.5V).
5DRAINAnalogSignalanschluss DRAIN (Richtung: Analog, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: DRAIN. Unterstützte Bus-Schnittstellen: General.
6DRAINAnalogSignalanschluss DRAIN (Richtung: Analog, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: DRAIN. Unterstützte Bus-Schnittstellen: General.
8CSDigital_IOSignalanschluss CS (Richtung: I/O, Spannungsbereich: 3.3V / 5.0V Standard Logic). Alternative Multiplex-Funktionen: CS. Unterstützte Bus-Schnittstellen: General.