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COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — Symbol, Footprint IPC-7351B & 3D STEP Model

COM5046P

MICROCHIPID: C20432172PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL · 14 ピン · Pitch 2.54mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL)1XTAL/EXT12XTAL/EXT23+5V4NC5GND6NC7+12V14FOUT13A12B11C10D9ST8FX/4*Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.215.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
1234567891011121314E=6.35mm · Pitch e=2.54mmD=17.24mm-9-7-5-3-113579131197531-1-3-5-7-9-11-13mm
3. 3Dモデル
パッケージ外形: 6.35mm × 17.24mm · ピッチ: 2.54mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (14/14)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1XTAL/EXT1I/OマルチプレクスI/O・ペリフェラル端子 XTAL/EXT1 (RTC/CLK)
2XTAL/EXT2I/OマルチプレクスI/O・ペリフェラル端子 XTAL/EXT2 (RTC/CLK)
3+5VPower電源供給入力 (+5V — 3.3V / 5.0V Standard Logic)
4NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
5GNDGNDグラウンド基準端子 (GND)
6NCI/OマルチプレクスI/O・ペリフェラル端子 NC (General)
7+12VI/OマルチプレクスI/O・ペリフェラル端子 +12V (General)
8FX/4*I/OマルチプレクスI/O・ペリフェラル端子 FX/4* (General)
9STI/OマルチプレクスI/O・ペリフェラル端子 ST (General)
10DI/OマルチプレクスI/O・ペリフェラル端子 D (General)
11CI/OマルチプレクスI/O・ペリフェラル端子 C (General)
12BI/OマルチプレクスI/O・ペリフェラル端子 B (General)
13AI/OマルチプレクスI/O・ペリフェラル端子 A (General)
14FOUTI/OマルチプレクスI/O・ペリフェラル端子 FOUT (General)
PIN 1 XTAL/EXT1
I/O
マルチプレクスI/O・ペリフェラル端子 XTAL/EXT1 (RTC/CLK)
設計上の注意点: Signal terminal XTAL/EXT1 (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: XTAL/EXT1. Supported peripheral buses: RTC/CLK.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 5 抽出図面)

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PDF VIEWERメーカー公式データシート: COM5046P (MICROCHIP · PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL)
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1. 実装3D外観モデルREPRESENTATIVE
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (14ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 4. パッケージ外形寸法図 (D×E×A)
PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL · 6.35×17.24mm · ピッチ 2.54mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 5. 推奨PCBフットプリント
IPC-7351B パッド (14 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (5 点 · 1/1 ページ)
COM5046 シリーズの切り抜きなし原本図面 5 点中 1–5 点目を表示
P1 · p01_fig011803×2288px
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — DARI ICROSYSTE! Se ARD Mt Ms COM 5026T —_ COM 5046 Baud Rate Generator Programmable Divider FEATURES PIN CONFIGURATION Ci On chip crystal oscillator or external frequency input O Choice of 16 output frequencies XTAL/EXT1 1 44 four (16 async
DARI ICROSYSTE! Se ARD Mt Ms COM 5026T —_ COM 5046 Baud Rate Generator Programmable Divider FEATURES PIN CONFIGURATION Ci On chip crystal oscillator or external frequency input O Choice of 16 output frequencies XTAL/EXT1 1 44 four (16 async
P2 · p02_fig011803×2288px
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — GENERAL DESCRIPTION ‘The Standard Microsystems COM 5026/COM 5046 Baud Rate Generator/Programmable Divider is an N-channel COPLAMOS® MOS/LS! device which, from a single crystal (on-chip oscillator) or input frequency is capable of generating
GENERAL DESCRIPTION ‘The Standard Microsystems COM 5026/COM 5046 Baud Rate Generator/Programmable Divider is an N-channel COPLAMOS® MOS/LS! device which, from a single crystal (on-chip oscillator) or input frequency is capable of generating
P4 · p04_fig011803×2288px
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — Crystal Operation External Input Operation COM5016 COM5016/COMS016T COMs036 COM5036/COMS036T 5.0688 MHz Ul ee | | OT TW oy, TI a raxx>] >otT] [} zaxx o o—{] ‘a ™ 7 pep 74XX—totem pole or open collector output (external pull-up resistor requ
Crystal Operation External Input Operation COM5016 COM5016/COMS016T COMs036 COM5036/COMS036T 5.0688 MHz Ul ee | | OT TW oy, TI a raxx>] >otT] [} zaxx o o—{] ‘a ™ 7 pep 74XX—totem pole or open collector output (external pull-up resistor requ
P5 · p05_fig011803×2288px
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — APPLICATIONS INFORMATION +5,0v Charge pump techniques using the +5 volt power 10K t004n supply can be used to generate the + 12 volt | > | > [> power supply required. 1/6 4/6 416 +12 The +12 volt power 7406 7406 7406 OUT supply of figure 1
APPLICATIONS INFORMATION +5,0v Charge pump techniques using the +5 volt power 10K t004n supply can be used to generate the + 12 volt | > | > [> power supply required. 1/6 4/6 416 +12 The +12 volt power 7406 7406 7406 OUT supply of figure 1
P6 · p06_fig011803×2288px
COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) — PDF 抽出図面 p06_fig01 (6 ページ — OTHER_DIAGRAM)
PDF 抽出図面 p06_fig01 (6 ページ — OTHER_DIAGRAM)

電気仕様 & 部品詳細スペック (COM5046P)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) は 14 ピンの標準電子部品・コネクタで、パッケージ外形は 17.24 × 6.35 × 4.20 mm（ピンピッチ e = 2.54 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、RTC/CLK インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
DC / Broadband Passive
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
17.24 × 6.35 × 4.20 mm (A1=0.51 mm)
パッケージ系列: DIP (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL)
ピン数・リードピッチN / e
14 Pins | Pitch e = 2.54 mm (100.0 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
RTC/CLK
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル14 ピン自動バス分類
OK
IPC-7351B フットプリント14 パッド · ピッチ 2.54mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
17.24 × 6.35 mm
全高 (A) & ピッチ (e)IPC-7351B
A=4.20mm · e=2.54mm
パッド寸法 (W × L)Level B
1.60 × 1.60 mm
ピン数 / 総パッド数Topology
14P / 14Pad (THT_DIP)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) のピン配置 (Pinout) および電源電圧仕様は？

MICROCHIP 製 COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL パッケージ) は全 14 ピン構成で、ピンピッチは 2.54 mm です。主なピン：1 (XTAL/EXT1: マルチプレクスI/O・ペリフェラル端子 XTAL/EXT1 (RTC/CLK)), 2 (XTAL/EXT2: マルチプレクスI/O・ペリフェラル端子 XTAL/EXT2 (RTC/CLK)), 3 (+5V: 電源供給入力 (+5V — 3.3V / 5.0V Standard Logic)), 4 (NC: マルチプレクスI/O・ペリフェラル端子 NC (General)), 5 (GND: グラウンド基準端子 (GND)), 6 (NC: マルチプレクスI/O・ペリフェラル端子 NC (General))。

COM5046P の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、COM5046P (PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) の本体外形は 6.35 × 17.24 mm、ピッチ e = 2.54 mm、合計 14 パッドで構成されています。

COM5046P の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの COM5046P (MICROCHIP, PDIP-14_L19.6-W6.5-P2.54-LS7.9-BL) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (14 ピン) & COM5046 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1XTAL/EXT1Digital_IO信号端子 XTAL/EXT1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: XTAL/EXT1。対応バス/インターフェース: RTC/CLK。
2XTAL/EXT2Digital_IO信号端子 XTAL/EXT2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: XTAL/EXT2。対応バス/インターフェース: RTC/CLK。
3+5VPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (+5V、最大定格: 5.5V) です。
4NCNC信号端子 NC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
5GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
6NCNC信号端子 NC（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: NC。対応バス/インターフェース: General。
7+12VDigital_IO信号端子 +12V（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: +12V。対応バス/インターフェース: General。
8FX/4*Digital_IO信号端子 FX/4*（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: FX/4*。対応バス/インターフェース: General。
9STDigital_IO信号端子 ST（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: ST。対応バス/インターフェース: General。
10DDigital_IO信号端子 D（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: D。対応バス/インターフェース: General。
11CDigital_IO信号端子 C（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: C。対応バス/インターフェース: General。
12BDigital_IO信号端子 B（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: B。対応バス/インターフェース: General。
13ADigital_IO信号端子 A（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A。対応バス/インターフェース: General。
14FOUTDigital_IO信号端子 FOUT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: FOUT。対応バス/インターフェース: General。
探索部品パッケージメーカーアップロード