CH9431T (TSSOP-20) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH9431T

WCHID: C54973454TSSOP-20 · 20 引脚 · Pitch 0.65mmIPC-7351B Verified5.0 (0)
4D 同步交叉探测模式 (CROSS-PROBE)点击或悬停任意引脚,同时在原理图、PCB焊盘和3D模型上高亮展示
1. 原理图符号
U1 · CH9431T (TSSOP-20)1CANT2CANR3CLKOUT4TX0RTS#5TX1RTS#6NC7TX2RTS#8OSC_OUT9OSC_IN10VSS20VDD19RESET#18CS#17MISO16MOSI15NC14SCK13INT#12RX0IP#11RX1IP#Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.217.812.77.62.5-2.5-7.6-12.7-17.8mm
2. 2D封装焊盘
1234567891011121314151617181920E=4.40mm · Pitch e=0.65mmD=6.50mm-5-4-3-2-1012345543210-1-2-3-4-5mm
3. 3D实体模型
封装外形: 4.40mm × 6.50mm · 间距 Pitch: 0.65mm · 标尺网格步距: 1.00mm实时同步 <100ms

引脚定义三维联动 (Symbol / 2D / 3D) (20/20)

点击或悬停任意引脚,同时在原理图、PCB焊盘和3D模型上高亮展示
引脚符号类型功能说明 (ZH)
1CANTI/O多功能复用 I/O 与外设引脚 CANT (CAN)
2CANRI/O多功能复用 I/O 与外设引脚 CANR (CAN)
3CLKOUTI/O多功能复用 I/O 与外设引脚 CLKOUT (General)
4TX0RTS#I/O多功能复用 I/O 与外设引脚 TX0RTS# (General)
5TX1RTS#I/O多功能复用 I/O 与外设引脚 TX1RTS# (General)
6NCI/O多功能复用 I/O 与外设引脚 NC (General)
7TX2RTS#I/O多功能复用 I/O 与外设引脚 TX2RTS# (General)
8OSC_OUTI/O多功能复用 I/O 与外设引脚 OSC_OUT (RTC/CLK)
9OSC_INI/O多功能复用 I/O 与外设引脚 OSC_IN (RTC/CLK)
10VSSGND电源参考地引脚 (VSS)
11RX1IP#I/O多功能复用 I/O 与外设引脚 RX1IP# (General)
12RX0IP#I/O多功能复用 I/O 与外设引脚 RX0IP# (General)
13INT#I/O多功能复用 I/O 与外设引脚 INT# (General)
14SCKI/O多功能复用 I/O 与外设引脚 SCK (SPI)
15NCI/O多功能复用 I/O 与外设引脚 NC (General)
16MOSII/O多功能复用 I/O 与外设引脚 MOSI (SPI)
17MISOI/O多功能复用 I/O 与外设引脚 MISO (SPI)
18CS#I/O多功能复用 I/O 与外设引脚 CS# (General)
19RESET#I系统复位 / 芯片使能引脚 (RESET#)
20VDDPower正电源供电引脚 (VDD — 3.3V / 5.0V Standard Logic)
PIN 1 CANT
I/O
多功能复用 I/O 与外设引脚 CANT (CAN)
PCB布线建议: Signal terminal CANT (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: CANT. Supported peripheral buses: CAN.
IPC-7351B 焊接密度与跨距 C/G/Z 调整

规格书PDF在线浏览与工程图画廊 (6 标准工程图 + 3 提取细节图)

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PDF VIEWER原厂官方芯片数据手册: CH9431T (WCH · TSSOP-20)
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1. 3D真实封装照片级模型REPRESENTATIVE
CH9431T (TSSOP-20) - 1. 3D真实封装照片级模型
高精度实体渲染放大 ›
2. 标准引脚分布图 (Top View)CLEANROOM PINOUT
CH9431T (TSSOP-20) - 2. 标准引脚分布图 (Top View)
准确封装引脚分布 (20 引脚)放大 ›
3. 原厂规格书引脚图PDF PINOUT
CH9431T (TSSOP-20) - 3. 原厂规格书引脚图
无损原始引脚图放大 ›
4. 封装机械外形图 (D×E×A)PACKAGE DIMENSIONS
CH9431T (TSSOP-20) - 4. 封装机械外形图 (D×E×A)
TSSOP-20 · 4.40×6.50mm · 节距 0.65mm放大 ›
5. 推荐PCB焊盘图LAND PATTERN
CH9431T (TSSOP-20) - 5. 推荐PCB焊盘图
IPC-7351B 焊盘 (20 Pads)放大 ›
6. 典型应用原理图SCHEMATIC
CH9431T (TSSOP-20) - 6. 典型应用原理图
Typical Application Schematic放大 ›
Datasheet 原始引脚图与技术图纸库 (3 张图纸 · 第 1/1 页)
显示第 1–3 张,共 3 张完整原图 (来自 CH9431 系列)
P34 · p34_fig01精确匹配封装
CH9431T (TSSOP-20) — 13.1 TSSOP20
13.1 TSSOP20
P2 · p02_fig011749×2677px
CH9431T (TSSOP-20) — V1.4 2
V1.4 2
P8 · p08_fig011740×386px
CH9431T (TSSOP-20) — V1.4 8
V1.4 8

电气参数与元器件规格详情 (CH9431T)

基于规格书自动提取的功能描述、封装外形尺寸、工作电压范围及外设接口 (ZH)
标准电子与连接器元件
详细概述:CH9431T (TSSOP-20) 是一款 20 引脚的标准电子与连接器元件,机械封装尺寸为 6.50 × 4.40 × 1.00 mm(引脚间距 e = 0.65 mm)。工作电压范围 1.8V ~ 5.5V (Theo Datasheet),工作温度 -40°C ~ +85°C (Industrial Grade),内置 SPI, CAN, RTC/CLK 通信接口。
工作电源电压范围V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
请在电源引脚 2mm 内布置 100nF + 10µF X7R 去耦电容
工作环境温度范围T_A
-40°C ~ +85°C (Industrial Grade)
工业级温度规范;最高结温 T_J(max) = +125°C
时钟与射频工作频率f_CLK / f_RF
DC / Broadband Passive
源自数据手册电气参数表
额定电流与功耗参数I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
请严格遵守单引脚最大电流限制
机械封装外廓尺寸D × E × A
6.50 × 4.40 × 1.00 mm (A1=0.10 mm)
封装类型:TSSOP (TSSOP-20)
引脚总数与中心间距N / e
20 Pins | Pitch e = 0.65 mm (25.6 mil)
基于 IPC-7351B 中心距 C 数学归一化
内置外设与总线接口Buses
SPI, CAN, RTC/CLK
与原理图符号、2D 焊盘及 3D 模型四向同步
回流焊与潮敏等级规范IPC / MSL
IPC-7351B Level B | J-STD-020 (峰值 260°C) | MSL-3
底部散热焊盘采用 60% 网格钢网开窗防气泡
工程安全警示: SMT 贴片前请核对丝印层第 1 引脚斜角标识。
工程安全警示: 底部散热焊盘需通过 Ø0.3mm 散热过孔阵列连接至内层完整 GND 铜皮。

5项工业标准验证

导出文件前自动执行几何与电气校验
5/5 全部通过
IEEE-315 原理图符号20 个引脚自动按总线分组
OK
IPC-7351B 封装焊盘20 个焊盘 · 节距 0.65mm
OK
IPC-7525 60% 钢网开窗回流焊 1:1 标准
OK
DFM 可制造性规则 (JLCPCB / PCBWay)焊盘最小间距: 0.25mm
OK
3D STEP AP214 & GLB原点完全对齐 (0,0,0)
OK

实物验证与工程师技术评价

基于规格书自动提取的功能描述、封装外形尺寸、工作电压范围及外设接口
5.00 PCB Verified

机械外形尺寸与焊盘 (Land Pattern) (TSSOP-20)

由芯片数据手册提取并按 IPC-7351B 规范化
mm
封装本体尺寸 (D × E)Nominal
6.50 × 4.40 mm
封装高度 (A) 与引脚间距 (e)IPC-7351B
A=1.00mm · e=0.65mm
焊盘尺寸 (W × L)Level B
0.42 × 1.45 mm
引脚数 / 总焊盘数Topology
20P / 20Pad (DUAL_ROW)

推荐外围 BOM 器件与原位替代料号 (Drop-in)

标准应用电路伴随无源器件及引脚 1:1 兼容替代型号
DFM READY
位号 / 替代型号参数值 / 封装电路作用与 PCB 布局规则 (Layout Rule)
N/A
BOM
按应用电路选取
TSSOP-20
按额定负载电流计算走线宽度,并遵循 IPC-2221 电气间隙规范。

工程技术常见问题 (FAQ) — CH9431T (TSSOP-20)

关于引脚定义、IPC-7351B 焊盘尺寸及 CAD 格式导出的快速解答
IPC-7351B / IEEE-315

CH9431T (TSSOP-20) 的引脚排列 (Pinout) 与供电电压参数是什么?

WCH 生产的 CH9431T 采用 TSSOP-20 封装,共 20 脚,引脚间距 0.65 mm。主要引脚包括:1 (CANT: 多功能复用 I/O 与外设引脚 CANT (CAN)), 2 (CANR: 多功能复用 I/O 与外设引脚 CANR (CAN)), 3 (CLKOUT: 多功能复用 I/O 与外设引脚 CLKOUT (General)), 4 (TX0RTS#: 多功能复用 I/O 与外设引脚 TX0RTS# (General)), 5 (TX1RTS#: 多功能复用 I/O 与外设引脚 TX1RTS# (General)), 6 (NC: 多功能复用 I/O 与外设引脚 NC (General))。

CH9431T 的 IPC-7351B 标准 PCB 封装焊盘尺寸是多少?

依据数据手册机械尺寸及 IPC-7351B Level B (中等密度) 规范,CH9431T (TSSOP-20) 本体轮廓为 4.40 × 6.50 mm,引脚间距 e = 0.65 mm,共计 20 个铜箔焊盘。

哪里可以下载 CH9431T 的 KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr) 与 3D STEP 模型?

您可以在本页面免费下载基于 CERN-OHL-P-2.0 开源硬件协议且通过几何校验的 CH9431T (WCH, TSSOP-20) 完整 CAD 库,包含 KiCad 8 封装、原理图符号、Fusion 360 / Eagle (.lbr) 以及 3D STEP AP214 / WebGL GLB 模型。

静态索引附录:引脚分配表 (20 脚) 与 CH9431 系列同族变体展开静态数据表
引脚编号 (Pin #)信号名称 (Signal Name)电气类型 (Type)功能说明与 PCB 设计建议
1CANTRF_50Ohm信号引脚 CANT(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):CANT。支持总线接口:CAN。
2CANRDigital_IO信号引脚 CANR(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):CANR。支持总线接口:CAN。
3CLKOUTDigital_IO信号引脚 CLKOUT(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):CLKOUT。支持总线接口:General。
4TX0RTS#Digital_IO信号引脚 TX0RTS#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):TX0RTS#。支持总线接口:General。
5TX1RTS#Digital_IO信号引脚 TX1RTS#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):TX1RTS#。支持总线接口:General。
6NCNC信号引脚 NC(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):NC。支持总线接口:General。
7TX2RTS#Digital_IO信号引脚 TX2RTS#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):TX2RTS#。支持总线接口:General。
8OSC_OUTDigital_IO信号引脚 OSC_OUT(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):OSC_OUT。支持总线接口:RTC/CLK。
9OSC_INDigital_IO信号引脚 OSC_IN(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):OSC_IN。支持总线接口:RTC/CLK。
10VSSGND0V 接地回路引脚 (VSS),用于芯片内部核心逻辑、I/O 驱动器及模拟电路参考地。
11RX1IP#Digital_IO信号引脚 RX1IP#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):RX1IP#。支持总线接口:General。
12RX0IP#Digital_IO信号引脚 RX0IP#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):RX0IP#。支持总线接口:General。
13INT#Digital_IO信号引脚 INT#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):INT#。支持总线接口:General。
14SCKDigital_IO信号引脚 SCK(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):SCK。支持总线接口:SPI。
15NCNC信号引脚 NC(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):NC。支持总线接口:General。
16MOSIDigital_IO信号引脚 MOSI(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):MOSI。支持总线接口:SPI。
17MISODigital_IO信号引脚 MISO(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):MISO。支持总线接口:SPI。
18CS#Digital_IO信号引脚 CS#(方向:I/O,电压域:3.3V / 5.0V Standard Logic)。复用功能 (Alternate Functions):CS#。支持总线接口:General。
19RESET#Digital_IO低电平有效硬件复位引脚 (RESET#),拉低将复位内核与所有外设寄存器。
20VDDPower_In主供电输入引脚 (VDD),工作电压域:3.3V / 5.0V Standard Logic(最高耐压:5.5V)。