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CH585F (QFN-32(4x4)) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH585F

WCHID: C42381475QFN-32(4x4) · 33 ピン · Pitch 0.40mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH585F (QFN-32(4x4))1PA102VDCID3VSW4VDD335PB9/NFCI/PA96PB9（4） PB87PB178PB169PB15（3）I/O/510PB14（3）I/O/511PB1312PB1213PB1114PB1015PB716PB617PB533EP32PA1131PA1230PA13/SCK0/PW29PA14/MOSI/TX28PA15/MISO/RX27PA5/TXD3/A126PA4/RXD3/A025VDCIA24ANT23VINTA22X32MI21X32MO20PB2219IO2018PB4Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.227.922.917.812.77.62.5-2.5-7.6-12.7-17.8-22.9-27.9mm
2. 2Dフットプリント
123456789101112131415161718192021222324252627282930313233E=4.00mm · Pitch e=0.40mmD=4.00mm-4-3-2-10123443210-1-2-3-4mm
3. 3Dモデル
パッケージ外形: 4.00mm × 4.00mm · ピッチ: 0.40mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (33/33)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1PA10I/OマルチプレクスI/O・ペリフェラル端子 PA10 (General)
2VDCIDI/OマルチプレクスI/O・ペリフェラル端子 VDCID (General)
3VSWI/OマルチプレクスI/O・ペリフェラル端子 VSW (General)
4VDD33Power電源供給入力 (VDD33 — 3.3V / 5.0V Standard Logic)
5PB9/NFCI/PA9/TMR0/A13I/OマルチプレクスI/O・ペリフェラル端子 PB9/NFCI/PA9/TMR0/A13 (General)
6PB9（4） PB8I/OマルチプレクスI/O・ペリフェラル端子 PB9（4） PB8 (General)
7PB17I/OマルチプレクスI/O・ペリフェラル端子 PB17 (General)
8PB16I/OマルチプレクスI/O・ペリフェラル端子 PB16 (General)
9PB15（3）I/O/5VTPower電源供給入力 (PB15（3）I/O/5VT — 3.3V / 5.0V Standard Logic)
10PB14（3）I/O/5VTPower電源供給入力 (PB14（3）I/O/5VT — 3.3V / 5.0V Standard Logic)
11PB13I/OマルチプレクスI/O・ペリフェラル端子 PB13 (UART, SPI, I2C)
12PB12I/OマルチプレクスI/O・ペリフェラル端子 PB12 (UART, I2C)
13PB11I/OマルチプレクスI/O・ペリフェラル端子 PB11 (USB)
14PB10I/OマルチプレクスI/O・ペリフェラル端子 PB10 (General)
15PB7I/OマルチプレクスI/O・ペリフェラル端子 PB7 (UART, PWM)
16PB6I/OマルチプレクスI/O・ペリフェラル端子 PB6 (UART, PWM)
17PB5I/OマルチプレクスI/O・ペリフェラル端子 PB5 (UART)
18PB4I/OマルチプレクスI/O・ペリフェラル端子 PB4 (UART, PWM)
19IO20I/OGPIO20 / RTC_GPIO20 / USB_D+ / U1CTS / ADC2_CH9
20PB22I/OマルチプレクスI/O・ペリフェラル端子 PB22 (UART)
21X32MOI/OマルチプレクスI/O・ペリフェラル端子 X32MO (General)
22X32MII/OマルチプレクスI/O・ペリフェラル端子 X32MI (General)
23VINTAPower電源供給入力 (VINTA — 3.3V / 5.0V Standard Logic)
24ANTI/OマルチプレクスI/O・ペリフェラル端子 ANT (General)
25VDCIAI/OマルチプレクスI/O・ペリフェラル端子 VDCIA (General)
26PA4/RXD3/A0I/OマルチプレクスI/O・ペリフェラル端子 PA4/RXD3/A0 (UART)
27PA5/TXD3/A1I/OマルチプレクスI/O・ペリフェラル端子 PA5/TXD3/A1 (UART)
28PA15/MISO/RXD0_/A5I/OマルチプレクスI/O・ペリフェラル端子 PA15/MISO/RXD0_/A5 (UART, SPI)
29PA14/MOSI/TXD0_/A4I/OマルチプレクスI/O・ペリフェラル端子 PA14/MOSI/TXD0_/A4 (UART, SPI)
30PA13/SCK0/PWM5/A3I/OマルチプレクスI/O・ペリフェラル端子 PA13/SCK0/PWM5/A3 (SPI, PWM)
31PA12I/OマルチプレクスI/O・ペリフェラル端子 PA12 (PWM)
32PA11I/OマルチプレクスI/O・ペリフェラル端子 PA11 (General)
33EPGND露出サーマルパッド・グラウンド (EP)
PIN 1 PA10
I/O
マルチプレクスI/O・ペリフェラル端子 PA10 (General)
設計上の注意点: X32KI /TMR1
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 11 抽出図面)

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PDF VIEWERメーカー公式データシート: CH585F (WCH · QFN-32(4x4))
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1. 実装3D外観モデルREPRESENTATIVE
CH585F (QFN-32(4x4)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH585F (QFN-32(4x4)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (33ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH585F (QFN-32(4x4)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH585F (QFN-32(4x4)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-32(4x4) · 4.00×4.00mm · ピッチ 0.40mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH585F (QFN-32(4x4)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (33 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH585F (QFN-32(4x4)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (11 点 · 1/1 ページ)
CH584 / CH585 シリーズの切り抜きなし原本図面 11 点中 1–11 点目を表示
P1 · p01_fig01247×133px
CH585F (QFN-32(4x4)) — 概述
概述
P3 · p03_fig011128×1216px
CH585F (QFN-32(4x4)) — 2 3
2 3
P3 · p03_fig021132×1128px
CH585F (QFN-32(4x4)) — V1.6 1
V1.6 1
P5 · p05_fig011107×1221px
CH585F (QFN-32(4x4)) — 3 2 3 3
3 2 3 3
P5 · p05_fig021077×1222px
CH585F (QFN-32(4x4)) — 1
1
P5 · p05_fig02P5
CH585F (QFN-32(4x4)) — Datasheet Page 5 (p05_fig02)
Datasheet Page 5 (p05_fig02)
P103 · p103_fig011708×557px
CH585F (QFN-32(4x4)) — CH585/CH584 数据手册 https://wch.cn
CH585/CH584 数据手册 https://wch.cn
P103 · p103_fig021609×396px
CH585F (QFN-32(4x4)) — 12.11 I2C 时序
12.11 I2C 时序
P103 · p103_fig031731×740px
CH585F (QFN-32(4x4)) — | TSsTA | SOARARAZATSCL Maat | 04 | | | us | THSTA | SDATKRBAZIa SCL mRBEAOORESRT] | 04 | | us | TSDA | SCL.EAAZAT SDA MIABAUMESEAA | 0.05 | | |S | THA | SCL_EAIAZ Ia SDABRBOIRERTIA] | >toni@ | | |S | TssTO | SOAFAAZ AN SCL MraeAMAtA | 04 |
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P103 · p103_fig01P103
CH585F (QFN-32(4x4)) — Datasheet Page 103 (p103_fig01)
Datasheet Page 103 (p103_fig01)
P109 · p109_fig011713×1927px
CH585F (QFN-32(4x4)) — V1.6 107
V1.6 107

電気仕様 & 部品詳細スペック (CH585F)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:CH585F (QFN-32(4x4)) は 32 ピンの標準電子部品・コネクタで、パッケージ外形は 4.00 × 4.00 × 0.85 mm（ピンピッチ e = 0.40 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、Bluetooth / BLE, USB, UART, SPI, I2C, ADC, PWM インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
4GHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
4.00 × 4.00 × 0.85 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-32(4x4))
ピン数・リードピッチN / e
32 Pins | Pitch e = 0.40 mm (15.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Bluetooth / BLE, USB, UART, SPI, I2C, ADC, PWM
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル33 ピン自動バス分類
OK
IPC-7351B フットプリント33 パッド · ピッチ 0.40mm
OK
IPC-7525 60% はんだペースト開口EPAD 2.70×2.70mm メッシュ分割
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (QFN-32(4x4))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
4.00 × 4.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.85mm · e=0.40mm
パッド寸法 (W × L)Level B
0.28 × 0.80 mm
ピン数 / 総パッド数Topology
33P / 33Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-32(4x4)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH585F (QFN-32(4x4))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH585F (QFN-32(4x4)) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH585F (QFN-32(4x4) パッケージ) は全 33 ピン構成で、ピンピッチは 0.40 mm です。主なピン：1 (PA10: マルチプレクスI/O・ペリフェラル端子 PA10 (General)), 2 (VDCID: マルチプレクスI/O・ペリフェラル端子 VDCID (General)), 3 (VSW: マルチプレクスI/O・ペリフェラル端子 VSW (General)), 4 (VDD33: 電源供給入力 (VDD33 — 3.3V / 5.0V Standard Logic)), 5 (PB9/NFCI/PA9/TMR0/A13: マルチプレクスI/O・ペリフェラル端子 PB9/NFCI/PA9/TMR0/A13 (General)), 6 (PB9（4） PB8: マルチプレクスI/O・ペリフェラル端子 PB9（4） PB8 (General))。

CH585F の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH585F (QFN-32(4x4)) の本体外形は 4.00 × 4.00 mm、ピッチ e = 0.40 mm、合計 33 パッドで構成されています（中央放熱パッド EPAD 2.70 × 2.70 mm、IPC-7525 60% 開口ペーストマスク付き）。

CH585F の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH585F (WCH, QFN-32(4x4)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (33 ピン) & CH584 / CH585 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1PA10Digital_IO信号端子 PA10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA10。対応バス/インターフェース: General。
2VDCIDDigital_IO信号端子 VDCID（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VDCID。対応バス/インターフェース: General。
3VSWDigital_IO信号端子 VSW（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VSW。対応バス/インターフェース: General。
4VDD33Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD33、最大定格: 5.5V) です。
5PB9/NFCI/PA9/TMR0/A13Digital_IO信号端子 PB9/NFCI/PA9/TMR0/A13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB9/NFCI/PA9/TMR0/A13。対応バス/インターフェース: General。
6PB9（4） PB8Digital_IO信号端子 PB9（4） PB8（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB9（4） PB8。対応バス/インターフェース: General。
7PB17Digital_IO信号端子 PB17（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB17。対応バス/インターフェース: General。
8PB16Digital_IO信号端子 PB16（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB16。対応バス/インターフェース: General。
9PB15（3）I/O/5VTPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (PB15（3）I/O/5VT、最大定格: 5.5V) です。
10PB14（3）I/O/5VTPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (PB14（3）I/O/5VT、最大定格: 5.5V) です。
11PB13Digital_IO信号端子 PB13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB13。対応バス/インターフェース: UART, SPI, I2C。
12PB12Digital_IO信号端子 PB12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB12。対応バス/インターフェース: UART, I2C。
13PB11Digital_IO信号端子 PB11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB11。対応バス/インターフェース: USB。
14PB10Digital_IO信号端子 PB10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB10。対応バス/インターフェース: General。
15PB7Digital_IO信号端子 PB7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB7。対応バス/インターフェース: UART, PWM。
16PB6Digital_IO信号端子 PB6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB6。対応バス/インターフェース: UART, PWM。
17PB5Digital_IO信号端子 PB5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB5。対応バス/インターフェース: UART。
18PB4Digital_IO信号端子 PB4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB4。対応バス/インターフェース: UART, PWM。
19IO20Digital_IOGPIO20 / RTC_GPIO20 / USB_D+ / U1CTS / ADC2_CH9
20PB22Digital_IO信号端子 PB22（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB22。対応バス/インターフェース: UART。
21X32MODigital_IO信号端子 X32MO（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: X32MO。対応バス/インターフェース: General。
22X32MIDigital_IO信号端子 X32MI（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: X32MI。対応バス/インターフェース: General。
23VINTAPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VINTA、最大定格: 5.5V) です。
24ANTRF_50Ohm信号端子 ANT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: ANT。対応バス/インターフェース: General。
25VDCIADigital_IO信号端子 VDCIA（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VDCIA。対応バス/インターフェース: General。
26PA4/RXD3/A0Digital_IO信号端子 PA4/RXD3/A0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA4/RXD3/A0。対応バス/インターフェース: UART。
27PA5/TXD3/A1Digital_IO信号端子 PA5/TXD3/A1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA5/TXD3/A1。対応バス/インターフェース: UART。
28PA15/MISO/RXD0_/A5Digital_IO信号端子 PA15/MISO/RXD0_/A5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: UART, SPI。
29PA14/MOSI/TXD0_/A4Digital_IO信号端子 PA14/MOSI/TXD0_/A4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: UART, SPI。
30PA13/SCK0/PWM5/A3Digital_IO信号端子 PA13/SCK0/PWM5/A3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SPI。対応バス/インターフェース: SPI, PWM。
31PA12Digital_IO信号端子 PA12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA12。対応バス/インターフェース: PWM。
32PA11Digital_IO信号端子 PA11（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA11。対応バス/インターフェース: General。
33EPGNDパッケージ底面の露出放熱パッド (EP)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
探索部品パッケージメーカーアップロード