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CH571R (TSSOP-16) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH571R

WCHID: C39831291TSSOP-16 · 16 ピン · Pitch 0.65mmIPC-7351B Verified5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH571R (TSSOP-16)1PA15/MISO/RX2PA14/MOSI/TX3PA13/SCK0/AI4PA12/SCS/AIN5VIO33/VDD336PA8/RXD17PA9/TMR0/TXD8PB11/UD+/TMR16ANT15GND14VINTA13X32MI12X32MO11PB22/TMR310PB23/RST#/TM9PB10/UD-/TMRGrid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.215.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
12345678910111213141516E=4.40mm · Pitch e=0.65mmD=5.00mm-5-4-3-2-101234543210-1-2-3-4mm
3. 3Dモデル
パッケージ外形: 4.40mm × 5.00mm · ピッチ: 0.65mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (16/16)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1PA15/MISO/RXD0_/AIN5I/OマルチプレクスI/O・ペリフェラル端子 PA15/MISO/RXD0_/AIN5 (UART, SPI, ADC)
2PA14/MOSI/TXD0_/AIN4I/OマルチプレクスI/O・ペリフェラル端子 PA14/MOSI/TXD0_/AIN4 (UART, SPI, ADC)
3PA13/SCK0/AIN3I/OマルチプレクスI/O・ペリフェラル端子 PA13/SCK0/AIN3 (SPI, ADC)
4PA12/SCS/AIN2I/OマルチプレクスI/O・ペリフェラル端子 PA12/SCS/AIN2 (ADC)
5VIO33/VDD33Power電源供給入力 (VIO33/VDD33 — 3.3V / 5.0V Standard Logic)
6PA8/RXD1I/OマルチプレクスI/O・ペリフェラル端子 PA8/RXD1 (UART)
7PA9/TMR0/TXD1I/OマルチプレクスI/O・ペリフェラル端子 PA9/TMR0/TXD1 (UART)
8PB11/UD+/TMR2_I/OマルチプレクスI/O・ペリフェラル端子 PB11/UD+/TMR2_ (USB)
9PB10/UD-/TMR1_I/OマルチプレクスI/O・ペリフェラル端子 PB10/UD-/TMR1_ (USB)
10PB23/RST#/TMR0_I/OマルチプレクスI/O・ペリフェラル端子 PB23/RST#/TMR0_ (General)
11PB22/TMR3I/OマルチプレクスI/O・ペリフェラル端子 PB22/TMR3 (General)
12X32MOI/OマルチプレクスI/O・ペリフェラル端子 X32MO (General)
13X32MII/OマルチプレクスI/O・ペリフェラル端子 X32MI (General)
14VINTAPower電源供給入力 (VINTA — 3.3V / 5.0V Standard Logic)
15GNDGNDグラウンド基準端子 (GND)
16ANTI/OマルチプレクスI/O・ペリフェラル端子 ANT (General)
PIN 1 PA15/MISO/RXD0_/AIN5
I/O
マルチプレクスI/O・ペリフェラル端子 PA15/MISO/RXD0_/AIN5 (UART, SPI, ADC)
設計上の注意点: Signal terminal PA15/MISO/RXD0_/AIN5 (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: PA15/MISO/RXD0_/AIN5. Supported peripheral buses: UART, SPI, ADC.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 8 抽出図面)

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PDF VIEWERメーカー公式データシート: CH571R (WCH · TSSOP-16)
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1. 実装3D外観モデルREPRESENTATIVE
CH571R (TSSOP-16) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH571R (TSSOP-16) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (16ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH571R (TSSOP-16) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH571R (TSSOP-16) - 4. パッケージ外形寸法図 (D×E×A)
TSSOP-16 · 4.40×5.00mm · ピッチ 0.65mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH571R (TSSOP-16) - 5. 推奨PCBフットプリント
IPC-7351B パッド (16 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH571R (TSSOP-16) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (8 点 · 1/1 ページ)
CH571 / CH573 シリーズの切り抜きなし原本図面 8 点中 1–8 点目を表示
P1 · p01_fig01288×163px
CH571R (TSSOP-16) — CH573 是集成BLE 无线通讯的RISC-V MCU 微控制器。片上集成低功耗蓝牙BLE 通讯模块、全速 USB 主机和设备控制器及收发器、SPI、4 个串口、ADC、触摸按键检测模块、RTC 等丰富的外设资源。 功能
CH573 是集成BLE 无线通讯的RISC-V MCU 微控制器。片上集成低功耗蓝牙BLE 通讯模块、全速 USB 主机和设备控制器及收发器、SPI、4 个串口、ADC、触摸按键检测模块、RTC 等丰富的外设资源。 功能
P3 · p03_fig011674×2374px
CH571R (TSSOP-16) — 图1-1 CH573 和CH571 封装引脚排列
图1-1 CH573 和CH571 封装引脚排列
P3 · p03_fig01P3
CH571R (TSSOP-16) — Datasheet Page 3 (p03_fig01)
Datasheet Page 3 (p03_fig01)
P61 · p61_fig011713×2677px
CH571R (TSSOP-16) — V2.3 61 WCH
V2.3 61 WCH
P62 · p62_fig011713×2665px
CH571R (TSSOP-16) — V2.3 62 WCH
V2.3 62 WCH
P63 · p63_fig011713×858px
CH571R (TSSOP-16) — 位 名称 访问 描述 复位值 [7：0] R8_SPI0_FIFO_COUNT RW 当前FIFO 中字节计数。 00h SPI 收发FIFO 计数寄存器(R8_SPI0_FIFO_COUNT1) | 位 名称 访问 描述 复位值 | [7：0] R8_SPI0_FIFO_COUNT1 RW 当前FIFO 中字节计数。 同R8_SPI0_FIFO_COUNT。 00h | SPI 收发数据总长度寄存器(R16_SPI0_TOTAL_CNT) | 位 名称 访问 描述 复位值
位 名称 访问 描述 复位值 [7：0] R8_SPI0_FIFO_COUNT RW 当前FIFO 中字节计数。 00h SPI 收发FIFO 计数寄存器(R8_SPI0_FIFO_COUNT1) | 位 名称 访问 描述 复位值 | [7：0] R8_SPI0_FIFO_COUNT1 RW 当前FIFO 中字节计数。 同R8_SPI0_FIFO_COUNT。 00h | SPI 收发数据总长度寄存器(R16_SPI0_TOTAL_CNT) | 位 名称 访问 描述 复位值
P93 · p93_fig011344×1019px
CH571R (TSSOP-16) — 4.0401 0.2+0. 05 Ld Ld Ld td Ld td td ld U U U U UJ U U UV ra 16> “_ : | BL Is a cde > = - | | 43 - 2.7+0.2 — ~ | Top View |= 41 =| P ;cqJa = Bottom View = =| [coo = = =| lc > CJ sy | _ #32(0 0 @ SM — — — — —— Ie #9[> I Fi Fi ri Fi Fi ri fi
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P93 · p93_fig01P93
CH571R (TSSOP-16) — Datasheet Page 93 (p93_fig01)
Datasheet Page 93 (p93_fig01)

電気仕様 & 部品詳細スペック (CH571R)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:CH571R (TSSOP-16) は 16 ピンの標準電子部品・コネクタで、パッケージ外形は 5.00 × 4.40 × 1.20 mm（ピンピッチ e = 0.65 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、Bluetooth / BLE, USB, SPI, ADC, UART インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
20MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
5.00 × 4.40 × 1.20 mm (A1=0.10 mm)
パッケージ系列: TSSOP (TSSOP-16)
ピン数・リードピッチN / e
16 Pins | Pitch e = 0.65 mm (25.6 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Bluetooth / BLE, USB, SPI, ADC, UART
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル16 ピン自動バス分類
OK
IPC-7351B フットプリント16 パッド · ピッチ 0.65mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (TSSOP-16)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
5.00 × 4.40 mm
全高 (A) & ピッチ (e)IPC-7351B
A=1.20mm · e=0.65mm
パッド寸法 (W × L)Level B
0.42 × 1.45 mm
ピン数 / 総パッド数Topology
16P / 16Pad (DUAL_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
TSSOP-16
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH571R (TSSOP-16)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH571R (TSSOP-16) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH571R (TSSOP-16 パッケージ) は全 16 ピン構成で、ピンピッチは 0.65 mm です。主なピン：1 (PA15/MISO/RXD0_/AIN5: マルチプレクスI/O・ペリフェラル端子 PA15/MISO/RXD0_/AIN5 (UART, SPI, ADC)), 2 (PA14/MOSI/TXD0_/AIN4: マルチプレクスI/O・ペリフェラル端子 PA14/MOSI/TXD0_/AIN4 (UART, SPI, ADC)), 3 (PA13/SCK0/AIN3: マルチプレクスI/O・ペリフェラル端子 PA13/SCK0/AIN3 (SPI, ADC)), 4 (PA12/SCS/AIN2: マルチプレクスI/O・ペリフェラル端子 PA12/SCS/AIN2 (ADC)), 5 (VIO33/VDD33: 電源供給入力 (VIO33/VDD33 — 3.3V / 5.0V Standard Logic)), 6 (PA8/RXD1: マルチプレクスI/O・ペリフェラル端子 PA8/RXD1 (UART))。

CH571R の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH571R (TSSOP-16) の本体外形は 4.40 × 5.00 mm、ピッチ e = 0.65 mm、合計 16 パッドで構成されています。

CH571R の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH571R (WCH, TSSOP-16) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (16 ピン) & CH571 / CH573 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1PA15/MISO/RXD0_/AIN5Digital_IO信号端子 PA15/MISO/RXD0_/AIN5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA15/MISO/RXD0_/AIN5。対応バス/インターフェース: UART, SPI, ADC。
2PA14/MOSI/TXD0_/AIN4Digital_IO信号端子 PA14/MOSI/TXD0_/AIN4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA14/MOSI/TXD0_/AIN4。対応バス/インターフェース: UART, SPI, ADC。
3PA13/SCK0/AIN3Digital_IO信号端子 PA13/SCK0/AIN3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA13/SCK0/AIN3。対応バス/インターフェース: SPI, ADC。
4PA12/SCS/AIN2Analog信号端子 PA12/SCS/AIN2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA12/SCS/AIN2。対応バス/インターフェース: ADC。
5VIO33/VDD33Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VIO33/VDD33、最大定格: 5.5V) です。
6PA8/RXD1Digital_IO信号端子 PA8/RXD1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA8/RXD1。対応バス/インターフェース: UART。
7PA9/TMR0/TXD1Digital_IO信号端子 PA9/TMR0/TXD1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PA9/TMR0/TXD1。対応バス/インターフェース: UART。
8PB11/UD+/TMR2_Digital_IO信号端子 PB11/UD+/TMR2_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB11/UD+/TMR2_。対応バス/インターフェース: USB。
9PB10/UD-/TMR1_Digital_IO信号端子 PB10/UD-/TMR1_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB10/UD-/TMR1_。対応バス/インターフェース: USB。
10PB23/RST#/TMR0_Digital_IO信号端子 PB23/RST#/TMR0_（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB23/RST#/TMR0_。対応バス/インターフェース: General。
11PB22/TMR3Digital_IO信号端子 PB22/TMR3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PB22/TMR3。対応バス/インターフェース: General。
12X32MODigital_IO信号端子 X32MO（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: X32MO。対応バス/インターフェース: General。
13X32MIDigital_IO信号端子 X32MI（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: X32MI。対応バス/インターフェース: General。
14VINTAPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VINTA、最大定格: 5.5V) です。
15GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
16ANTRF_50Ohm信号端子 ANT（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: ANT。対応バス/インターフェース: General。
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