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CH275J (QFN-14F(3x3)) — Symbol, Footprint IPC-7351B & 3D STEP Model

CH275J

WCHID: C55013890QFN-14F(3x3) · 14 ピン · Pitch 0.50mmDISCREPANCY REVIEW REQUIRED5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · CH275J (QFN-14F(3x3))1VDD52AI3AO4PWM15PWM26BS27SW214VDD3313GND12SW111VHV10VHV9CSO8BS1Grid Pitch = 2.54mm (IEEE-315)-15.2-10.2-5.105.110.215.215.210.25.10-5.1-10.2-15.2mm
2. 2Dフットプリント
1356711109812144321E=3.00mm · Pitch e=0.50mmD=3.00mm-4-3-2-1012343210-1-2-3mm
3. 3Dモデル
パッケージ外形: 3.00mm × 3.00mm · ピッチ: 0.50mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (14/14)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1VDD5Power電源供給入力 (VDD5 — 3.3V / 5.0V Standard Logic)
2AII/OマルチプレクスI/O・ペリフェラル端子 AI (General)
3AOI/OマルチプレクスI/O・ペリフェラル端子 AO (General)
4PWM1I/OマルチプレクスI/O・ペリフェラル端子 PWM1 (PWM)
5PWM2I/OマルチプレクスI/O・ペリフェラル端子 PWM2 (PWM)
6BS2I/OマルチプレクスI/O・ペリフェラル端子 BS2 (General)
7SW2I/OマルチプレクスI/O・ペリフェラル端子 SW2 (PWM)
8BS1I/OマルチプレクスI/O・ペリフェラル端子 BS1 (General)
9CSOI/OマルチプレクスI/O・ペリフェラル端子 CSO (General)
10VHVI/OマルチプレクスI/O・ペリフェラル端子 VHV (General)
11VHVI/OマルチプレクスI/O・ペリフェラル端子 VHV (General)
12SW1I/OマルチプレクスI/O・ペリフェラル端子 SW1 (PWM)
13GNDGNDグラウンド基準端子 (GND)
14VDD33Power電源供給入力 (VDD33 — 3.3V / 5.0V Standard Logic)
PIN 1 VDD5
Power
電源供給入力 (VDD5 — 3.3V / 5.0V Standard Logic)
設計上の注意点: 内部5V电压稳压器LDO输出 ， 紧贴引脚外接至少1uF 电容 ，建议2 .2uF 以上
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 8 抽出図面)

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PDF VIEWERメーカー公式データシート: CH275J (WCH · QFN-14F(3x3))
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1. 実装3D外観モデルREPRESENTATIVE
CH275J (QFN-14F(3x3)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
CH275J (QFN-14F(3x3)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (14ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
CH275J (QFN-14F(3x3)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
CH275J (QFN-14F(3x3)) - 4. パッケージ外形寸法図 (D×E×A)
QFN-14F(3x3) · 3.00×3.00mm · ピッチ 0.50mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
CH275J (QFN-14F(3x3)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (14 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
CH275J (QFN-14F(3x3)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (8 点 · 1/1 ページ)
CH275 シリーズの切り抜きなし原本図面 8 点中 1–8 点目を表示
P8 · p08_fig02パッケージ完全一致
CH275J (QFN-14F(3x3)) — 8.1. QFN14F_3x3x0.55-0.5
8.1. QFN14F_3x3x0.55-0.5
P1 · p01_fig011697×1640px
CH275J (QFN-14F(3x3)) — 下面为CH275 的内部框图，仅供参考。
下面为CH275 的内部框图，仅供参考。
P2 · p02_fig011790×1209px
CH275J (QFN-14F(3x3)) — PWM2 5 GND 13 VDD33 14 | VHV 11 VHV 10 CSO 9 | SW1 12 | BS1 8 AI 2 VDD5 1 | SW2 7 | PWM1 4 | BS2 6 | AO 3 | CH275J | PWM2 5 GND 13 VDD33 14 | VHV 11 VHV 10 PWME 9 | SW1 12 | BS1 8 AI 2 VDD5 1 | SW2 7 | PWM1 4 | BS2 6 | AO 3 | CH275P | 3、引脚排
PWM2 5 GND 13 VDD33 14 | VHV 11 VHV 10 CSO 9 | SW1 12 | BS1 8 AI 2 VDD5 1 | SW2 7 | PWM1 4 | BS2 6 | AO 3 | CH275J | PWM2 5 GND 13 VDD33 14 | VHV 11 VHV 10 PWME 9 | SW1 12 | BS1 8 AI 2 VDD5 1 | SW2 7 | PWM1 4 | BS2 6 | AO 3 | CH275P | 3、引脚排
P2 · p02_fig01P2
CH275J (QFN-14F(3x3)) — Datasheet Page 2 (p02_fig01)
Datasheet Page 2 (p02_fig01)
P5 · p05_fig011728×1923px
CH275J (QFN-14F(3x3)) — 版本：1.3 ５
版本：1.3 ５
P7 · p07_fig012018×1589px
CH275J (QFN-14F(3x3)) — 版本：1.3 ７
版本：1.3 ７
P8 · p08_fig011866×800px
CH275J (QFN-14F(3x3)) — 8、封装信息
8、封装信息
P8 · p08_fig01P8
CH275J (QFN-14F(3x3)) — Datasheet Page 8 (p08_fig01)
Datasheet Page 8 (p08_fig01)

電気仕様 & 部品詳細スペック (CH275J)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:CH275J (QFN-14F(3x3)) は 14 ピンの標準電子部品・コネクタで、パッケージ外形は 3.00 × 3.00 × 0.90 mm（ピンピッチ e = 0.50 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、PWM インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
DC / Broadband Passive
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
3.00 × 3.00 × 0.90 mm (A1=0.03 mm)
パッケージ系列: QFN (QFN-14F(3x3))
ピン数・リードピッチN / e
14 Pins | Pitch e = 0.50 mm (19.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
PWM
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: ブートストラップピン注意 (BS2, BS1)：リセット解除時の論理レベルを乱す外部プルアップ/ダウンを避けてください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル14 ピン自動バス分類
OK
IPC-7351B フットプリント14 パッド · ピッチ 0.50mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (QFN-14F(3x3))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
3.00 × 3.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.90mm · e=0.50mm
パッド寸法 (W × L)Level B
0.30 × 0.50 mm
ピン数 / 総パッド数Topology
14P / 14Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
QFN-14F(3x3)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — CH275J (QFN-14F(3x3))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

CH275J (QFN-14F(3x3)) のピン配置 (Pinout) および電源電圧仕様は？

WCH 製 CH275J (QFN-14F(3x3) パッケージ) は全 14 ピン構成で、ピンピッチは 0.50 mm です。主なピン：1 (VDD5: 電源供給入力 (VDD5 — 3.3V / 5.0V Standard Logic)), 2 (AI: マルチプレクスI/O・ペリフェラル端子 AI (General)), 3 (AO: マルチプレクスI/O・ペリフェラル端子 AO (General)), 4 (PWM1: マルチプレクスI/O・ペリフェラル端子 PWM1 (PWM)), 5 (PWM2: マルチプレクスI/O・ペリフェラル端子 PWM2 (PWM)), 6 (BS2: マルチプレクスI/O・ペリフェラル端子 BS2 (General))。

CH275J の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、CH275J (QFN-14F(3x3)) の本体外形は 3.00 × 3.00 mm、ピッチ e = 0.50 mm、合計 14 パッドで構成されています。

CH275J の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの CH275J (WCH, QFN-14F(3x3)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (14 ピン) & CH275 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1VDD5Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD5、最大定格: 5.5V) です。
2AIDigital_IO信号端子 AI（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: AI。対応バス/インターフェース: General。
3AODigital_IO信号端子 AO（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: AO。対応バス/インターフェース: General。
4PWM1Digital_IO信号端子 PWM1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PWM1。対応バス/インターフェース: PWM。
5PWM2Digital_IO信号端子 PWM2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: PWM2。対応バス/インターフェース: PWM。
6BS2Digital_IO信号端子 BS2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: BS2。対応バス/インターフェース: General。
7SW2Digital_IO信号端子 SW2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SW2。対応バス/インターフェース: PWM。
8BS1Digital_IO信号端子 BS1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: BS1。対応バス/インターフェース: General。
9CSODigital_IO信号端子 CSO（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: CSO。対応バス/インターフェース: General。
10VHVDigital_IO信号端子 VHV（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VHV。対応バス/インターフェース: General。
11VHVDigital_IO信号端子 VHV（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VHV。対応バス/インターフェース: General。
12SW1Digital_IO信号端子 SW1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: SW1。対応バス/インターフェース: PWM。
13GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
14VDD33Power_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VDD33、最大定格: 5.5V) です。
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