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STM32L053C8U6 (UFQFPN-48(7x7)) — Symbol, Footprint IPC-7351B & 3D STEP Model

STM32L053C8U6

STID: C529424UFQFPN-48(7x7) · 49 ピン · Pitch 0.50mmIPC TOLERANCE VARIATION5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · STM32L053C8U6 (UFQFPN-48(7x7))1PC132PC14OSC32 IN33V34PH0OSC IN -_5PH1 OSC OUT 6NRST7NRST8VSSA927 -Jun- 20110PA011PA112PA213PA314PA415PA516PA617PA718PB019PB120PB221PB1022PB1123VSS24VDD25PB1249EP48VDD47VSS46PB945PB844BOOT043PB742PB641PB540PB439PB338PA1537PA1436VDD_USB35VSS34PA1333PA1232PA1131PA1030PA929PA828PB1527PB1426PB13Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.838.133.027.922.917.812.77.62.5-2.5-7.6-12.7-17.8-22.9-27.9-33.0-38.1mm
2. 2Dフットプリント
12345678910111213141516171819202122232425262728293031323334353637383940414243444546474849E=7.00mm · Pitch e=0.50mmD=7.00mm-6-5-4-3-2-101234566543210-1-2-3-4-5-6mm
3. 3Dモデル
パッケージ外形: 7.00mm × 7.00mm · ピッチ: 0.50mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (49/49)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1PC13I/OマルチプレクスI/O・ペリフェラル端子 PC13 (RTC/CLK)
2PC14OSC32 IN -_ (PC14)I/OマルチプレクスI/O・ペリフェラル端子 PC14OSC32 IN -_ (PC14) (RTC/CLK)
33V3Power3.3V Main Power Supply Rail (3.0V ~ 3.6V)
4PH0OSC IN -_ (PH0)I/OマルチプレクスI/O・ペリフェラル端子 PH0OSC IN -_ (PH0) (USB, RTC/CLK)
5PH1 OSC OUT -_ (PH1)I/OマルチプレクスI/O・ペリフェラル端子 PH1 OSC OUT -_ (PH1) (RTC/CLK)
6NRSTIシステムイネーブル・ハードウェアリセット (NRST)
7NRSTIシステムイネーブル・ハードウェアリセット (NRST)
8VSSAGNDグラウンド基準端子 (VSSA)
927 -Jun- 2019I/OマルチプレクスI/O・ペリフェラル端子 27 -Jun- 2019 (General)
10PA0I/OマルチプレクスI/O・ペリフェラル端子 PA0 (UART, RTC/CLK)
11PA1I/OマルチプレクスI/O・ペリフェラル端子 PA1 (UART)
12PA2I/OマルチプレクスI/O・ペリフェラル端子 PA2 (UART)
13PA3I/OマルチプレクスI/O・ペリフェラル端子 PA3 (UART)
14PA4I/OマルチプレクスI/O・ペリフェラル端子 PA4 (UART, SPI, DAC)
15PA5I/OマルチプレクスI/O・ペリフェラル端子 PA5 (SPI)
16PA6I/OマルチプレクスI/O・ペリフェラル端子 PA6 (UART, SPI, ADC)
17PA7I/OマルチプレクスI/O・ペリフェラル端子 PA7 (SPI, ADC)
18PB0I/OマルチプレクスI/O・ペリフェラル端子 PB0 (General)
19PB1I/OマルチプレクスI/O・ペリフェラル端子 PB1 (UART, ADC)
20PB2I/OマルチプレクスI/O・ペリフェラル端子 PB2 (General)
21PB10I/OマルチプレクスI/O・ペリフェラル端子 PB10 (SPI)
22PB11I/OマルチプレクスI/O・ペリフェラル端子 PB11 (General)
23VSSGNDグラウンド基準端子 (VSS)
24VDDPower電源供給入力 (VDD — 3.3V VDD (Max 4.0V))
25PB12I/OマルチプレクスI/O・ペリフェラル端子 PB12 (UART, SPI, I2C)
26PB13I/OマルチプレクスI/O・ペリフェラル端子 PB13 (UART, SPI, I2C)
27PB14I/OマルチプレクスI/O・ペリフェラル端子 PB14 (UART, SPI, I2C)
28PB15I/OマルチプレクスI/O・ペリフェラル端子 PB15 (SPI, RTC/CLK)
29PA8I/OマルチプレクスI/O・ペリフェラル端子 PA8 (USB, UART, RTC/CLK)
30PA9I/OマルチプレクスI/O・ペリフェラル端子 PA9 (UART, RTC/CLK)
31PA10I/OマルチプレクスI/O・ペリフェラル端子 PA10 (UART)
32PA11I/OマルチプレクスI/O・ペリフェラル端子 PA11 (USB, UART, SPI)
33PA12I/OマルチプレクスI/O・ペリフェラル端子 PA12 (USB, UART, SPI)
34PA13I/OマルチプレクスI/O・ペリフェラル端子 PA13 (USB, SWD/JTAG)
35VSSGNDグラウンド基準端子 (VSS)
36VDD_USBPower電源供給入力 (VDD_USB — 3.3V VDD (Max 4.0V))
37PA14I/OマルチプレクスI/O・ペリフェラル端子 PA14 (UART, SWD/JTAG)
38PA15I/OマルチプレクスI/O・ペリフェラル端子 PA15 (UART, SPI)
39PB3I/OマルチプレクスI/O・ペリフェラル端子 PB3 (SPI)
40PB4I/OマルチプレクスI/O・ペリフェラル端子 PB4 (SPI)
41PB5I/OマルチプレクスI/O・ペリフェラル端子 PB5 (SPI, I2C)
42PB6I/OマルチプレクスI/O・ペリフェラル端子 PB6 (UART)
43PB7I/OマルチプレクスI/O・ペリフェラル端子 PB7 (UART)
44BOOT0I入力専用端子 BOOT0 (General)
45PB8I/OマルチプレクスI/O・ペリフェラル端子 PB8 (General)
46PB9I/OマルチプレクスI/O・ペリフェラル端子 PB9 (SPI, I2C)
47VSSGNDグラウンド基準端子 (VSS)
48VDDPower電源供給入力 (VDD — 3.3V VDD (Max 4.0V))
49EPGND露出サーマルパッド・グラウンド (EP)
PIN 1 PC13
I/O
マルチプレクスI/O・ペリフェラル端子 PC13 (RTC/CLK)
設計上の注意点: Add: RTC TAMP1/RTC TS/RT__ C OUT/WKUP2_
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

データシートPDF直接表示 & 技術図面ギャラリー (6 標準図面 + 12 抽出図面)

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PDF VIEWERメーカー公式データシート: STM32L053C8U6 (ST · UFQFPN-48(7x7))
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1. 実装3D外観モデルREPRESENTATIVE
STM32L053C8U6 (UFQFPN-48(7x7)) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
STM32L053C8U6 (UFQFPN-48(7x7)) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (49ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
STM32L053C8U6 (UFQFPN-48(7x7)) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
STM32L053C8U6 (UFQFPN-48(7x7)) - 4. パッケージ外形寸法図 (D×E×A)
UFQFPN-48(7x7) · 7.00×7.00mm · ピッチ 0.50mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
STM32L053C8U6 (UFQFPN-48(7x7)) - 5. 推奨PCBフットプリント
IPC-7351B パッド (49 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
STM32L053C8U6 (UFQFPN-48(7x7)) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (12 点 · 1/1 ページ)
STM32L053 シリーズの切り抜きなし原本図面 12 点中 1–12 点目を表示
P1 · p01_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — STM32L053C6 STM32L053C8 STM32L053R6 STM32L053R8 Ultra-low-power 32-bit MCU Arm®-based Cortex®-M0+, up to 64KB | Flash, 8KB SRAM, 2KB EEPROM, LCD, USB, ADC, DAC | Datasheet - production data | LQFP64 10x10 mm | LQFP48 7x7 mm TFBGA64 5x5 mm |
STM32L053C6 STM32L053C8 STM32L053R6 STM32L053R8 Ultra-low-power 32-bit MCU Arm®-based Cortex®-M0+, up to 64KB | Flash, 8KB SRAM, 2KB EEPROM, LCD, USB, ADC, DAC | Datasheet - production data | LQFP64 10x10 mm | LQFP48 7x7 mm TFBGA64 5x5 mm |
P39 · p39_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 5. STM32L053x6/8 LQFP48 pinout
Figure 5. STM32L053x6/8 LQFP48 pinout
P39 · p39_fig02パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 6. STM32L053x6/8 UFQFPN48
Figure 6. STM32L053x6/8 UFQFPN48
P121 · p121_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 43. LQFP48 - 48-pin, 7 x 7 mm low-profile quad flat package outline
Figure 43. LQFP48 - 48-pin, 7 x 7 mm low-profile quad flat package outline
P122 · p122_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 44. LQFP48 - 48-pin, 7 x 7 mm low-profile quad flat recommended footprint
Figure 44. LQFP48 - 48-pin, 7 x 7 mm low-profile quad flat recommended footprint
P124 · p124_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 46. UFQFPN48 - 48 leads, 7x7 mm, 0.5 mm pitch, ultra thin fine pitch quad flat Pin 1 identifier laser marking area
Figure 46. UFQFPN48 - 48 leads, 7x7 mm, 0.5 mm pitch, ultra thin fine pitch quad flat Pin 1 identifier laser marking area
P125 · p125_fig01パッケージ完全一致
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 47. UFQFPN48 - 48 leads, 7x7 mm, 0.5 mm pitch, ultra thin fine pitch quad flat
Figure 47. UFQFPN48 - 48 leads, 7x7 mm, 0.5 mm pitch, ultra thin fine pitch quad flat
P52 · p52_fig011546×1527px
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 9. Power supply scheme
Figure 9. Power supply scheme
P52 · p52_fig01P52
STM32L053C8U6 (UFQFPN-48(7x7)) — Datasheet Page 52 (p52_fig01)
Datasheet Page 52 (p52_fig01)
P53 · p53_fig011546×975px
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 10. Optional LCD power supply scheme
Figure 10. Optional LCD power supply scheme
P53 · p53_fig021546×555px
STM32L053C8U6 (UFQFPN-48(7x7)) — Figure 11. Current consumption measurement scheme
Figure 11. Current consumption measurement scheme
P135 · p135_fig011542×2058px
STM32L053C8U6 (UFQFPN-48(7x7)) — STM32L053x6 STM32L053x8 Revision history
STM32L053x6 STM32L053x8 Revision history

電気仕様 & 部品詳細スペック (STM32L053C8U6)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
組込みマイクロコントローラ (MCU)
詳細概要:STM32L053C8U6 (UFQFPN-48(7x7)) は 48 ピンの組込みマイクロコントローラ (MCU)で、パッケージ外形は 7.00 × 7.00 × 0.55 mm（ピンピッチ e = 0.50 mm）です。動作電源電圧 1.65 V to 3.6 V、動作温度範囲 -40°C ~ +85°C (Industrial Grade)、USB, UART, SPI, I2C, I2S, ADC, DAC, IrDA, RTC/CLK, SWD/JTAG インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.65 V to 3.6 V
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-40°C ~ +85°C (Industrial Grade)
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
32 kHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
5V トレラント (FT) ピン 31 本対応
パッケージ外形寸法 (D × E × A)D × E × A
7.00 × 7.00 × 0.55 mm (A1=0.04 mm)
パッケージ系列: QFN (UFQFPN-48(7x7))
ピン数・リードピッチN / e
48 Pins | Pitch e = 0.50 mm (19.7 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
USB, UART, SPI, I2C, I2S, ADC, DAC, IrDA, RTC/CLK, SWD/JTAG
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: ブートストラップピン注意 (BOOT0)：リセット解除時の論理レベルを乱す外部プルアップ/ダウンを避けてください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル49 ピン自動バス分類
OK
IPC-7351B フットプリント49 パッド · ピッチ 0.50mm
OK
IPC-7525 60% はんだペースト開口EPAD 5.60×5.60mm メッシュ分割
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (UFQFPN-48(7x7))

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
7.00 × 7.00 mm
全高 (A) & ピッチ (e)IPC-7351B
A=0.55mm · e=0.50mm
パッド寸法 (W × L)Level B
0.29 × 0.80 mm
ピン数 / 総パッド数Topology
49P / 49Pad (QUAD_ROW)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
応用回路に準拠
UFQFPN-48(7x7)
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — STM32L053C8U6 (UFQFPN-48(7x7))

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

STM32L053C8U6 (UFQFPN-48(7x7)) のピン配置 (Pinout) および電源電圧仕様は？

ST 製 STM32L053C8U6 (UFQFPN-48(7x7) パッケージ) は全 49 ピン構成で、ピンピッチは 0.50 mm、動作電源電圧範囲 VCC は 1.65 V to 3.6 V です。主なピン：1 (PC13: マルチプレクスI/O・ペリフェラル端子 PC13 (RTC/CLK)), 2 (PC14OSC32 IN -_ (PC14): マルチプレクスI/O・ペリフェラル端子 PC14OSC32 IN -_ (PC14) (RTC/CLK)), 3 (3V3: 3.3V Main Power Supply Rail (3.0V ~ 3.6V)), 4 (PH0OSC IN -_ (PH0): マルチプレクスI/O・ペリフェラル端子 PH0OSC IN -_ (PH0) (USB, RTC/CLK)), 5 (PH1 OSC OUT -_ (PH1): マルチプレクスI/O・ペリフェラル端子 PH1 OSC OUT -_ (PH1) (RTC/CLK)), 6 (NRST: システムイネーブル・ハードウェアリセット (NRST))。

STM32L053C8U6 の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、STM32L053C8U6 (UFQFPN-48(7x7)) の本体外形は 7.00 × 7.00 mm、ピッチ e = 0.50 mm、合計 49 パッドで構成されています（中央放熱パッド EPAD 5.60 × 5.60 mm、IPC-7525 60% 開口ペーストマスク付き）。

STM32L053C8U6 の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの STM32L053C8U6 (ST, UFQFPN-48(7x7)) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (49 ピン) & STM32L053 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1PC13Digital_IO信号端子 PC13（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PC13。対応バス/インターフェース: RTC/CLK。
2PC14OSC32 IN -_ (PC14)Digital_IO信号端子 PC14OSC32 IN -_ (PC14)（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PC14OSC32 IN -_ (PC14)。対応バス/インターフェース: RTC/CLK。
33V3Power_In3.3V Main Power Supply Rail (3.0V ~ 3.6V)
4PH0OSC IN -_ (PH0)Digital_IO信号端子 PH0OSC IN -_ (PH0)（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: PH0OSC IN -_ (PH0)。対応バス/インターフェース: USB, RTC/CLK。
5PH1 OSC OUT -_ (PH1)Digital_IO信号端子 PH1 OSC OUT -_ (PH1)（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: PH1 OSC OUT -_ (PH1)。対応バス/インターフェース: RTC/CLK。
6NRSTDigital_IOローアクティブ・ハードウェアリセット端子 (NRST)：Lowに引くことでコアと全ペリフェラルを初期化します。
7NRSTDigital_IOローアクティブ・ハードウェアリセット端子 (NRST)：Lowに引くことでコアと全ペリフェラルを初期化します。
8VSSAGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSSA) です。
927 -Jun- 2019Digital_IO信号端子 27 -Jun- 2019（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: 27 -Jun- 2019。対応バス/インターフェース: General。
10PA0Digital_IO信号端子 PA0（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: PA0。対応バス/インターフェース: UART, RTC/CLK。
11PA1Digital_IO信号端子 PA1（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA1。対応バス/インターフェース: UART。
12PA2Digital_IO信号端子 PA2（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA2。対応バス/インターフェース: UART。
13PA3Digital_IO信号端子 PA3（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA3。対応バス/インターフェース: UART。
14PA4Digital_IO信号端子 PA4（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: SPI1_NSS_TSCG2IO1。対応バス/インターフェース: UART, SPI, DAC。
15PA5Digital_IO信号端子 PA5（方向: I/O、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: SPI1_SCKTIM2ETR。対応バス/インターフェース: SPI。
16PA6Digital_IO信号端子 PA6（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MISOLCDSEG3。対応バス/インターフェース: UART, SPI, ADC。
17PA7Digital_IO信号端子 PA7（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MOSILCDSEG4。対応バス/インターフェース: SPI, ADC。
18PB0Digital_IO信号端子 PB0（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB0。対応バス/インターフェース: General。
19PB1Digital_IO信号端子 PB1（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB1。対応バス/インターフェース: UART, ADC。
20PB2Digital_IO信号端子 PB2（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB2。対応バス/インターフェース: General。
21PB10Digital_IO信号端子 PB10（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI2_SCKI2C2SCL。対応バス/インターフェース: SPI。
22PB11Digital_IO信号端子 PB11（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB11。対応バス/インターフェース: General。
23VSSGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSS) です。
24VDDPower_In3.3V VDD (Max 4.0V) 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 4.0V) です。
25PB12Digital_IO信号端子 PB12（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI2_NSS, I2C2_SMBAEVENTOUT。対応バス/インターフェース: UART, SPI, I2C。
26PB13Digital_IO信号端子 PB13（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI2_SCK。対応バス/インターフェース: UART, SPI, I2C。
27PB14Digital_IO信号端子 PB14（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI2_MISO。対応バス/インターフェース: UART, SPI, I2C。
28PB15Digital_IO信号端子 PB15（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI2_MOSI。対応バス/インターフェース: SPI, RTC/CLK。
29PA8Digital_IO信号端子 PA8（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA8。対応バス/インターフェース: USB, UART, RTC/CLK。
30PA9Digital_IO信号端子 PA9（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA9。対応バス/インターフェース: UART, RTC/CLK。
31PA10Digital_IO信号端子 PA10（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA10。対応バス/インターフェース: UART。
32PA11Digital_IO信号端子 PA11（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MISOEVENTOUT, USB_DM。対応バス/インターフェース: USB, UART, SPI。
33PA12Digital_IO信号端子 PA12（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MOSIEVENTOUT, USB_DP。対応バス/インターフェース: USB, UART, SPI。
34PA13Digital_IO信号端子 PA13（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA13。対応バス/インターフェース: USB, SWD/JTAG。
35VSSGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSS) です。
36VDD_USBPower_In3.3V VDD (Max 4.0V) 電源ドメインで動作する正電源入力端子 (VDD_USB、最大定格: 4.0V) です。
37PA14Digital_IO信号端子 PA14（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PA14。対応バス/インターフェース: UART, SWD/JTAG。
38PA15Digital_IO信号端子 PA15（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_NSSLCDSEG17。対応バス/インターフェース: UART, SPI。
39PB3Digital_IO信号端子 PB3（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_SCKLCDSEG7。対応バス/インターフェース: SPI。
40PB4Digital_IO信号端子 PB4（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MISOLCDSEG8。対応バス/インターフェース: SPI。
41PB5Digital_IO信号端子 PB5（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: SPI1_MOSILCDSEG9。対応バス/インターフェース: SPI, I2C。
42PB6Digital_IO信号端子 PB6（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB6。対応バス/インターフェース: UART。
43PB7Digital_IO信号端子 PB7（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB7。対応バス/インターフェース: UART。
44BOOT0Digital_IO信号端子 BOOT0（方向: I、電圧域: 3.3V VDD (Max 4.0V)）。多重化オルタネート機能: BOOT0。対応バス/インターフェース: General。
45PB8Digital_IO信号端子 PB8（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: PB8。対応バス/インターフェース: General。
46PB9Digital_IO信号端子 PB9（方向: I/O、電圧域: 3.3V VDD (5V-Tolerant FT)）。多重化オルタネート機能: I2C1_SDA, SPI2_NSS。対応バス/インターフェース: SPI, I2C。
47VSSGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (VSS) です。
48VDDPower_In3.3V VDD (Max 4.0V) 電源ドメインで動作する正電源入力端子 (VDD、最大定格: 4.0V) です。
49EPGNDパッケージ底面の露出放熱パッド (EP)。基板への主要な放熱経路および低インダクタンスの0Vグラウンド帰路として機能します。
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