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AT27C040-90PU (PDIP-32) — Symbol, Footprint IPC-7351B & 3D STEP Model

AT27C040-90PU

MICROCHIPPDIP-32 · 32 ピン · Pitch 2.54mmIPC TOLERANCE VARIATION5.0 (0)
4D 同期クロスプローブモード (CROSS-PROBE)ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
1. シンボル
U1 · AT27C040-90PU (PDIP-32)1VPP2A163A154A125A76A67A58A49A310A211A112A013O014O115O216GND32VCC31A1830A1729A1428A1327A826A925OE24OE#23A1022CE#21O720O619O518O417O3Grid Pitch = 2.54mm (IEEE-315)-17.8-12.7-7.6-2.52.57.612.717.825.420.315.210.25.10-5.1-10.2-15.2-20.3-25.4mm
2. 2Dフットプリント
1234567891011121314151617181920212223242526272829303132E=13.70mm · Pitch e=2.54mmD=40.10mm-19-17-15-13-11-9-7-5-3-1135791113151719312927252321191715131197531-1-3-5-7-9-11-13-15-17-19-21-23-25-27-29-31mm
3. 3Dモデル
パッケージ外形: 13.70mm × 40.10mm · ピッチ: 2.54mm · ルーラー目盛: 1.00mm同期完了 <100ms

同期ピン配置 (Symbol / 2D / 3D) (32/32)

ピンをクリックまたはホバーすると、シンボル、フットプリント、3Dモデル上で同時に強調表示されます
ピン記号種別機能説明 (JA)
1VPPI/OマルチプレクスI/O・ペリフェラル端子 VPP (General)
2A16I/OマルチプレクスI/O・ペリフェラル端子 A16 (General)
3A15I/OマルチプレクスI/O・ペリフェラル端子 A15 (General)
4A12I/OマルチプレクスI/O・ペリフェラル端子 A12 (General)
5A7I/OマルチプレクスI/O・ペリフェラル端子 A7 (General)
6A6I/OマルチプレクスI/O・ペリフェラル端子 A6 (General)
7A5I/OマルチプレクスI/O・ペリフェラル端子 A5 (General)
8A4I/OマルチプレクスI/O・ペリフェラル端子 A4 (General)
9A3I/OマルチプレクスI/O・ペリフェラル端子 A3 (General)
10A2I/OマルチプレクスI/O・ペリフェラル端子 A2 (General)
11A1I/OマルチプレクスI/O・ペリフェラル端子 A1 (General)
12A0I/OマルチプレクスI/O・ペリフェラル端子 A0 (General)
13O0I/OマルチプレクスI/O・ペリフェラル端子 O0 (General)
14O1I/OマルチプレクスI/O・ペリフェラル端子 O1 (General)
15O2I/OマルチプレクスI/O・ペリフェラル端子 O2 (General)
16GNDGNDグラウンド基準端子 (GND)
17O3I/OマルチプレクスI/O・ペリフェラル端子 O3 (General)
18O4I/OマルチプレクスI/O・ペリフェラル端子 O4 (General)
19O5I/OマルチプレクスI/O・ペリフェラル端子 O5 (General)
20O6I/OマルチプレクスI/O・ペリフェラル端子 O6 (General)
21O7I/OマルチプレクスI/O・ペリフェラル端子 O7 (General)
22CE#I/OマルチプレクスI/O・ペリフェラル端子 CE# (General)
23A10I/OマルチプレクスI/O・ペリフェラル端子 A10 (General)
24OE#I/OマルチプレクスI/O・ペリフェラル端子 OE# (General)
25OEI/OマルチプレクスI/O・ペリフェラル端子 OE (General)
26A9I/OマルチプレクスI/O・ペリフェラル端子 A9 (General)
27A8I/OマルチプレクスI/O・ペリフェラル端子 A8 (General)
28A13I/OマルチプレクスI/O・ペリフェラル端子 A13 (General)
29A14I/OマルチプレクスI/O・ペリフェラル端子 A14 (General)
30A17I/OマルチプレクスI/O・ペリフェラル端子 A17 (General)
31A18I/OマルチプレクスI/O・ペリフェラル端子 A18 (General)
32VCCPower電源供給入力 (VCC — 3.3V / 5.0V Standard Logic)
PIN 1 VPP
I/O
マルチプレクスI/O・ペリフェラル端子 VPP (General)
設計上の注意点: Signal terminal VPP (I/O, 3.3V / 5.0V Standard Logic domain). Multiplexed alternate functions: VPP. Supported peripheral buses: General.
IPC-7351B はんだ付け密度 & スパン C/G/Z 設定

抽出図面ギャラリー (6 標準図面 + 5 抽出図面)

原本PDFを直接閲覧、または図面をクリックして全画面拡大
1. 実装3D外観モデルREPRESENTATIVE
AT27C040-90PU (PDIP-32) - 1. 実装3D外観モデル
高精度3Dソリッドモデル拡大 ›
2. 標準ピン配置図 (上面)CLEANROOM PINOUT
AT27C040-90PU (PDIP-32) - 2. 標準ピン配置図 (上面)
パッケージ正規ピン配置 (32ピン)拡大 ›
3. 原本データシートピン図PDF PINOUT
AT27C040-90PU (PDIP-32) - 3. 原本データシートピン図
無トリミングピン配置図拡大 ›
4. パッケージ外形寸法図 (D×E×A)PACKAGE DIMENSIONS
AT27C040-90PU (PDIP-32) - 4. パッケージ外形寸法図 (D×E×A)
PDIP-32 · 13.70×40.10mm · ピッチ 2.54mm拡大 ›
5. 推奨PCBフットプリントLAND PATTERN
AT27C040-90PU (PDIP-32) - 5. 推奨PCBフットプリント
IPC-7351B パッド (32 Pads)拡大 ›
6. アプリケーション参考回路SCHEMATIC
AT27C040-90PU (PDIP-32) - 6. アプリケーション参考回路
Typical Application Schematic拡大 ›
PDF データシート原本ピン配置・技術図面ライブラリ (5 点 · 1/1 ページ)
AT27C040 シリーズの切り抜きなし原本図面 5 点中 1–5 点目を表示
P2 · p02_fig011312×710px
AT27C040-90PU (PDIP-32) — 2 Atmel AT27C040 [DATASHEET]
2 Atmel AT27C040 [DATASHEET]
P10 · p10_fig012027×2262px
AT27C040-90PU (PDIP-32) — 10 Atmel AT27C040 [DATASHEET]
10 Atmel AT27C040 [DATASHEET]
P11 · p11_fig012036×2307px
AT27C040-90PU (PDIP-32) — 11 Atmel AT27C040 [DATASHEET]
11 Atmel AT27C040 [DATASHEET]
P11 · p11_fig01P11
AT27C040-90PU (PDIP-32) — Datasheet Page 11 (p11_fig01)
Datasheet Page 11 (p11_fig01)
P12 · p12_fig012035×569px
AT27C040-90PU (PDIP-32) — 10. Revision History | Doc. Rev. Date Comments | 0189J 10/2012 Update 32P6 package outline drawing. | Update template and Atmel logo. | 0189I 04/2011 Remove TSOP package. | Add lead finish to ordering information. | 0189H 12/2007 Datasheet
10. Revision History | Doc. Rev. Date Comments | 0189J 10/2012 Update 32P6 package outline drawing. | Update template and Atmel logo. | 0189I 04/2011 Remove TSOP package. | Add lead finish to ordering information. | 0189H 12/2007 Datasheet

電気仕様 & 部品詳細スペック (AT27C040-90PU)

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース (JA)
標準電子部品・コネクタ
詳細概要:AT27C040-90PU (PDIP-32) は 32 ピンの標準電子部品・コネクタで、パッケージ外形は 40.10 × 13.70 × 4.20 mm（ピンピッチ e = 2.54 mm）です。動作電源電圧 1.8V ~ 5.5V (Theo Datasheet)、動作温度範囲 -55°C to +125°C、Standard I/O / Passive インターフェースを内蔵しています。
動作電源電圧範囲V_CC / V_DD
1.8V ~ 5.5V (Theo Datasheet)
電源ピンから 2mm 以内に 100nF + 10µF X7R パスコンを配置
動作周囲温度範囲T_A
-55°C to +125°C
工業用温度グレード；最大接合部温度 T_J(max) = +125°C
動作クロック・無線周波数f_CLK / f_RF
5MHz
PDF データシート電気的特性より抽出
出力電流・消費電流定格I_OUT / I_CC
I_GPIO(max) = ±20 mA / pin | I_VDD(total) ≤ 150 mA
ピンあたりの絶対最大定格電流を厳守
パッケージ外形寸法 (D × E × A)D × E × A
40.10 × 13.70 × 4.20 mm (A1=0.51 mm)
パッケージ系列: DIP (PDIP-32)
ピン数・リードピッチN / e
32 Pins | Pitch e = 2.54 mm (100.0 mil)
IPC-7351B 中心間スパン C 準拠
内蔵ペリフェラルバスBuses
Standard I/O / Passive
回路図シンボル・2D フットプリント・3D モデル完全同期
リフロー実装・吸湿感度IPC / MSL
IPC-7351B Level B | J-STD-020 (ピーク 260°C) | MSL-3
サーマルパッドは 60% 分割ステンシル開口を推奨
エンジニアリング警告: 実装前にシルクスクリーンの 1 番ピン面取りマークを確認してください。
エンジニアリング警告: 放熱パッドは Ø0.3mm サーマルビアを介して GND プレーンへ確実に接続してください。

5点工業規格検証

ファイル出力前の自動幾何・電気チェック
5/5 合格
IEEE-315 シンボル32 ピン自動バス分類
OK
IPC-7351B フットプリント32 パッド · ピッチ 2.54mm
OK
IPC-7525 60% はんだペースト開口リフロー標準 1:1
OK
DFM製造基準 (JLCPCB / PCBWay)最小パッド間隙: 0.25mm
OK
3D STEP AP214 & GLB座標原点完全一致 (0,0,0)
OK

実機検証 & コミュニティ技術レビュー

データシートから自動抽出された機能概要、外形寸法、電源電圧範囲、周辺機能インターフェース
5.00 PCB Verified

機械寸法 & ランドパターン (PDIP-32)

データシートから抽出・IPC-7351B 準拠標準化
mm
パッケージ外形 (D × E)Nominal
40.10 × 13.70 mm
全高 (A) & ピッチ (e)IPC-7351B
A=4.20mm · e=2.54mm
パッド寸法 (W × L)Level B
1.60 × 1.60 mm
ピン数 / 総パッド数Topology
32P / 32Pad (THT_DIP)

推奨周辺部品 (BOM) & ピン互換代替品 (Drop-in)

標準アプリケーション回路の受動部品および 1:1 ピン互換代替型番
DFM READY
部品記号 / 代替型番定数 / パッケージ役割 & PCB レイアウトルール
N/A
BOM
Per application circuit
PDIP-32
定格負荷電流に応じた配線幅を確保し、IPC-2221 の絶縁沿面距離規格に準拠してください。

技術的なよくある質問 (FAQ) — AT27C040-90PU (PDIP-32)

ピン配置、IPC-7351B ランドパターン寸法、CAD 出力フォーマットに関する回答
IPC-7351B / IEEE-315

AT27C040-90PU (PDIP-32) のピン配置 (Pinout) および電源電圧仕様は？

MICROCHIP 製 AT27C040-90PU (PDIP-32 パッケージ) は全 32 ピン構成で、ピンピッチは 2.54 mm です。主なピン：1 (VPP: マルチプレクスI/O・ペリフェラル端子 VPP (General)), 2 (A16: マルチプレクスI/O・ペリフェラル端子 A16 (General)), 3 (A15: マルチプレクスI/O・ペリフェラル端子 A15 (General)), 4 (A12: マルチプレクスI/O・ペリフェラル端子 A12 (General)), 5 (A7: マルチプレクスI/O・ペリフェラル端子 A7 (General)), 6 (A6: マルチプレクスI/O・ペリフェラル端子 A6 (General))。

AT27C040-90PU の IPC-7351B 準拠 PCB フットプリント寸法は？

データシート外形図および IPC-7351B Level B (標準密度) に基づき、AT27C040-90PU (PDIP-32) の本体外形は 13.70 × 40.10 mm、ピッチ e = 2.54 mm、合計 32 パッドで構成されています。

AT27C040-90PU の KiCad (.kicad_mod, .kicad_sym)、Fusion 360 (.lbr)、3D STEP モデルはどこでダウンロードできますか？

このページから CERN-OHL-P-2.0 ライセンスの下で検証済みの AT27C040-90PU (MICROCHIP, PDIP-32) CAD ライブラリパッケージ（KiCad 8、Autodesk Fusion 360 / Eagle .lbr、3D STEP AP214 & WebGL GLB）を無料で直接ダウンロードできます。

静的リファレンス付録：ピン配置表 (32 ピン) & AT27C040 シリーズバリエーション静的テーブルを開く
ピン番号 (Pin #)信号名 (Signal Name)電気種別 (Type)機能説明 & 回路設計上の注意
1VPPDigital_IO信号端子 VPP（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: VPP。対応バス/インターフェース: General。
2A16Digital_IO信号端子 A16（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A16。対応バス/インターフェース: General。
3A15Digital_IO信号端子 A15（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A15。対応バス/インターフェース: General。
4A12Digital_IO信号端子 A12（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A12。対応バス/インターフェース: General。
5A7Digital_IO信号端子 A7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A7。対応バス/インターフェース: General。
6A6Digital_IO信号端子 A6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A6。対応バス/インターフェース: General。
7A5Digital_IO信号端子 A5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A5。対応バス/インターフェース: General。
8A4Digital_IO信号端子 A4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A4。対応バス/インターフェース: General。
9A3Digital_IO信号端子 A3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A3。対応バス/インターフェース: General。
10A2Digital_IO信号端子 A2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A2。対応バス/インターフェース: General。
11A1Digital_IO信号端子 A1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A1。対応バス/インターフェース: General。
12A0Digital_IO信号端子 A0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A0。対応バス/インターフェース: General。
13O0Digital_IO信号端子 O0（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O0。対応バス/インターフェース: General。
14O1Digital_IO信号端子 O1（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O1。対応バス/インターフェース: General。
15O2Digital_IO信号端子 O2（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O2。対応バス/インターフェース: General。
16GNDGND内部ロジック、I/Oドライバ、アナログ回路の共通帰路となる0Vグラウンド端子 (GND) です。
17O3Digital_IO信号端子 O3（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O3。対応バス/インターフェース: General。
18O4Digital_IO信号端子 O4（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O4。対応バス/インターフェース: General。
19O5Digital_IO信号端子 O5（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O5。対応バス/インターフェース: General。
20O6Digital_IO信号端子 O6（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O6。対応バス/インターフェース: General。
21O7Digital_IO信号端子 O7（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: O7。対応バス/インターフェース: General。
22CE#Digital_IO信号端子 CE#（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: CE#。対応バス/インターフェース: General。
23A10Digital_IO信号端子 A10（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A10。対応バス/インターフェース: General。
24OE#Digital_IO信号端子 OE#（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: OE#。対応バス/インターフェース: General。
25OEDigital_IO信号端子 OE（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: OE。対応バス/インターフェース: General。
26A9Digital_IO信号端子 A9（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A9。対応バス/インターフェース: General。
27A8Digital_IO信号端子 A8（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A8。対応バス/インターフェース: General。
28A13Digital_IO信号端子 A13（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A13。対応バス/インターフェース: General。
29A14Digital_IO信号端子 A14（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A14。対応バス/インターフェース: General。
30A17Digital_IO信号端子 A17（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A17。対応バス/インターフェース: General。
31A18Digital_IO信号端子 A18（方向: I/O、電圧域: 3.3V / 5.0V Standard Logic）。多重化オルタネート機能: A18。対応バス/インターフェース: General。
32VCCPower_In3.3V / 5.0V Standard Logic 電源ドメインで動作する正電源入力端子 (VCC、最大定格: 5.5V) です。
探索部品パッケージメーカーアップロード